倒數(shù)計(jì)時(shí)器 提供時(shí)間到關(guān)機(jī)的功能 可自由設(shè)定是否關(guān)機(jī)或者提供警示
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上傳時(shí)間： 2016-02-02
上傳用戶：lepoke
FPGA可促進(jìn)嵌入式系統(tǒng)設(shè)計(jì)改善即時(shí)應(yīng)用性能，臺灣人寫的，關(guān)于FPGA應(yīng)用的技術(shù)文章
標(biāo)簽： FPGA 嵌入式 系統(tǒng) 性能
上傳時(shí)間： 2013-08-20
上傳用戶：liuwei6419
對多維的矩陣,做大量矩陣的的計(jì)算,來試探實(shí)際效能以及處理時(shí)間.
標(biāo)簽： 效能
上傳時(shí)間： 2015-03-26
上傳用戶：許小華
這個(gè)程式可以用來觀察其他程式的VCL組態(tài)、記憶體內(nèi)容。幫助設(shè)計(jì)時(shí)的runtime debug。 當(dāng)然也可以用來看別人程式中用了什麼元件、設(shè)計(jì)了什麼property
標(biāo)簽： property runtime debug 程式
上傳時(shí)間： 2015-04-11
上傳用戶：ynzfm
家具行業(yè)的成本核算報(bào)價(jià)系統(tǒng),主要征對家個(gè)產(chǎn)品的結(jié)構(gòu)展開進(jìn)行材料成本及人工制造費(fèi)用統(tǒng)計(jì),加上可調(diào)節(jié)的利潤設(shè)定,將其成本核算出來,同時(shí)將報(bào)價(jià)單作出來
上傳時(shí)間： 2014-01-21
上傳用戶：songnanhua
設(shè)計(jì)VHDL24小時(shí)的時(shí)鐘，去除了按鍵彈跳現(xiàn)象
上傳時(shí)間： 2013-12-23
上傳用戶：hzy5825468
這是一個(gè)簡單的小工具,有點(diǎn)類似我們使用form方式設(shè)計(jì)時(shí),使用behaver方式讓各個(gè)form作轉(zhuǎn)場特效一樣,不過這個(gè)工具是針對各個(gè)movie clip,相信對一些Art設(shè)計(jì)師有一定的幫助囉, 使用的是Transition manager方式完成,相信不久會有利用tween class方式的程式產(chǎn)生器吧..其實(shí)我還蠻需要的...因?yàn)閔elp檔沒有,有時(shí)要參考指令,都要上網(wǎng)查一次
標(biāo)簽： form behaver movie clip
上傳時(shí)間： 2013-12-17
上傳用戶：hasan2015
一個(gè)很好用的 lcd 時(shí)鐘程序 C語言 #include<reg51.h> #include<stdio.h> //定義計(jì)時(shí)器0 的重裝值 #define RELOAD_HIGH 0x3C #define RELOAD_LOW 0xD2 //定義按鍵彈跳時(shí)間 #define DB_VAL //定義設(shè)置模式的最大時(shí)間間隔 #define TIMEOUT 200 //定義游標(biāo)位置常數(shù) #define HOME 0 #define HOUR 1 #define MIN 2 #define SEC 3
標(biāo)簽： include define RELOAD stdio
上傳時(shí)間： 2014-12-19
上傳用戶：zukfu
使用VHDL設(shè)計(jì)一個(gè)適用於ETSI OFDM的時(shí)間和頻率同步處理器
上傳時(shí)間： 2015-09-21
上傳用戶：luke5347
FPGA可促進(jìn)嵌入式系統(tǒng)設(shè)計(jì)改善即時(shí)應(yīng)用性能，臺灣人寫的，關(guān)于FPGA應(yīng)用的技術(shù)文章
標(biāo)簽： FPGA 嵌入式 系統(tǒng) 性能
上傳時(shí)間： 2014-01-17
上傳用戶：ljt101007
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