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在互補式金氧半(CMOS)積體電路中，隨著量產製程的演進，元件的尺寸已縮減到深次微 米(deep-submicron)階段，以增進積體電路(IC)的性能及運算速度，以及降低每顆晶片的製造 成本。但隨著元件尺寸的縮減，卻出現一些可靠度的問題。 在次微米技術中，為了克服所謂熱載子(Hot-Carrier)問題而發展出 LDD(Lightly-Doped Drain) 製程與結構; 為了降低 CMOS 元件汲極(drain)與源極(source)的寄生電阻(sheet resistance) Rs 與 Rd，而發展出 Silicide 製程; 為了降低 CMOS 元件閘級的寄生電阻 Rg，而發展出 Polycide 製 程 ; 在更進步的製程中把 Silicide 與 Polycide 一起製造，而發展出所謂 Salicide 製程
標簽： Protection CMOS ESD ICs in
上傳時間： 2020-06-05
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設計高速電路必須考慮高速訊 號所引發的電磁干擾、阻抗匹配及串音等效應，所以訊號完整性 (signal integrity)將是考量設計電路優劣的一項重要指標，電路日異複雜必須仰賴可 靠的軟體來幫忙分析這些複雜的效應，才比較可能獲得高品質且可靠的設計， 因此熟悉軟體的使用也將是重要的研究項目之一。另外了解高速訊號所引發之 各種效應(反射、振鈴、干擾、地彈及串音等)及其克服方法也是研究高速電路 設計的重點之一。目前高速示波器的功能越來越多，使用上很複雜，必須事先 進修學習，否則無法全盤了解儀器之功能，因而無法有效發揮儀器的量測功能。 其次就是高速訊號量測與介面的一些測試規範也必須熟悉，像眼圖分析，探針 效應，抖動(jitter)測量規範及高速串列介面量測規範等實務技術，必須充分 了解研究學習，進而才可設計出優良之教學教材及教具。
標簽： 高速電路
上傳時間： 2021-11-02
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網絡奇技贏巧大搜捕
標簽： 網絡
上傳時間： 2013-04-15
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專輯類-網絡及電腦相關專輯-114冊-4.31G 網絡奇技贏巧大搜捕.pdf
上傳時間： 2013-07-25
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針對傳統過壓/欠壓、過頻/欠頻、相位突變、主動頻率偏移孤島檢測方法的不足，提出了一種改進方法。將相位偏移量作為輔助量加入主動移頻孤島檢測方法中，使檢測容性負載的孤島現象具有與感性負載同樣的快速性，并能有效降低主動頻率偏移法對電網電能的影響。該方法實現簡單，檢測快速，仿真結果驗證了其快速性和有效性。
標簽： 相位 偏移 孤島檢測 移頻
上傳時間： 2013-11-09
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數字電子技朮
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上傳時間： 2013-10-09
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LABVIEW最實用的技巧合集
標簽： LABVIEW
上傳時間： 2013-11-15
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HTML 技 巧 集
標簽： HTML
上傳時間： 2014-01-24
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C++編程技考高級文檔資料
標簽： 編程 文檔
上傳時間： 2013-12-24
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標簽： 商 電腦 源碼 網站
上傳時間： 2014-01-20
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