我做畢業(yè)設(shè)計(jì)用的單片機(jī)仿真教程，希望對(duì)各位有用
標(biāo)簽： 畢業(yè)設(shè)計(jì) 單片機(jī) 仿真教程
上傳時(shí)間： 2013-08-26
上傳用戶：libinxny
做過板子的人都知道高速電路的難度，這個(gè)多少有些幫助
標(biāo)簽： 高速電路
上傳時(shí)間： 2013-08-28
上傳用戶：lgd57115700
基于FPGA的高速圖像采集和處理卡 能用于視覺檢測系統(tǒng)
標(biāo)簽： FPGA 高速圖像采集 視覺檢測
上傳用戶：Shaikh
數(shù)據(jù)采集 基于DSP和FPGA的高精度數(shù)據(jù)采集卡設(shè)計(jì)
標(biāo)簽： FPGA DSP 高精度 數(shù)據(jù)采集卡
上傳時(shí)間： 2013-08-29
上傳用戶：2728460838
是關(guān)于對(duì)數(shù)據(jù)采集卡的基于PC104總線的讀寫程序，開發(fā)環(huán)境Quarters , 用VHDL語言編寫。
標(biāo)簽： 104 PC 數(shù)據(jù)采集卡 總線
上傳用戶：qw12
用CPLD做了個(gè)FPGA的FPP下載時(shí)序，驗(yàn)證過。
標(biāo)簽： CPLD FPGA FPP
上傳時(shí)間： 2013-08-31
上傳用戶：xy@1314
采用Verilog語言,實(shí)現(xiàn)了FPGA控制視頻芯片的數(shù)據(jù)采集,并將數(shù)據(jù)按幀存儲(chǔ)起來
標(biāo)簽： Verilog FPGA 語言 控制
上傳時(shí)間： 2013-09-01
上傳用戶：喵米米米
關(guān)于用CPLD和FPGA做插補(bǔ)算法的內(nèi)容,對(duì)于想用FPGA做控制的朋友是個(gè)好的借鑒!
標(biāo)簽： FPGA CPLD 插補(bǔ)算法 控制
上傳時(shí)間： 2013-09-02
上傳用戶：taox
結(jié)合XILINXCPLD所做的模擬RS232通信verilog源程序
標(biāo)簽： XILINXCPLD verilog 232 RS
上傳時(shí)間： 2013-09-03
上傳用戶：gps6888
用CADENCE做VHDL語言實(shí)驗(yàn)的教程
標(biāo)簽： CADENCE VHDL 語言實(shí)驗(yàn) 教程
上傳時(shí)間： 2013-09-04
上傳用戶：wangchong
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