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儀器接口

變頻器資料.rar

這是西門子變頻器的資料，介紹運動原理、技術、接口、變頻器和電機的選擇等參數

標簽： 變頻器

上傳時間： 2013-06-05

上傳用戶：siguazgb
三磁道磁卡讀存器的設計.rar

該系統是一款磁卡閱讀存儲器，根據用戶要求解決了普通閱讀器只能實時連接計算機，不能單獨使用的問題。而且針對作為特殊用途的磁卡，要求三道磁道都記錄數據，并且第三磁道記錄格式與標準規定的記錄格式不同時，系統配套的應用程序對其做了正確譯碼、顯示。 @@ 整個系統包括單片機控制的閱讀存儲器硬件部分，和配套使用的計算機界面應用程序軟件部分。其中硬件電路包括磁條譯碼芯片、外部存儲器芯片、串口電平轉換芯片等等，所有的工作過程都是由單片機控制。我們這里選用紫外線擦除的87C52單片機，電路使用的集成電路芯片都是采用SMT封裝器件，極大縮小了讀存器的體積，使用簡單，攜帶方便。 @@ 磁條譯碼芯片采用的是中青科技有限公司出品的M3-230.LQ F/2F解碼器集成電路。該IC實現了磁信號到電信號的轉換。外部存儲器則是使用的8K Bytes的24LC65集成芯片，擴展8片，總容量達到8×8K。 @@ MAXIM公司出品的MAX232實現了單片機TTL電平到RS232接口電平的轉換，從而與計算機串口實現硬件連接。 @@ 計算機界面顯示程序采用當今使用最廣的面向對象編程語言Visual Basic 6.0版本(以后簡稱VB)，并且使用VB帶有的串口通信控件MScomm，通過設置其屬性，使其和下位機單片機協議保持一致，進而進行正確的串口通信。關于磁道上數據記錄的譯碼，則是通過對每條磁道上數據記錄進行多次實驗，認真分析，進而得到了各條磁道各自的編碼規則，按照其規則對其譯碼顯示。這部分程序也是通過VB編程語言實現的。另外，計算機應用程序部分還實現了對下位機讀存器的擦除控制。 @@關鍵詞：磁卡，閱讀存儲器，單片機，串口通信，track3數據譯碼

標簽： 磁道磁卡

上傳時間： 2013-08-05

上傳用戶：黃華強
基于TMS320F2808的高效雙向DCDC變換器.rar

雙向DC/DC變換器（Bi-directionalDC/DCconverters）是能夠根據需要調節能量雙向傳輸的直流/直流變換器。隨著科技的發展，雙向DC/DC變換器的應用需求越來越多，正逐步應用到無軌電車、地鐵、列車、電動車等直流電機驅動系統，直流不間斷電源系統，航天電源等場合。一方面，雙向DC/DC變換器為這些系統提供能量，另一方面，又使可回收能量反向給供電端充電，從而節約能量。大多數雙向DC/DC變換器采用復雜的輔助網絡來實現軟開關技術，本文所研究的Buck/Boost雙向的DC/DC變換器從拓撲上解決器件軟開關的問題；由于Buck/Boost雙向DC/DC變換器的電流紋波較大，這會帶來嚴重的電磁干擾，本文結合Buck/Boost雙向DC/DC變換器拓撲與磁耦合技術使電感電流紋波減??；由于在同一頻率下不同負載時電流紋波不同，本文在控制時根據負載改變PWM頻率，從而使輕載時的電流紋波均較小。本文所研究的雙向DC/DC變換器采用DSP處理器進行控制，其原因在于：目前沒有專門用于控制該Buck/Boost雙向DC/DC變換器的控制芯片，而DSP具有多路的高分辨率PWM，通過對DSP寄存器的配置可以實現Buck/Boost雙向DC/DC變換器的控制PWM；DSP具有多路高速的A/D轉換接口，并可以通過配合PWM完成對反饋采樣，具備一定的濾波功能。本文所研究的數字雙向DC/DC變換器實現了在Buck模式下功率MOSFET的零電壓開通及零電壓關斷，電感電流的交迭使其電感輸出端電流紋波明顯變小，輕載時PWM頻率的提升也使得電流紋波變小。

標簽： F2808 2808 320F DCDC

上傳時間： 2013-06-08

上傳用戶：cy_ewhat
帶諧波抑制功能的分布式發電并網逆變器的研究.rar

隨著“節能環保”概念的提出，以解決電力緊張，環境污染等問題為目的的新能源利用方案得到迅速的推廣，使得分布式發電備受關注，即將成為世界各國重要的發電形式。帶有分布式電源的配電網及電力電子裝置的大量應用致使電能質量下降，如何將分布式發電系統的能量回饋至電網的同時有效改善電能質量是一個重要的問題，因此在分布式發電系統中起電能變換作用的逆變器成為研究的一個熱點。本篇主要以電壓型并網逆變器為研究對象，對并網逆變器的拓撲結構、控制策略、參數的選擇、并網實驗等方面作出了詳細的分析和研究。首先根據帶有分布式發電的配電網的特點提出一種新的諧波治理思路，即將改善電能質量的有源濾波技術結合到分布式逆變電源中，設計一種新型的多功能并網逆變器。用開關函數法建立了并網逆變器小信號數學模型，確定了以PI閉環調節為核心的復合控制策略，同時為了使輸出電流控制達到更好的效果，采用電網電壓前饋補償方法抵消電網電壓擾動對并網電流的影響；基于瞬時無功功率的id-iq諧波電流檢測算法能精確檢測和分離所需要的有功和諧波分量；基于DSP的軟件鎖相控制算法能實現并網電流與電網電壓同頻同相。其次對并網逆變器控制系統的軟硬件進行了分塊設計：對逆變系統的A/D轉換電路、逆變驅動電路、PWM信號發生電路等電路進行了詳細地分析和說明。利用DSP主控芯片TMS320LF2407A內部的SCI異步串行通信接口實現了逆變器的人機交互功能，利用其內嵌的CAN控制模塊實現了逆變器的并機通信功能；同時在TI DSP2000的運行環境下給出控制系統的主程序和周期中斷子程序流程。最后開發了以功率器件IPM構成的三相PWM變流橋主電路的多功能逆變電源實驗平臺和相關配套輔助電路，完成了逆變電源的輸出有功功率及消除諧波的實驗并給出了裝置樣機的實物圖以及實驗波形圖。驗證了逆變器工作原理分析的正確性和系統設計思路的可行性。本文所做工作拓寬了帶有分布式發電的配電網諧波治理的思路，對推動我國節能供電、新能源的利用以及改善電網電能質量等方面具有一定的理論意義和較強的實用價值。

標簽： 諧波抑制分布式發電并網逆變器

上傳時間： 2013-06-06

上傳用戶：amandacool
基于BOOST變換器的高功率因數軟開關電源的研究.rar

隨著電力電子技術的發展，對大功率、高性能的開關電源要求也越來越高。功率因數校正(PFC)技術是當前電力電子技術研究的熱點問題。大多數電力電子裝置通過整流器與電網接口，而傳統的二極管或晶閘管整流裝置會產生大量的諧波電流，對電網造成污染。許多國家和國際組織相繼制定了一系列限制用電設備諧波的標準。有源功率因數校正技術能夠有效的消除整流裝置的諧波，因此具有廣泛的應用前景。本文首先分析了開關電源的發展現狀及發展要求，詳細地闡述了開關電源的基本構成和基本組態。然后研究了ZVT-Boost軟開關PFC電路的基本結構、基本工作原理及軟開關實現原理，在此基礎上確定了主電路結構，并制定了控制系統方案。鑒于功率要求，本文采用兩級PFC電路。因此對常見的DC-DC變換器的拓撲結構、原理特性進行分析。并針對各自的變換器建立了簡化模型，基于所建立的模型分析了變換器的特性，列出各變換器的優缺點及在設計開關電源時的選用原則。最后，對所設計的系統進行了仿真分析。本文根據用戶的要求研究設計了一種大功率高性能開關電源。該開關電源分為前級和后級，前級為采用BOOST結構的單相有源功率因數校正電路，后級為采用移相控制軟開關技術的全橋變換器。最后研制出了實驗樣機，并給出了實驗樣機的功率因數校正電路和移相全橋軟開關變換電路的實驗波形。

標簽： BOOST 變換器高功率因數

上傳時間： 2013-04-24

上傳用戶：朗朗乾坤
單相光伏并網逆變器的研究.rar

逆變器作為光伏陣列和電網接口的主要設備，它的性能決定著整個光伏發電系統的性能。為了將光伏陣列產生的電能最大限度地饋入電網，并提高其運行的穩定度、可靠性和精確度，必須對并網逆變器的主電路拓撲選擇、濾波器參數設計及其控制策略選取等進行深入研究。論文首先分析了光伏發電的國內外發展現狀和應用前景，對光伏并網發電系統的種類、結構和并網標準進行了綜述。針對眾多適用于光伏并網的逆變器拓撲進行了詳細的比較分析，最終確定了一臺單相滿載功率1kW、并網電壓220V的逆變器拓撲及其主電路參數，對其輸出濾波器參數進行設計，并對其進行了幅頻特性分析。其次，詳細分析和研究逆變器的并網控制策略，確定了在獨立工作模式下的瞬時電壓控制策略和在并網工作模式下的瞬時電流控制策略。根據選定的控制策略分別對其控制系統進行了建模和閉環參數設計，并利用Sabet軟件進行系統仿真，驗證了系統建模和設計的正確性。接著，在分析光伏陣列特性的基礎上，總結和比較了常用的幾種MPPT（Maximum Power Point Tracking）控制方法，通過擾動觀測法對并網逆變器輸出電流的控制，實現了光伏陣列的MPPT，并給出了設計方案和實驗驗證。最后，根據以上分析結果，研制了一臺基于DSP控制的光伏并網逆變器的試驗樣機，并詳述了其軟硬件的設計方案，給出了相關實驗結果。

標簽： 單相光伏并網逆變器

上傳時間： 2013-04-24

上傳用戶：天天天天
基于PIC的智能異步電機軟起動器的研究.rar

為了減小異步電機在起動過程中過高電流對電網的沖擊，消除傳統降壓起動對電器和機械設備的不利影響，提高電機的起動特性，本文基于電力電子技術對異步電機的軟起動進行了較為深刻的研究。本文介紹并設計了一種基于PIC18F4550的新型的軟起動器。在功能上，除了具有一般的電壓斜坡軟起動和電流限流軟起動功能，還增加了專門針對泵類負載的轉矩閉環泵控軟起動模式。這種起動方式有效的降低了水泵起動和停止時造成的水錘，并減輕了管路系統的振蕩。同時，針對異步電動機軟起動過程中出現的電流、電磁轉矩以及轉速振蕩問題，分析了引起振蕩的影響因素及其產生原因，采用以電流關斷時刻為晶閘管觸發基準來抑制振蕩問題。文章首先分析研究了異步電機的基本結構和工作原理，確定了軟起動器所采用的基本原理和控制方法。分析得出為改善泵類負載起動性能所采用的轉矩閉環泵控制策略以及為減小振蕩所采用的關斷角控制方法的可行性。其次，本課題對傳統的軟起動器的改進進行了嘗試。采用Microchip公司的PIC18F4550芯片為控制核心。在此基礎上，詳細介紹了交流采樣電路、同步觸發電路以及通迅接口電路等硬件電路。軟件方面采用C語言和匯編語言混合編程實現模塊化程序的設計，在文中較為詳細地介紹了控制系統各部分軟件的設計思想和實現，其中包括主程序流程、各種起動方式的控制程序等。在文章最后給出了基于MATLAB搭建的軟起動系統的仿真模型，仿真結果表明這種帶泵控制功能的軟起動器可以有效的減小電機起動過程中過高電流對電網的沖擊，優化了電機的起動性能。

標簽： PIC 異步電機軟起動器

上傳時間： 2013-06-13

上傳用戶：wang5829
基于ARM920T和Linux的具有轉儲功能的MP4播放器的設計與實現.rar

河北工業大學碩士學位論文論文研究在 ARM920T硬件平臺以及Linux軟件平臺上，通過構建完整的嵌入式Linux系統并移植多媒體播放器MPlayer，完成一款具有轉儲功能的MP4播放器。在這個過程中研究了Linux系統移植、探索了USB驅動程序、學習了文件系統的構建并完成了多媒體播放器 MPlayer 的移植，最終實現了一款基于嵌入式 Linux 軟件平臺具有轉儲功能的 MP4 播放器，使得 MP4 播放器可以通過 USB 接口對可移動硬盤上的信息進行操作。通過該研究過程構建了嵌入式軟件系統，以實現更好的系統性能，最重要的是可以在實踐基礎上增加對系統移植和驅動開發理論的理解并積累豐富的系統移植經驗，以促進我們去理解軟件開發項目及其與目標硬件移植和優化的關系。

標簽： Linux 920T ARM 920

上傳時間： 2013-07-08

上傳用戶：sclyutian
1553B總線接口技術研究及FPGA實現.rar

本論文在詳細研究MIL-STD-1553B數據總線協議以及參考國外芯片設計的基礎上，結合目前新興的EDA技術和大規?？删幊碳夹g，提出了一種全新的基于FPGA的1553B總線接口芯片的設計方法。從專用芯片實現的具體功能出發，結合自頂向下的設計思想，給出了總線接口的總體設計方案，考慮到電路的具體實現對結構進行模塊細化。在介紹模擬收發器模塊的電路設計后，重點介紹了基于FPGA的BC、RT、MT三種類型終端設計，最終通過工作方式選擇信號以及其他控制信號將此三種終端結合起來以達到通用接口的功能。同時給出其設計邏輯框圖、算法流程圖、引腳說明以及部分模塊的仿真結果。為了資源的合理利用，對其中相當部分模塊進行復用。在設計過程中采用自頂向下、碼型轉換中的全數字鎖相環、通用異步收發器UART等關鍵技術。本設計使用VHDL描述，在此基礎之上采用專門的綜合軟件對設計進行了綜合優化，在FPGA芯片EP1K100上得以實現。通過驗證證明該設計能夠完成BC/RT/MT三種模式的工作，能處理多種消息格式的傳輸，并具有較強的檢錯能力。最后設計了總線接口芯片測試系統，選擇TMS320LF2407作為主處理器，測試主要包括主處理器的自發自收驗證，加入RS232串口調試過程提高測試數據的直觀性。驗證的結果表明本文提出的設計方案是合理的。

標簽： 1553B FPGA 總線接口

上傳時間： 2013-06-04

上傳用戶：ayfeixiao
基于FPGA的通用異步收發器的設計.rar

通用異步收發器(Universal Asynchronous Receiver Transmitter，UART)是一種能同時支持短距離和長距離數據傳輸的串行通信接口，被廣泛應用于微機和外設之間的數據交換。像8251、NS8250、NS16550等都是常用的UART芯片，但是這些專用的串行接口芯片的缺點是數據傳輸速率比較慢，難以滿足高速率數據傳輸的場合，而更重要的就是它們都具有不可移植性，因此要利用這些芯片來實現PC機和FPGA芯片之間的通信，勢必會增加接口連線的復雜程度以及降低整個系統的穩定性和有效性。本課題就是針對UART的特點以及FPGA設計具有可移植性的優勢，提出了一種基于FPGA芯片的嵌入式UART設計方法，其中主要包括狀態機的描述形式以及自頂向下的設計方法，利用硬件描述語言來編制UART的各個子功能模塊以及頂層模塊，之后將其集成到FPGA芯片的內部，這樣不僅能解決傳統UART芯片的缺點而且同時也使整個系統變得更加具有緊湊性以及可靠性。本課題所設計的LIART支持標準的RS-232C傳輸協議，主要設計有發送模塊、接收模塊、線路控制與中斷仲裁模塊、Modem控制模塊以及兩個獨立的數據緩沖區FIFO模塊。該模塊具有可變的波特率、數據幀長度以及奇偶校驗方式，還有多種中斷源、中斷優先級、較強的抗干擾數據接收能力以及芯片內部自診斷的能力，模塊內分開的接收和發送數據緩沖寄存器能實現全雙工通信。除此之外最重要的是利用IP模塊復用技術設計數據緩沖區FIFO，采用兩種可選擇的數據緩沖模式。這樣既可以應用于高速的數據傳輸環境，也能適合低速的數據傳輸場合，因此可以達到資源利用的最大化。在具體的設計過程中，利用Synplify Pro綜合工具、ModelSim仿真工具、ISE集成的軟件開發環境中對各個功能模塊進行綜合優化、仿真驗證以及下載實現。各項數據結果表明，本課題中所設計的UART滿足預期設計目標。

標簽： FPGA 異步收發器

上傳時間： 2013-08-02

上傳用戶：rocketrevenge