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光時(shí)(shí)域反射儀

LOBS邊緣節(jié)點(diǎn)突發(fā)包組裝和光板FPGA實(shí)現(xiàn)

近年來(lái)提出的光突發(fā)交換OBS(Optical．Burst Switching)技術(shù)，結(jié)合了光路交換(OCS)與光分組交換(OPS)的優(yōu)點(diǎn)，有效支持高突發(fā)、高速率的多種業(yè)務(wù)，成為目前研究的熱點(diǎn)和前沿。本論文圍繞國(guó)家“863”計(jì)劃資助課題“光突發(fā)交換關(guān)鍵技術(shù)和試驗(yàn)系統(tǒng)”，主要涉及兩個(gè)方面：LOBS邊緣節(jié)點(diǎn)核心板和光板FPGA的實(shí)現(xiàn)方案，重點(diǎn)關(guān)注于邊緣節(jié)點(diǎn)核心板突發(fā)包組裝算法。本文第一章首先介紹LOBS網(wǎng)絡(luò)的背景、架構(gòu)，分析了LOBS網(wǎng)絡(luò)的關(guān)鍵技術(shù)，然后介紹了本論文后續(xù)章節(jié)研究的主要內(nèi)容。第二章介紹了LOBS邊緣節(jié)點(diǎn)的總體結(jié)構(gòu)，主要由核心板和光板組成。核心板包括千兆以太網(wǎng)物理層接入芯片，突發(fā)包組裝FPGA，突發(fā)包調(diào)度FPGA，SDRAM以及背板驅(qū)動(dòng)芯片($2064)等硬件模塊。光板包括$2064，發(fā)射FPGA，接收FPGA，光發(fā)射機(jī)，光接收機(jī)，CDR等硬件模塊。論文對(duì)這些軟硬件資源進(jìn)行了詳細(xì)介紹，重點(diǎn)關(guān)注于各FPGA與其余硬件資源的接口。第三章闡明了LOBS邊緣節(jié)點(diǎn)FPGA的具體實(shí)現(xiàn)方法，分為核心板突發(fā)包組裝FPGA和光板FPGA兩部分。核心板FPGA對(duì)數(shù)據(jù)和描述信息分別存儲(chǔ)，僅對(duì)描述信息進(jìn)行處理，提高了組裝效率。在維護(hù)突發(fā)包信息時(shí)，實(shí)時(shí)查詢和更新FEC配置表，保證了對(duì)FEE狀態(tài)表維護(hù)的靈活性。在讀寫SDRAM時(shí)都采用整頁(yè)突發(fā)讀寫模式，對(duì)MAC幀整幀一次性寫入，讀取時(shí)采用超前預(yù)讀模式，對(duì)SDRAM內(nèi)存的使用采取即時(shí)申請(qǐng)方式，十分靈活高效。光板FPGA分為發(fā)射和接收兩個(gè)方向，主要是將進(jìn)入FPGA的數(shù)據(jù)進(jìn)行同步后按照指定的格式發(fā)送。第四章總結(jié)了論文的主要內(nèi)容，并對(duì)LOBS技術(shù)進(jìn)行展望。本論文組幀算法采用動(dòng)態(tài)組裝參數(shù)表的方法，可以充分支持各種擴(kuò)展，包括自適應(yīng)動(dòng)態(tài)組裝算法。

標(biāo)簽： LOBS FPGA 節(jié)點(diǎn)

上傳時(shí)間： 2013-05-26

上傳用戶：AbuGe
板級(jí)光互連協(xié)議研究與FPGA實(shí)現(xiàn)

隨著集成電路頻率的提高和多核時(shí)代的到來(lái)，傳統(tǒng)的高速電互連技術(shù)面臨著越來(lái)越嚴(yán)重的瓶頸問(wèn)題，而高速下的光互連具有電互連無(wú)法比擬的優(yōu)勢(shì)，成為未來(lái)電互連的理想替代者，也成為科學(xué)研究的熱點(diǎn)問(wèn)題。目前，由OIF(Optical Intemetworking Forum，光網(wǎng)絡(luò)論壇)論壇提出的甚短距離光互連協(xié)議，主要面向主干網(wǎng)，其延遲、功耗、兼容性等都不能滿足板間、芯片間光互連的需要，因此，研究定制一種適用于板級(jí)、芯片級(jí)的光互連協(xié)議具有非常重要的研究意義。本論文將協(xié)議功能分為數(shù)據(jù)鏈路層和物理層來(lái)設(shè)計(jì)，鏈路層功能包括了協(xié)議原語(yǔ)設(shè)計(jì)，數(shù)據(jù)幀格式和數(shù)據(jù)傳輸流程設(shè)計(jì)，流量控制機(jī)制設(shè)計(jì)，協(xié)議通道初始化設(shè)計(jì)，錯(cuò)誤檢測(cè)機(jī)制設(shè)計(jì)和空閑字符產(chǎn)生、時(shí)鐘補(bǔ)償方式設(shè)計(jì)；物理層功能包含了數(shù)據(jù)的串化和解串功能，多通道情況下的綁定功能，數(shù)據(jù)編解碼功能等。然后，文章采用FPGA(Field Programmable Gate Array,現(xiàn)場(chǎng)可編程門陣列)技術(shù)實(shí)現(xiàn)了定制協(xié)議的單通道模式。重點(diǎn)是數(shù)據(jù)鏈路層的實(shí)現(xiàn)，物理層采用定制具備其功能的IP(Intellectual Property,知識(shí)產(chǎn)權(quán))——RocketIO來(lái)實(shí)現(xiàn)。實(shí)現(xiàn)的過(guò)程中，采用了Xilinx公司的ISE(Integrated System Environment,集成開(kāi)發(fā)環(huán)境)開(kāi)發(fā)流程，使用的設(shè)計(jì)工具包括:ISE，ModelSim，Synplify Pro,ChipScope等。最后，本文對(duì)實(shí)現(xiàn)的協(xié)議進(jìn)行了軟件仿真和上扳測(cè)試，訪真和測(cè)試結(jié)果表明，實(shí)現(xiàn)的單通道模式，支持的最高串行頻率達(dá)到3.5GHz，完全滿足了光互連驗(yàn)證系統(tǒng)初期的要求，同時(shí)由RocketIO的高速串行差分口得到的眼圖質(zhì)量良好，表明對(duì)物理層IP的定制是成功的。

標(biāo)簽： FPGA 板級(jí) 光互連協(xié)議研究

上傳時(shí)間： 2013-06-28

上傳用戶：guh000
線性光耦HCNR201在正負(fù)電壓測(cè)量上的應(yīng)用

介紹了線性模擬光耦器件HCNR201的基本原理；闡述了利用該芯片對(duì)電壓量進(jìn)行隔離測(cè)量的測(cè)試原理以及硬件電路；給出了試驗(yàn)數(shù)據(jù)以及數(shù)據(jù)處理結(jié)果；證明了改種測(cè)試方法的準(zhǔn)確性。關(guān)鍵詞:HCNR

標(biāo)簽： HCNR 201 線性光耦正

上傳時(shí)間： 2013-07-28

上傳用戶：pompey
基于DVD應(yīng)用的RS編譯碼器的研究

糾錯(cuò)碼技術(shù)是一種通過(guò)增加一定冗余信息來(lái)提高信息傳輸可靠性的有效方法。RS碼是一種典型的糾錯(cuò)碼，在線性分組碼中，它具有最強(qiáng)的糾錯(cuò)能力，既能糾正隨機(jī)錯(cuò)誤，也能糾正突發(fā)錯(cuò)誤，在深空通信、移動(dòng)通信、磁盤陣列、光存儲(chǔ)及數(shù)字視頻廣播(DVB)等系統(tǒng)中具有廣泛的應(yīng)用。 DVD是一種高容量的存儲(chǔ)媒質(zhì)。DVD技術(shù)的應(yīng)用很廣泛，在數(shù)字技術(shù)中占有重要地位。DVD系統(tǒng)中采用里德-所羅門乘積碼(RS-PC：Reed-Solomon ProductCode)進(jìn)行糾錯(cuò)，RS碼譯碼器在伺服芯片中具有重要作用。 FPGA在開(kāi)發(fā)階段具有安全、方便、可隨時(shí)修改設(shè)計(jì)等不可替代的優(yōu)點(diǎn)，在電子系統(tǒng)中采用FPGA可以極大的提升硬件系統(tǒng)設(shè)計(jì)的靈活性，可靠性，同時(shí)提高硬件開(kāi)發(fā)的速度和降低系統(tǒng)的成本。FPGA的固有優(yōu)點(diǎn)使其得到越來(lái)越廣泛的應(yīng)用，F(xiàn)PGA設(shè)計(jì)技術(shù)也被越來(lái)越多的設(shè)計(jì)人員所掌握。本文首先介紹了編碼理論和常用的RS編譯碼算法，提出RS編碼器實(shí)現(xiàn)方案，詳細(xì)分析了譯碼器的ME算法和改進(jìn)BM算法的實(shí)現(xiàn)，針對(duì)ME算法提出了一種流水線結(jié)構(gòu)的糾刪糾錯(cuò)RS譯碼器實(shí)現(xiàn)方案，在譯碼器復(fù)雜度和延時(shí)上作了折衷，降低了譯碼器的復(fù)雜度并提高了最高工作頻率，利用有限域乘法器的特性對(duì)編譯碼電路進(jìn)行優(yōu)化。這些技術(shù)的采用大大的提高了RS編譯碼器的效率，節(jié)省了RS編譯碼器占用的資源。在Xilinx公司的Virtex-II系列FPGA上設(shè)計(jì)并成功實(shí)現(xiàn)了RS(208，192)編譯碼器。

標(biāo)簽： DVD RS編譯碼

上傳時(shí)間： 2013-07-20

上傳用戶：xinshou123456
LED的調(diào)光原理分析與設(shè)計(jì)實(shí)例

對(duì)于 LED 光源來(lái)說(shuō)，調(diào)光也是比其他熒光燈、節(jié)能燈、高壓鈉燈等更容易實(shí)現(xiàn)，所以更應(yīng)該在各種類型的 LED燈具中加上調(diào)光的功能

標(biāo)簽： LED 調(diào)光分設(shè)計(jì)實(shí)例

上傳時(shí)間： 2013-05-17

上傳用戶：qweqweqwe
真實(shí)感圖形繪制中明暗效果的FPGA實(shí)現(xiàn)

計(jì)算機(jī)圖形學(xué)中真實(shí)感成像包括兩部分內(nèi)容：物體的精確圖形表示；場(chǎng)景中光照效果的適當(dāng)?shù)拿枋觥９庹招Чü獾姆瓷洹⑼该餍浴⒈砻婕y理和陰影。對(duì)物體進(jìn)行投影，然后再可見(jiàn)面上產(chǎn)生自然光照效果，可以實(shí)現(xiàn)場(chǎng)景的真實(shí)感顯示。光照明模型主要用于物體表面某點(diǎn)處的光強(qiáng)度計(jì)算。面繪制算法是通過(guò)光照模型中的光強(qiáng)度計(jì)算，以確定場(chǎng)景中物體表面的所有投影像素點(diǎn)的光強(qiáng)度。Phong明暗處理算法是生成真實(shí)感3D圖像最佳算法之一。但是由于其大量的像素級(jí)運(yùn)算和硬件難度而在實(shí)現(xiàn)實(shí)時(shí)真實(shí)感圖形繪制中被Gotuaud明暗處理算法所取代。VLSI技術(shù)的發(fā)展以及對(duì)于高真實(shí)感實(shí)時(shí)圖形的需求使得Phong明暗處理算法的實(shí)現(xiàn)成為可能。利用泰勒級(jí)數(shù)近似的Fast Phong明暗處理算法適合硬件實(shí)現(xiàn)。此算法需要存儲(chǔ)大量數(shù)據(jù)的ROM。這增加了實(shí)現(xiàn)的難度。本文完成了以下工作： 1、本文簡(jiǎn)述了實(shí)時(shí)真實(shí)感圖形繪制管線，詳細(xì)敘述了所用到的光照明模型和明暗處理方法，并對(duì)幾種明暗處理方法的效果作了比較，實(shí)驗(yàn)結(jié)果表明Fast Phong明暗處理算法適用于實(shí)時(shí)真實(shí)感圖形繪制。 2、在熟悉Xilinx公司FPGA芯片結(jié)構(gòu)及其開(kāi)發(fā)流程的基礎(chǔ)上，結(jié)合Xilinx公司提供的FPGA開(kāi)發(fā)工具ISE 7.1i，仿真工具為ISE simulator，綜合工具為XST；完成了Fast Phong明暗處理模塊的FPGA設(shè)計(jì)與實(shí)現(xiàn)。綜合得到的電路的最高頻率為54.058MHz。本文的Fast Phong明暗處理硬件模塊適用于實(shí)時(shí)真實(shí)感圖形繪制。 3、本文通過(guò)誤差分析，提出了優(yōu)化的查找表結(jié)構(gòu)。通過(guò)在FPGA上對(duì)本文所提結(jié)構(gòu)進(jìn)行驗(yàn)證。結(jié)果表明，本方案在提高速度、精度的同時(shí)將ROM的數(shù)據(jù)量從64K*8bit減少至13K*8bit。

標(biāo)簽： FPGA 圖形繪制

上傳時(shí)間： 2013-06-21

上傳用戶：ghostparker
[質(zhì)量管理與可靠性工程].光昕&李沁.文字版

·[質(zhì)量管理與可靠性工程].光昕&李沁.文字版

標(biāo)簽： 質(zhì)量管理可靠性工程

上傳時(shí)間： 2013-04-24

上傳用戶：kirivir
RS485光藕隔離電路

4路485光藕隔離電路。收發(fā)自動(dòng)轉(zhuǎn)換。好用。

標(biāo)簽： 485 RS 光藕隔離電路

上傳時(shí)間： 2013-05-30

上傳用戶：懶龍1988
數(shù)碼攝影構(gòu)圖與用光

攝影技術(shù) 構(gòu)圖用光攝影基礎(chǔ) 簡(jiǎn)單的攝影技巧

標(biāo)簽： 數(shù)碼攝影

上傳時(shí)間： 2013-04-24

上傳用戶：zhenyushaw
LED光立方電路圖與程序

資料里是一套詳細(xì)的led光立方制作教程，含原理圖，含代碼，含bom，是學(xué)習(xí)制作的好幫手。

標(biāo)簽： LED 光立方電路圖程序

上傳時(shí)間： 2013-05-25

上傳用戶：fuzhoulinzexu

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