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克鄰大盜專殺工具

  • 基于FPGA的視頻圖像檢測技術(shù)

    在圖像處理及檢測系統(tǒng)中,實(shí)時性要求往往影響著系統(tǒng)處理速度的性能。本文在分析研究視頻檢測技術(shù)及方法的基礎(chǔ)上,應(yīng)用嵌入式系統(tǒng)設(shè)計(jì)和圖像處理技術(shù),以交通信息視頻檢測系統(tǒng)為研究背景,展開了基于FPGA視頻圖像檢測技術(shù)的研究與應(yīng)用,通過系統(tǒng)仿真驗(yàn)證了基于FPGA架構(gòu)的圖像并行處理和檢測系統(tǒng)具有較高的實(shí)時處理能力,能夠準(zhǔn)確并穩(wěn)定地檢測出運(yùn)動目標(biāo)的信息。可見FPGA對提高視頻檢測及處理的實(shí)時性是一個較好的選擇。 本文主要研究的內(nèi)容有: 1.分析研究了視頻圖像檢測技術(shù),針對傳統(tǒng)基于PC構(gòu)架和DSP處理器的視頻檢測系統(tǒng)的弊端,并從可靠性、穩(wěn)定性、實(shí)時性和開發(fā)成本等因素考慮,提出了以FPGA芯片作為中央處理器的嵌入式并行數(shù)據(jù)處理系統(tǒng)的設(shè)計(jì)方案。 2.應(yīng)用模塊化的硬件設(shè)計(jì)方法,構(gòu)建了新一代嵌入式視頻檢測系統(tǒng)的硬件平臺。該系統(tǒng)由異步FIFO模塊、圖像空間轉(zhuǎn)換模塊、SRAM幀存控制模塊、圖像預(yù)處理模塊和圖像檢測模塊等組成,較好地解決了圖像采樣存儲、處理和傳輸?shù)膯栴},并為以后系統(tǒng)功能的擴(kuò)展奠定了良好的基礎(chǔ)。 3.在深入研究了線性與非線性濾波幾種圖像處理算法,分析比較了各自的優(yōu)缺點(diǎn)的基礎(chǔ)上,本文提出一種適合于FPGA的快速圖像中值濾波算法,并給出該算法的硬件實(shí)現(xiàn)結(jié)構(gòu)圖,應(yīng)用VHDL硬件描述語言編程、實(shí)現(xiàn),仿真結(jié)果表明,快速中值濾波算法的處理速度較傳統(tǒng)算法提高了50%,更有效地降低了系統(tǒng)資源占用率和提高了系統(tǒng)運(yùn)算速度,增強(qiáng)了檢測系統(tǒng)的實(shí)時性能。 4.研究了基于視頻的交通車流量檢測算法,重點(diǎn)討論背景差分法,圖像二值化以及利用直方圖分析方法確定二值化的閾值,并對圖像進(jìn)行了直方圖均衡處理,提高圖像檢測精度。并結(jié)合嵌入式系統(tǒng)處理技術(shù),在FPGA系統(tǒng)上研究設(shè)計(jì)了這些算法的硬件實(shí)現(xiàn)結(jié)構(gòu),用VHDL語言實(shí)現(xiàn),并對各個模塊及相應(yīng)算法做出了功能仿真和性能分析。 5.系統(tǒng)仿真與驗(yàn)證是整個FPGA設(shè)計(jì)流程中最重要的步驟,針對現(xiàn)有仿真工具用手動設(shè)置輸入波形工作量大等弊病,本文提出了一種VHDL測試基準(zhǔn)(TestBench)方法解決系統(tǒng)輸入源仿真問題,用TEXTIO程序包設(shè)計(jì)了MATLAB與FPGA仿真軟件的接口,很好地解決了仿真測試中因測試向量龐大而難以手動輸入的問題。并將系統(tǒng)的仿真結(jié)果數(shù)據(jù)在MATLAB上還原為圖像,方便了系統(tǒng)測試結(jié)果的分析與調(diào)試。系統(tǒng)測試的結(jié)果表明,運(yùn)動目標(biāo)的檢測基本符合要求,可以排除行走路人等移動物體(除車輛外)的噪聲干擾,有效地檢測出正確的目標(biāo)。 本文主要研究了基于FPGA片上系統(tǒng)的圖像處理及檢測技術(shù),針對FPGA技術(shù)的特點(diǎn)對某些算法提出了改進(jìn),并在MATLAB、QuartusⅡ和ModelSim軟件開發(fā)平臺上仿真實(shí)現(xiàn),仿真結(jié)果達(dá)到預(yù)期目標(biāo)。本文的研究對智能化交通監(jiān)控系統(tǒng)的車流量檢測做了有益探索,對其他場合的圖像高速處理及檢測也具有一定的參考價值。

    標(biāo)簽: FPGA 視頻圖像 檢測技術(shù)

    上傳時間: 2013-07-13

    上傳用戶:woshiayin

  • 基于FPGA的圖像壓縮卡設(shè)計(jì)

    目前的國內(nèi)的CCD高清攝相頭能夠輸出一組視頻信號和數(shù)字圖像信號,雖然視頻信號能夠直接在監(jiān)視器顯示,但是輸出的數(shù)字圖像信號占用存儲空間太大,不便于進(jìn)行傳輸。本文設(shè)計(jì)了一種基于FPGA的數(shù)字圖像壓縮卡。 在過去的十幾年中,國際標(biāo)準(zhǔn)化組織制訂了一系列的國際視頻編碼標(biāo)準(zhǔn)并廣泛應(yīng)用到各種領(lǐng)域。It.264/AVC是ITU-T和ISO聯(lián)合推出的新標(biāo)準(zhǔn),采用了近幾年視頻編碼方面的先進(jìn)技術(shù),以較高編碼效率和網(wǎng)絡(luò)友好性成為新一代國際視頻編碼標(biāo)準(zhǔn)。 新發(fā)展的H.264/AVC比原有的視頻編碼標(biāo)準(zhǔn)大幅度提高了編碼效率,但其運(yùn)算復(fù)雜度也大大增加,本文簡要分析了H.264/AVC的復(fù)雜度及其優(yōu)化的途徑,給出了主要模塊的優(yōu)化算法實(shí)驗(yàn)結(jié)果。 H.264/AVC仍基于以前視頻編碼標(biāo)準(zhǔn)的運(yùn)動補(bǔ)償混合編碼方案,主要不同有:增強(qiáng)的運(yùn)動預(yù)測能力,準(zhǔn)確匹配的較小塊變換,自適應(yīng)環(huán)內(nèi)濾波器,增強(qiáng)的熵編碼。測試結(jié)果表明這些新特征使H.264/AVC編碼器提高50%編碼效率的同時,增加了一個數(shù)量級的復(fù)雜度。實(shí)際中恰當(dāng)?shù)厥褂肏.264/AVC編碼工具可以較低的實(shí)現(xiàn)復(fù)雜度得到與復(fù)雜配置相當(dāng)?shù)木幋a效率。故實(shí)際編碼系統(tǒng)開發(fā)需要在運(yùn)算復(fù)雜性和編碼效率之間進(jìn)行折衷、兼顧考慮。H.264/AVC引入的新編碼特征既增加基本模塊的復(fù)雜度,也成倍增加算法的復(fù)雜度。針對它們的作用和實(shí)現(xiàn)方法的不同,可采用不同的硬件實(shí)現(xiàn)方法。本文基于上述思路進(jìn)行優(yōu)化,具體的工作包括:針對去塊濾波的復(fù)雜性,本文提出一種適合硬件實(shí)現(xiàn)的算法,使其在節(jié)省了資源的同時,很好的達(dá)到了標(biāo)準(zhǔn)所定義的性能。針對變換量化的復(fù)雜性,本文提出一種既滿足整體的硬件流水結(jié)構(gòu),又極大的降低了硬件資源的實(shí)現(xiàn)方法。針對碼率控制的實(shí)現(xiàn),本文提出了一種有別于傳統(tǒng)實(shí)現(xiàn)方式的算法,在保證實(shí)時性的同時,極大的提高了編碼器的性能。本文基于上述算法還進(jìn)行Baseline Profile編碼器的研究,給出了一種實(shí)時編碼器結(jié)構(gòu),實(shí)現(xiàn)了對高清圖像格式(720P)的實(shí)時編碼,并將其和當(dāng)前業(yè)界先進(jìn)水平進(jìn)行了對比,表明本文所實(shí)現(xiàn)得結(jié)構(gòu)能夠達(dá)到當(dāng)前業(yè)界的先進(jìn)水平。

    標(biāo)簽: FPGA 圖像 壓縮卡

    上傳時間: 2013-07-23

    上傳用戶:yepeng139

  • FPGA設(shè)計(jì)指南——器件、工具和流程

    本書涉及大量豐富的、工程師所喜好的技術(shù)細(xì)節(jié)如多種不同的設(shè)計(jì)流程、工具和概念。此外本書還涵蓋了一系列技術(shù)層次相對低的主題,如基本概念等。

    標(biāo)簽: FPGA 設(shè)計(jì)指南 器件 流程

    上傳時間: 2013-07-20

    上傳用戶:D&L37

  • 基于FPGA和PCI接口圖像采集壓縮卡

    隨著數(shù)字圖像處理的應(yīng)用領(lǐng)域不斷擴(kuò)大,實(shí)時處理技術(shù)成為研究的熱點(diǎn)。VLSI技術(shù)的迅猛發(fā)展為數(shù)字圖像實(shí)時處理技術(shù)提供了硬件基礎(chǔ)。其中FPGA(現(xiàn)場可編程門陣列)的特點(diǎn)使其在圖像采集和處理方面的應(yīng)用顯得更加經(jīng)濟(jì)、靈活、方便。 本文設(shè)計(jì)了一種以FPGA為工作核心,并實(shí)現(xiàn)了PCI接口的圖像采集壓縮系統(tǒng)。整個系統(tǒng)采用了自頂向下的設(shè)計(jì)方案,先把系統(tǒng)分成了三大塊,即圖像采集、PCI接口和圖像壓縮,然后分別設(shè)計(jì)各個大模塊中的子模塊。 首先,利用FPGA對專用視頻轉(zhuǎn)換器SAA7111A進(jìn)行控制,因?yàn)镾AA7111A是采用IC總線模塊,從而完成了對SAA7111A的控制,并通過設(shè)計(jì)圖像采集模塊、讀/寫數(shù)據(jù)模塊、總線管理模塊等,實(shí)現(xiàn)把標(biāo)準(zhǔn)的模擬視頻信號轉(zhuǎn)換成數(shù)字視頻信號并采集的功能。 其次,在了解PCI規(guī)范的前提下,深入地分析了PCI時序和地址配置空間等,設(shè)計(jì)了簡化邏輯的狀態(tài)機(jī),并用VHDL硬件描述語言設(shè)計(jì)了程序,完成了簡化邏輯的PCI接口設(shè)計(jì)在FPGA芯片內(nèi)部的實(shí)現(xiàn),達(dá)到了一33MHz、32位數(shù)據(jù)寬度、支持猝發(fā)傳輸?shù)腜CI從設(shè)備模塊的接口功能,與傳統(tǒng)的使用PCI專用接口芯片來實(shí)現(xiàn)的PCI接口比較來看,更加節(jié)約了系統(tǒng)的邏輯資源,降低了成本,增加了設(shè)計(jì)的靈活性。 再次,設(shè)計(jì)了WINDOWS下對PCI接口的驅(qū)動程序。驅(qū)動程序可以選擇不同的方法來完成,當(dāng)然每個方法都有自己的特點(diǎn),對幾種主要設(shè)計(jì)驅(qū)動程序的方法作以比較之后,本文選擇了使用DRIVER WORKS工具來完成。通過對配置空間的設(shè)計(jì)、系統(tǒng)端口和內(nèi)存映射的設(shè)計(jì)、中斷服務(wù)的設(shè)計(jì)等,用VC++語言編寫了驅(qū)動程序。 最后,考慮到增加系統(tǒng)的實(shí)用性和完備性,還填加設(shè)計(jì)了圖像的壓縮部分。這部分需要完成的工作是在上述系統(tǒng)完成后,再額外地把采集來的視頻數(shù)據(jù)通過另一路數(shù)據(jù)通道按照一定的格式壓縮后存儲到硬盤中。本系統(tǒng)中,這部分設(shè)計(jì)是利用Altera公司提供的IP核來完成壓縮的,同時還用VHDL語言在FPGA上設(shè)計(jì)了IDE硬盤接口,使壓縮后的數(shù)據(jù)存儲到硬盤中。

    標(biāo)簽: FPGA PCI 接口 圖像采集

    上傳時間: 2013-06-01

    上傳用戶:程嬰sky

  • 基于FPGA實(shí)現(xiàn)非均勻劃分信道

    軟件無線電已成為無線通信非常關(guān)鍵的技術(shù)之一。其基本思想是將寬帶A/D、D/A盡可能靠近天線,在一個開放式、模塊化的通用硬件平臺上用盡可能多的軟件來實(shí)現(xiàn)無線電臺的各種功能。 本文所討論的多相濾波器組信道化接收機(jī)(PPCR)及信道非均勻劃分,即是應(yīng)用了軟件無線電理念的一種新技術(shù)。該技術(shù)針對傳統(tǒng)無線電接收機(jī)存在的結(jié)構(gòu)不靈活、系統(tǒng)升級困難、同時處理多信號能力弱及系統(tǒng)規(guī)模過大等問題,應(yīng)用現(xiàn)代多速率信號處理理論對之進(jìn)行了改進(jìn)。改進(jìn)后的軟件無線電PPCR.具有全概率接收能力,能對信號進(jìn)行下變頻并降低其采樣率處理,實(shí)現(xiàn)后資源耗費(fèi)較低,而且依托現(xiàn)場可編程門陣列(FPGA)建立的平臺是開放式的,在需要時可在不改變硬件系統(tǒng)的情況下通過軟件更改系統(tǒng)的功能,極大地提高了系統(tǒng)的靈活性。諸多的優(yōu)點(diǎn)使其具有十分廣泛的應(yīng)用前景,也成為當(dāng)前研究熱點(diǎn)之一。 本文首先介紹了課題的應(yīng)用背景,并深入討論了軟件無線電的基本理論:信號采樣理論及多速率信號處理理論,介紹了應(yīng)用PPCR的采樣處理過程,給出了推導(dǎo)PPCR的數(shù)學(xué)模型,并在此基礎(chǔ)上分析闡述了信道非均勻劃分的原理。 在本文的系統(tǒng)仿真及實(shí)現(xiàn)部分,首先介紹了應(yīng)用現(xiàn)代DSP開發(fā)工具DSPBuilder進(jìn)行開發(fā)的設(shè)計(jì)流程,然后對應(yīng)用DSP Builder來設(shè)計(jì)PPCR中的主要模塊一多相濾波器組及快速傅立葉變換模塊做了詳細(xì)闡述,最后對系統(tǒng)仿真及實(shí)現(xiàn)過程的實(shí)驗(yàn)結(jié)果圖進(jìn)行了分析。 本文主要是在實(shí)驗(yàn)室階段對算法在硬件實(shí)現(xiàn)上進(jìn)行研究。成果可以作為后續(xù)應(yīng)用研究的基礎(chǔ),對各種應(yīng)用軟件無線電理念的通信系統(tǒng)都具有一定的參考價值。

    標(biāo)簽: FPGA 信道

    上傳時間: 2013-06-17

    上傳用戶:xfbs821

  • 無線通信系統(tǒng)的FPGA設(shè)計(jì)和研究

    在數(shù)字化、信息化的時代,數(shù)字集成電路應(yīng)用得非常廣泛。隨著微電子技術(shù)和工藝的發(fā)展,數(shù)字集成電路從電子管、晶體管、中小規(guī)模集成電路、超大規(guī)模集成電路(VLSIC)逐步發(fā)展到今天的專用集成電路(ASIC)。但是ASIC因其設(shè)計(jì)周期長,改版投資大,靈活性差等缺陷制約著它的應(yīng)用范圍。可編程邏輯器件的出現(xiàn)彌補(bǔ)了ASIC的缺陷,使得設(shè)計(jì)的系統(tǒng)變得更加靈活,設(shè)計(jì)的電路體積更加小型化,重量更加輕型化,設(shè)計(jì)的成本更低,系統(tǒng)的功耗也更小了。FPGA是英文Field Programmable Gate Array的縮寫,即現(xiàn)場可編程門陣列,它是在PAL、GAL、EPID等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。 本論文撰寫的是用FPGA來實(shí)現(xiàn)無人小飛機(jī)系統(tǒng)中基帶信號的處理過程。整個信號處理過程全部采用VHDL硬件描述語言來設(shè)計(jì),并用Modelsim仿真系統(tǒng)功能進(jìn)行調(diào)試,最后使用了Xilinx 公司可編程的FPGA芯片XC2S100完成,滿足系統(tǒng)設(shè)計(jì)的要求。 本文首先研究和討論了無線通信系統(tǒng)中基帶信號處理的總體結(jié)構(gòu),接著詳細(xì)闡述了各個模塊的設(shè)計(jì)原理和方法,以及FPGA結(jié)果分析,最后就關(guān)鍵技術(shù)和難點(diǎn)作了詳細(xì)的分析和研究。本文的最大特色是整個系統(tǒng)全部采用FPGA的方法來設(shè)計(jì)實(shí)現(xiàn),修改靈活,體積小,功耗小。本系統(tǒng)的設(shè)計(jì)包括了數(shù)字鎖相環(huán)、糾錯編解碼、碼組交織、擾碼加入、巴克碼插入、幀同步識別、DPSK調(diào)制解調(diào)及選擇了整體的時序,所有的組成部分都經(jīng)過了反復(fù)地修改和調(diào)試,取得了良好的數(shù)據(jù)處理效果,其關(guān)鍵之處與難點(diǎn)都得到了妥善地解決。本文分別在發(fā)射部分(編碼加調(diào)制)和接收部分(解調(diào)加解碼)相獨(dú)立和相聯(lián)系的情況下,獲得了仿真與實(shí)測結(jié)果。

    標(biāo)簽: FPGA 無線通信系統(tǒng)

    上傳時間: 2013-07-05

    上傳用戶:acon

  • 線性調(diào)頻信號的脈沖壓縮系統(tǒng)

    本文完成了一種高速高性能數(shù)字脈沖壓縮處理器的設(shè)計(jì)和FPGA實(shí)現(xiàn),包括系統(tǒng)架構(gòu)設(shè)計(jì)、方案論證及仿真、算法實(shí)現(xiàn)、結(jié)果的測試等。 緒論部分首先闡明了本課題研究的背景和意義,概述了雷達(dá)數(shù)字脈沖壓縮系統(tǒng)的主要研究內(nèi)容,關(guān)鍵技術(shù)及其發(fā)展趨勢,然后介紹了數(shù)字脈沖壓縮系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)的要求,最后給出了本文的主要研究內(nèi)容。 第二章敘述了線性調(diào)頻信號脈沖壓縮的基本原理,對系統(tǒng)設(shè)計(jì)的實(shí)現(xiàn)方法進(jìn)行了實(shí)時性方面的論證,并基于MATLAB做了仿真分析。 第三章從數(shù)字系統(tǒng)結(jié)構(gòu)化設(shè)計(jì)方面將本系統(tǒng)劃分為三個部分:輸入部分、脈壓計(jì)算部分、輸出部分,并在流程圖中對各部分所要實(shí)現(xiàn)的功能做了介紹。 第四章首先總結(jié)了數(shù)字脈沖壓縮的實(shí)現(xiàn)途徑;提出了基于自定制浮點(diǎn)數(shù)據(jù)格式和分時復(fù)用蝶型結(jié)構(gòu)的數(shù)字脈沖壓縮系統(tǒng)設(shè)計(jì)思想,對其關(guān)鍵技術(shù)進(jìn)行了深入的研究。 第五章對輸入輸出模塊的功能做了詳細(xì)的描述,設(shè)計(jì)了具體的結(jié)構(gòu)和電路。 第六章針對系統(tǒng)的測試驗(yàn)證,提出面向SOC的模塊驗(yàn)證和系統(tǒng)軟硬協(xié)同驗(yàn)證的驗(yàn)證策略。通過Link for Modelsim工具,實(shí)現(xiàn)MATAB與Modelsim之間對VHDL代碼的聯(lián)合仿真測試,通過在線邏輯分析工具ChipScope,完成系統(tǒng)的片上測試,并分析系統(tǒng)的性能,證明系統(tǒng)的可實(shí)用性。滿足設(shè)計(jì)的要求。 本文研制的數(shù)字脈沖壓縮處理器具有動態(tài)范圍大、處理精度高、處理能力強(qiáng)、體積小、重量輕、實(shí)時性好的優(yōu)點(diǎn),為設(shè)計(jì)高性能的現(xiàn)代雷達(dá)信號處理系統(tǒng)提供了可靠的保證。

    標(biāo)簽: 線性調(diào)頻信號 脈沖壓縮

    上傳時間: 2013-07-01

    上傳用戶:lingduhanya

  • 用FPGA實(shí)現(xiàn)8051內(nèi)核及外設(shè)I2C接口

    8051處理器自誕生起近30年來,一直都是嵌入式應(yīng)用的主流處理器,不同規(guī)模的805l處理器涵蓋了從低成本到高性能、從低密度到高密度的產(chǎn)品。該處理器極具靈活性,可讓開發(fā)者自行定義部分指令,量身訂制所需的功能模塊和外設(shè)接口,而且有標(biāo)準(zhǔn)版和經(jīng)濟(jì)版等多種版本可供選擇,可讓設(shè)計(jì)人員各取所需,實(shí)現(xiàn)更高性價比的結(jié)構(gòu)。如此多的優(yōu)越性使得8051處理器牢固地占據(jù)著龐大的應(yīng)用市場,因此研究和發(fā)展8051及與其兼容的接口具有極大的應(yīng)用前景。在眾多8051的外設(shè)接口中,I2C總線接口扮演著重要的角色。通用的12C接口器件,如帶12C總線的RAM,ROM,AD/DA,LCD驅(qū)動器等,越來越多地應(yīng)用于計(jì)算機(jī)及自動控制系統(tǒng)中。因此,本論文的根本目的就是針對如何在8051內(nèi)核上擴(kuò)展I2C外設(shè)接口進(jìn)行較深入的研究。 本課題項(xiàng)目采用可編程技術(shù)來開發(fā)805l核以及12C接口。由于8051內(nèi)核指令集相容,我們能借助在現(xiàn)有架構(gòu)方面的經(jīng)驗(yàn),發(fā)揮現(xiàn)有的大量代碼和工具的優(yōu)勢,較快地完成設(shè)計(jì)。在8051核模塊里,我們主要實(shí)現(xiàn)中央處理器、程序存儲器、數(shù)據(jù)存儲器、定時/計(jì)數(shù)器、并行接口、串行接口和中斷系統(tǒng)等七大單元及數(shù)據(jù)總線、地址總線和控制總線等三大總線,這些都是標(biāo)準(zhǔn)8051核所具有的模塊。在其之上我們再嵌入12C的串行通信模塊,采用自下而上的方法,逐次實(shí)現(xiàn)一位的收發(fā)、一個字節(jié)的收發(fā)、一個命令的收發(fā),直至實(shí)現(xiàn)I2C的整個通信協(xié)議。 8051核及I2C總線的研究通過可編程邏輯器件和一塊外圍I2C從設(shè)備TMPl01來驗(yàn)證。本課題的最終目的是可編程邏輯器件實(shí)現(xiàn)的8051核成功并高效地控制擴(kuò)展的12C接口與從設(shè)備TMPl01通信。 用EP2C35F672C6芯片開發(fā)的12C接口,數(shù)據(jù)的傳輸速率由該芯片嵌入8051微處理的時鐘頻率決定。經(jīng)測試其傳輸速率可達(dá)普通速率和快速速率。 目前集成了該12C接口的8051核已經(jīng)在工作中投入使用,主要用于POS設(shè)備的用戶數(shù)據(jù)加密及對設(shè)備溫度的實(shí)時控制。雖然該設(shè)備尚未大批量投產(chǎn),但它已成功通過PCI(PaymentCardIndustry)協(xié)會認(rèn)證。

    標(biāo)簽: FPGA 8051 I2C 內(nèi)核

    上傳時間: 2013-06-18

    上傳用戶:731140412

  • PCB特性阻抗計(jì)算工具

    PCB特性阻抗計(jì)算工具:用于射頻電路,高速數(shù)字電路中傳輸線阻抗的計(jì)算

    標(biāo)簽: PCB 特性阻抗 計(jì)算工具

    上傳時間: 2013-07-02

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  • 中興通訊康訊EDA工具手冊

    Cadence 軟件是我們公司統(tǒng)一使用的原理圖設(shè)計(jì)、PCB 設(shè)計(jì)、高速仿真、自動布線的EDA 工具。本篇 Cadence 使用手冊是一本基于Allegro SPB V15.2 版本的Cadence 軟件的基礎(chǔ)使用手冊,包括原理圖設(shè)計(jì)、 PCB 設(shè)計(jì)、高速仿真、約束管理器、自動布線五個方面的內(nèi)容,是一個入門級的教材。通過這本手冊旨在 讓新進(jìn)員工能掌握Cadence 的基本使用方法,能獨(dú)立進(jìn)行原理圖及PCB 的設(shè)計(jì),了解自動布線、約束管理 器的使用,熟悉高速仿真的過程,并對公司的EDA 流程有全面的了解。

    標(biāo)簽: EDA 中興通訊

    上傳時間: 2013-04-24

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