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全橋變換器

  • 基于FPGA的PWM控制多重逆變器的設計與實現

    逆變器在自動控制系統、電機交流調速、電力變換以及電力系統控制中都起著重要的作用;各系統對逆變器的性能需求也越來越高。PWM控制多重逆變器正是基于這些需求,實現可變頻、調壓、調相、低諧波、高穩定性的解決方案。 PWM控制逆變器通過對每個脈沖寬度進行控制,以達到控制輸出電壓和改善輸出波形的目的;多重逆變器則是把幾個矩形波逆變器的輸出組合起來起來形成階梯波,從而消除諧波;PWM控制多重逆變器綜合上述兩種技術的特點,非常適合于應用在對諧波、電壓輸出及穩定性要求比較高的場合。電力半導體技術和集成電路技術的快速發展,使得多重逆變器的控制、實現成為可能。 本文首先分析風力發電系統對逆變器的要求,從多重逆變器理論和PWM逆變器理論出發,提出同步式PWM控制電壓型串聯多重逆變器系統解決方案。本方案也可以應用在逆變電源、交流電機調速及電力變換領域中。 文中建立了一個多重逆變器的PWM控制算法模型。該算法可完成頻率、相位、幅值可調的多重逆變器的PWM控制,且能完成逆變器故障運行下的保護與告警。并在MATLAB/SIMULINK環境下對算法模型進行仿真與分析。 在比較了現有PWM發生解決方案的基礎上,本文提出了一個基于FPGA(可編程邏輯陣列)的多重逆變器PWM控制系統實現方案。并給出一個主要由FPGA、ADC/DAC、驅動與保護電路、逆變器主回路及其他外圍電路構成的多重逆變器系統解決方案。實驗結果表明,此方案系統結構簡單、可行,很好完成上述多重逆變器的PWM控制算法。

    標簽: FPGA PWM 控制 多重

    上傳時間: 2013-06-28

    上傳用戶:wmwai1314

  • 3KW光伏并網逆變器的軟件畢業設計設計論文

    不錯的畢業論文 很詳細的介紹了光伏逆變器設計方法

    標簽: 3KW 光伏并網 逆變器 軟件

    上傳時間: 2013-04-24

    上傳用戶:nanshan

  • 基于FPGA的視頻編碼器設計

    ISO和ITU-T制定的一系列視頻編碼國際標準的推出,開創了視頻通信和存儲應用的新紀元。從H.261視頻編碼建議,到H.262/3、MPEG-1/2/4等都有一個共同的不斷追求的目標,即在盡可能低的碼率(或存儲容量)下獲得盡可能好的圖像質量。 本課題的研究建立在目前主流的壓縮算法的基礎上,綜合出各種標準中實現途徑的共性和優勢,將算法的主體移植于FPGA(FieldProgrammableGateArray)平臺上。憑借該種類嵌入式系統配置靈活、資源豐富的特點,建立一個可重構的內核處理模塊。進一步的完善算法(運算速度、精度)和外圍系統后,就可作為專用視頻壓縮編碼器進行門級電路設計的原型,構建一個片上可編程的獨立系統。 編碼器設計有良好的應用前景,通過使用離散余弦變換和熵編碼,對運動圖像從空間上進行壓縮編碼,使得編碼后的數據流適合于傳輸、通信、存儲和編輯等方面的要求。同時,系統的設計將解碼的工作量大幅度降低,功能模塊在作適當的改動后可為解碼器的參考設計使用。 研究所涉及的各功能模塊都進行了系統性的仿真和綜合,滿足工程樣機的前期研發需要。

    標簽: FPGA 視頻編碼器

    上傳時間: 2013-04-24

    上傳用戶:xiangwuy

  • 基于FPGA的數字化通用PWM控制器設計

    如今電力電子電路的控制旨在實現高頻開關的計算機控制,并向著更高頻率、更低損耗和全數字化的方向發展。現場可編程門陣列器件(FieldProgrammableGateArrays)是近年來嶄露頭角的一類新型集成電路,它具有簡潔、經濟、高速度、低功耗等優勢,又具有全集成化、適用性強,便于開發和維護(升級)等顯著優點。與單片機和DSP相比,FPGA的頻率更高、速度更快,這些特點順應了電力電子電路的日趨高頻化和復雜化發展的需要。因此,在越來越多的領域中FPGA得到了日益廣泛的發展和應用。  本文提出了一種采用現場可編程門陣列(FPGA)器件實現數字化通用PWM控制器的方案。該控制器能產生多路PWM脈沖,具有開關頻率可調、各路脈沖間的相位可調、接口簡單、響應速度快、易修改、可現場編程等特點,可應用于PWM的全數字化控制。文中對方案的實現進行了比較詳細的論述,包括A/D采樣控制、PI算法的實現、PWM波形的產生、各模塊的工作原理等。  本文還提出一種新型ZCT-PWMBoost變換器,詳細的分析了該變換器的工作過程,并采用基于FPGA的數字化通用PWM控制器對這種軟開關Boost變換器進行控制,給出了比較完滿的實驗結果。實驗結果驗證了該控制器以及該ZCTBoost變換器的可行性和有效性,

    標簽: FPGA PWM 數字化 制器設計

    上傳時間: 2013-07-10

    上傳用戶:x4587

  • 基于FPGA的無線接收機下變頻器的設計與實現

    隨著無線通信的應用日益廣泛,無線通信系統的種類也越來越繁雜,但是由于不同通信系統的工作頻段、調制方式、通信協議等原理結構上存在差異而極大限制了不同系統之間的互通。軟件無線電擺脫了硬件體系結構的束縛,成為解決不同通信體制之間互操作問題和開展多種通信業務的最佳途徑,具有巨大的商業和軍事價值,被喻為無線電通信領域一次新的技術革命。 本文首先回顧了軟件無線電的提出和發展現狀,然后論述了軟件無線電的基本理論和數學模型。在此理論和模型的基礎上,設計了軟件無線電接收機的硬件平臺。該平臺包括射頻部分、中頻處理部分和基帶處理部分。射頻部分由天線和無線接收機組成;中頻部分先將接收機輸出的模擬信號數字化,然后再通過FPGA實現下變頻;基帶部分主要由DSP和嵌入式系統組成,完成解調、同步等處理并可以進行一些其他的應用。其中的嵌入式系統的主處理器是基于ARM7-TDMI內核的LPC2200芯片,為了實現開發的方便在此芯片上移植了uC/OS-Ⅱ嵌入式時實內核。 軟件無線電接收機是一個很龐大的體系,其中的數字下變頻器DDC是一個非常關鍵的組成部分,在這部分中可方便的對接收頻段、濾波器特性等進行編程控制,極大的提高了通信設備的性能和靈活性,因此本文的重點在于數字下變頻器的設計與實現。實現下變頻的方法有很多種,由于FPGA在速度和靈活性上的優勢,其應用也越來越廣泛,因此主要采用了居于領導地位的XILINX公司的SPATAN-Ⅱ芯片來實現數字下變頻的功能。

    標簽: FPGA 無線接收機 下變頻

    上傳時間: 2013-04-24

    上傳用戶:mfhe2005

  • adf4350寄存器配置軟件

    一個很好用的adf4350寄存器配置軟件,省卻了您繁瑣的計算寄存器值的時間

    標簽: 4350 adf 寄存器 軟件

    上傳時間: 2013-06-30

    上傳用戶:海陸空653

  • 基于FPGA技術的星載高速復接器設計

    隨著空間科學任務的增加,需要處理的空間科學數據量激增,要求建立一個高速的空間數據連接網絡.高速復接器作為空間飛行器星上網絡的關鍵設備,其性能對整個空間數據網絡的性能起著重要影響.該文闡述了利用先入先出存儲器FIFO進行異步速率調整,應用VHDL語言和可編程門陣列FPGA技術,對多個信號源數據進行數據打包、信道選通調度和多路復接的方法.設計中,用VHDL語言對高速復接器進行行為級建模,為了驗證這個模型,首先使用軟件進行仿真,通過編寫testbench程序模擬FIFO的動作特點,對程序輸入信號進行仿真,在軟件邏輯仿真取得預期結果后,繼續設計硬件電路,設計出的實際電路實現了將來自兩個不同速率的信源數據(1394總線數據和1553B總線數據)復接成一路符合CCSDS協議的位流業務數據.在實驗調試中對FPGA的輸出數據進行檢驗,同時對設計方法進行驗證.驗證結果完全符合設計目標.應用硬件可編程邏輯芯片FPGA設計高速復接器,大幅度提高了數據的復接速率,可應用于未來的星載高速數據系統中,能夠完成在軌系統的數據復接任務.

    標簽: FPGA 星載 復接器

    上傳時間: 2013-07-17

    上傳用戶:wfl_yy

  • 變頻器矢量控制及PID控制

    變頻器矢量控制及PID控制變頻器矢量控制及PID控制

    標簽: PID 變頻器 矢量控制 控制

    上傳時間: 2013-04-24

    上傳用戶:dyy618

  • 卷積碼在CDMA2000中的應用及其譯碼器FPGA實現

    數字信息在有噪聲的信道中傳輸時,受到噪聲的影響,誤碼總是不可避免的。根據香農信息理論,只要使Es/N0足夠大,就可以達到任意小的誤碼率。采用差錯控制編碼,即信道編碼技術,可以在一定的Es/N0條件下有效地降低誤碼率。按照對信息元處理方式不同,信道編碼分為分組碼與卷積碼兩類。卷積碼的k0和n0較小,實現最佳譯碼與準最佳譯碼更加容易。卷積碼運用廣泛,被ITU選入第三代移動通信系統,作為包括WCDMA,CDMA2000和TD-SCDMA在內的信道編碼的標準方案。 本文研究了CDMA2000業務通道中的幀結構,對CDMA2000系統中的卷積碼特性及維特比譯碼的性能限進行了分析,并基于MATLAB平臺做了相應的譯碼性能仿真。我們設計了一種可用于CDMA2000通信系統的通用、高速維特比譯碼器。該譯碼器在設計上具有以下創新之處:(1)采用通用碼表結構,支持可變碼率;幀控制模塊和頻率控制器模塊的設計中采用計數器、定時器等器件實現了可變幀長、可變數據速率的數據幀處理方式。(2)結合流水線結構思想,利用四個ACS模塊并行運行,加快數據處理速度;在ACS模塊中,將路徑度量值存貯器的存儲結構進行優化,防止數據讀寫的阻塞,縮短存儲器讀寫時間,使譯碼器的處理速度更快。(3)為了防止路徑度量值和幸存路徑長度的溢出,提出了保護處理策略。我們還將設計結果在APEXEP20K30E芯片上進行了硬件實現。該譯碼器芯片具有可變的碼率和幀長處理能力,可以運行于40MHZ系統時鐘下,內部最高譯碼速度可達625kbps。本文所提出的維特比譯碼器硬件結構具有很強的通用性和高速性,可以方便地應用于CDMA2000移動通信系統。

    標簽: CDMA 2000 FPGA 卷積碼

    上傳時間: 2013-06-24

    上傳用戶:lingduhanya

  • STC單片機全系列頭文件

    這個是STC單片機的全系列頭文件. 這個是STC單片機的全系列頭文件

    標簽: STC 單片機 頭文件

    上傳時間: 2013-04-24

    上傳用戶:1054154823

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