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分壓器

  • verilog

    verilog，4、5分頻器，5分頻器占空比3：2

    標簽： verilog

    上傳時間： 2015-03-12

    上傳用戶：wanghui2438

  • EDA中常用模塊VHDL程序

    EDA中常用模塊VHDL程序，不同時基的計數器由同一個外部是中輸入時必備的分頻函數。分頻器FENPIN1/2/3(50分頻=1HZ，25分頻=2HZ，10分頻=5HZ。稍微改變程序即可實現)

    標簽： VHDL EDA 模塊 程序

    上傳時間： 2015-03-22

    上傳用戶：498732662

  • 【經典設計】VHDL源代碼下載～～ 其中經典的設計有：【自動售貨機】、【電子鐘】、【紅綠燈交通信號系統】、【步進電機定位控制系統】、【直流電機速度控制系統】、【計算器】、【點陣列LED顯示控制系統】

    【經典設計】VHDL源代碼下載～～ 其中經典的設計有：【自動售貨機】、【電子鐘】、【紅綠燈交通信號系統】、【步進電機定位控制系統】、【直流電機速度控制系統】、【計算器】、【點陣列LED顯示控制系統】 基本數字邏輯設計有：【鎖存器】、【多路選擇器】、【三態門】、【雙向輸入|輸出端口】、【內部（緩沖）信號】、【編碼轉換】、【加法器】、【編碼器/譯碼器】、【4位乘法器】、【只讀存儲器】、【RSFF觸發器】、【DFF觸發器】、【JKFF觸發器】、【計數器】、【分頻器】、【寄存器】、【狀態機】

    標簽： VHDL LED 源代碼

    上傳時間： 2015-06-16

    上傳用戶：chenxichenyue

  • EWB做的多功能數字鐘 由振蕩器輸出穩定的高頻脈沖信號作為時間基準

    EWB做的多功能數字鐘 由振蕩器輸出穩定的高頻脈沖信號作為時間基準，經分頻器輸出標準的秒脈沖，秒計數器滿60向分計數器進位，分計數器滿60向小時計數器進位，小時計數器按“12翻1”規律計數，計數器經譯碼器送到顯示器；計數出現誤差可用校時電路進行校時、校分、校秒， 可發揮部分：使鬧鐘具有可整點報時與定時鬧鐘的功能。

    標簽： EWB 多功能 基準 數字

    上傳時間： 2015-08-06

    上傳用戶：zhangyi99104144

  • 在數字電路中

    在數字電路中，常需要對較高頻率的時鐘進行分頻操作，得到較低頻率的時鐘信號。我們知道，在硬件電路設計中時鐘信號是最重要的信號之一。 下面我們介紹分頻器的 VHDL 描述，在源代碼中完成對時鐘信號 CLK 的 2 分頻， 4 分頻， 8 分頻， 16 分頻。 這也是最簡單的分頻電路，只需要一個計數器即可。

    標簽： 數字電路

    上傳時間： 2015-08-25

    上傳用戶：wangchong

  • 數字系統設計實例.pdf,VHDL語言實現

    數字系統設計實例.pdf,VHDL語言實現，7.1 半整數分頻器的設計7.2 音樂發生器7.3 2FSK/2PSK信號產生器7.4 實用多功能電子表7.5 交通燈控制器 7.6 數字頻率計.值得一看。

    標簽： VHDL 數字系統 設計實例

    上傳時間： 2015-08-31

    上傳用戶：lhw888

  • fpga cpld 常見模塊設計

    fpga cpld 常見模塊設計，包括基于fpga 的全數字鎖向環，基于fpga cpld 的半整數分頻器的設計等，很有用

    標簽： fpga cpld 模塊設計

    上傳時間： 2014-11-06

    上傳用戶：leehom61

  • 數字鎖相環實現源碼

    數字鎖相環實現源碼，有很大的參考價值。 由 鑒相器 模K加減計數器 脈沖加減電路 同步建立偵察電路 模N分頻器 構成.

    標簽： 數字鎖相環 源碼

    上傳時間： 2014-01-04

    上傳用戶：zq70996813

  • 利用verilog語言

    利用verilog語言，設計分頻器，很不錯的參考資料

    標簽： verilog 語言

    上傳時間： 2013-12-03

    上傳用戶：685

  • 2MHz的數據時鐘恢復電路

    2MHz的數據時鐘恢復電路，包括鑒相器、分頻器及濾波器

    標簽： 2MHz 數據 時鐘恢復 電路

    上傳時間： 2013-12-26

    上傳用戶：電子世界

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