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分析與設(shè)計(jì)

  • 一篇來(lái)自臺(tái)灣中華大學(xué)的論文--《無(wú)線射頻系統(tǒng)標(biāo)簽晶片設(shè)計(jì)》

    一篇來(lái)自臺(tái)灣中華大學(xué)的論文--《無(wú)線射頻系統(tǒng)標(biāo)簽晶片設(shè)計(jì)》,彩色版。其摘要為:本論文討論使用於無(wú)線射頻辨識(shí)系統(tǒng)(RFID)之標(biāo)籤晶片系統(tǒng)的電路設(shè)計(jì)和晶片製作,初步設(shè)計(jì)標(biāo)籤晶片的基本功能,設(shè)計(jì)流程包含數(shù)位軟體及功能的模擬、基本邏輯閘及類比電路的設(shè)計(jì)與晶片電路的佈局考量。 論文的第一部份是序論、射頻辨識(shí)系統(tǒng)的規(guī)劃、辨識(shí)系統(tǒng)的規(guī)格介紹及制定,而第二部份是標(biāo)籤晶片設(shè)計(jì)、晶片量測(cè)、結(jié)論。 電路的初步設(shè)計(jì)功能為:使用電容作頻率緩衝的Schmitt trigger Clock、CRC-16的錯(cuò)誤偵測(cè)編碼、Manchester編碼及使用單一電路做到整流、振盪及調(diào)變的功能,最後完成晶片的實(shí)作。

    標(biāo)簽: 大學(xué) 論文 無(wú)線射頻

    上傳時(shí)間: 2016-08-27

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  • 在 Java EE 的藍(lán)圖中

    在 Java EE 的藍(lán)圖中,JSP Servlet是屬於Web層技術(shù),JSP與Servlet是一體的兩面,您可以使用單獨(dú)一項(xiàng)技術(shù)來(lái)解決動(dòng)態(tài)網(wǎng)頁(yè)呈現(xiàn)的需求,但最好的方式是取兩者的長(zhǎng)處,JSP是網(wǎng)頁(yè)設(shè)計(jì)人員導(dǎo)向的,而Servlet是程式設(shè)計(jì)人員導(dǎo)向的,釐清它們之間的職責(zé)可以讓兩個(gè)不同專長(zhǎng)的團(tuán)隊(duì)彼此合作,並降低相互間的牽制作用。

    標(biāo)簽: Java EE

    上傳時(shí)間: 2016-11-15

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  • cadence-allegro16.6高級(jí)教程

    主要內(nèi)容介紹 Allegro 如何載入 Netlist,進(jìn)而認(rèn)識(shí)新式轉(zhuǎn)法和舊式轉(zhuǎn)法有何不同及優(yōu)缺點(diǎn)的分析,透過(guò)本章學(xué)習(xí)可以對(duì) Allegro 和 Capture 之間的互動(dòng)關(guān)係,同時(shí)也能體驗(yàn)出 Allegro 和 Capture 同步變更屬性等強(qiáng)大功能。Netlist 是連接線路圖和 Allegro Layout 圖檔的橋樑。在這裏所介紹的 Netlist 資料的轉(zhuǎn)入動(dòng)作只是針對(duì)由 Capture(線路圖部分)產(chǎn)生的 Netlist 轉(zhuǎn)入 Allegro(Layout部分)1. 在 OrCAD Capture 中設(shè)計(jì)好線路圖。2. 然後由 OrCAD Capture 產(chǎn)生 Netlist(annotate 是在進(jìn)行線路圖根據(jù)第五步產(chǎn)生的資料進(jìn)行編改)。 3. 把產(chǎn)生的 Netlist 轉(zhuǎn)入 Allegro(layout 工作系統(tǒng))。 4. 在 Allegro 中進(jìn)行 PCB 的 layout。 5. 把在 Allegro 中產(chǎn)生的 back annotate(Logic)轉(zhuǎn)出(在實(shí)際 layout 時(shí)可能對(duì)原有的 Netlist 有改動(dòng)過(guò)),並轉(zhuǎn)入 OrCAD Capture 裏進(jìn)行回編。

    標(biāo)簽: cadence allegro

    上傳時(shí)間: 2022-04-28

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  • 11本開(kāi)關(guān)電源經(jīng)典書(shū)籍大放送 (網(wǎng)盤)

    全部都是個(gè)人珍藏開(kāi)關(guān)電源書(shū)籍,學(xué)習(xí)完不成大牛你們來(lái)找我~1、《反激式開(kāi)關(guān)電源設(shè)計(jì)、制作、調(diào)試》_2014年版2、《交換式電源供給器之理論與實(shí)務(wù)設(shè)計(jì)》3、《精通開(kāi)關(guān)電源設(shè)計(jì)》_2008年版4、《開(kāi)關(guān)電源的原理與設(shè)計(jì)》_2001年版5、《開(kāi)關(guān)電源故障診斷與排除》_2011年版6、《開(kāi)關(guān)電源設(shè)計(jì)》第2版_2005年版7、《開(kāi)關(guān)電源設(shè)計(jì)與優(yōu)化》_2006年版8、《開(kāi)關(guān)電源設(shè)計(jì)指南》_2004年版9、《開(kāi)關(guān)電源手冊(cè)》第2版_2006年10、《新型開(kāi)關(guān)電源優(yōu)化設(shè)計(jì)與實(shí)例詳解》_2006版11、開(kāi)關(guān)電源專業(yè)英語(yǔ)

    標(biāo)簽: 開(kāi)關(guān)電源

    上傳時(shí)間: 2022-06-01

    上傳用戶:默默

  • 10本開(kāi)關(guān)電源技術(shù)書(shū)籍分享!

    開(kāi)關(guān)電源專業(yè)英語(yǔ).doc 32KB2020-03-12 11:28 反激式開(kāi)關(guān)電源設(shè)計(jì)、制作、調(diào)試_2014年版..pdf 39.4M2020-03-12 11:28 《精通開(kāi)關(guān)電源設(shè)計(jì)》_2008年版.pdf 39.7M2020-03-12 11:28 《新型開(kāi)關(guān)電源優(yōu)化設(shè)計(jì)與實(shí)例詳解》_2006版.pdf 192.1M2020-03-12 11:28 《開(kāi)關(guān)電源設(shè)計(jì)指南》_2004年版.pdf 9.6M2020-03-12 11:28 《開(kāi)關(guān)電源設(shè)計(jì)與優(yōu)化》_2006年版.pdf 28.9M2020-03-12 11:28 《開(kāi)關(guān)電源設(shè)計(jì)》第2版_2005年版.pdf 31.5M2020-03-12 11:28 《開(kāi)關(guān)電源的原理與設(shè)計(jì)》_2001年版.pdf 17.9M2020-03-12 11:28 《開(kāi)關(guān)電源故障診斷與排除》_2011年版.pdf 40.8M2020-03-12 11:28 《開(kāi)關(guān)電源手冊(cè)》第2版_2006年.pdf 42M2020-03-12 11:28 《交換式電源供給器之理論與實(shí)務(wù)設(shè)計(jì)》.pdf

    標(biāo)簽: AutoCAD 2000 實(shí)用教程

    上傳時(shí)間: 2013-06-26

    上傳用戶:eeworm

  • 10本經(jīng)典的開(kāi)關(guān)電源相關(guān)書(shū)籍合集

    反激式開(kāi)關(guān)電源設(shè)計(jì)、制作、調(diào)試_2014年版..pdf 《新型開(kāi)關(guān)電源優(yōu)化設(shè)計(jì)與實(shí)例詳解》_2006版.pdf 《開(kāi)關(guān)電源手冊(cè)》第2版_2006年.pdf 《開(kāi)關(guān)電源設(shè)計(jì)指南》_2004年版.pdf 《開(kāi)關(guān)電源設(shè)計(jì)與優(yōu)化》_2006年版.pdf 《開(kāi)關(guān)電源設(shè)計(jì)》第2版_2005年版.pdf 《開(kāi)關(guān)電源故障診斷與排除》_2011年版.pdf 《開(kāi)關(guān)電源的原理與設(shè)計(jì)》_2001年版.pdf 《精通開(kāi)關(guān)電源設(shè)計(jì)》_2008年版.pdf 《交換式電源供給器之理論與實(shí)務(wù)設(shè)計(jì)》.pdf

    標(biāo)簽: 數(shù)字圖像處理

    上傳時(shí)間: 2013-04-15

    上傳用戶:eeworm

  • 開(kāi)關(guān)電源基本原理介紹

    開(kāi)關(guān)電源基本原理與設(shè)計(jì)介紹,臺(tái)達(dá)的資料,很好的

    標(biāo)簽: 開(kāi)關(guān) 電源基本

    上傳時(shí)間: 2013-04-24

    上傳用戶:cursor

  • _Wiley_Synthesis_of_Arithmetic_Circuits_-_FPGA_ASIC_and_Embedded_Systems_(2006)

    _Wiley_Synthesis_of_Arithmetic_Circuits_-_FPGA_ASIC_and_Embedded_Systems_(2006)_-_DDU一些硬體設(shè)計(jì)教學(xué)文件

    標(biāo)簽: Wiley_Synthesis_of_Arithmetic_Cir FPGA_ASIC_and_Embedded_Systems cuits 2006

    上傳時(shí)間: 2013-08-20

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  • 微電腦型數(shù)學(xué)演算式隔離傳送器

    特點(diǎn): 精確度0.1%滿刻度 可作各式數(shù)學(xué)演算式功能如:A+B/A-B/AxB/A/B/A&B(Hi or Lo)/|A|/ 16 BIT類比輸出功能 輸入與輸出絕緣耐壓2仟伏特/1分鐘(input/output/power) 寬范圍交直流兩用電源設(shè)計(jì) 尺寸小,穩(wěn)定性高

    標(biāo)簽: 微電腦 數(shù)學(xué)演算 隔離傳送器

    上傳時(shí)間: 2014-12-23

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  • pcb layout規(guī)則

    LAYOUT REPORT .............. 1   目錄.................. 1     1. PCB LAYOUT 術(shù)語(yǔ)解釋(TERMS)......... 2     2. Test Point : ATE 測(cè)試點(diǎn)供工廠ICT 測(cè)試治具使用............ 2     3. 基準(zhǔn)點(diǎn) (光學(xué)點(diǎn)) -for SMD:........... 4     4. 標(biāo)記 (LABEL ING)......... 5     5. VIA HOLE PAD................. 5     6. PCB Layer 排列方式...... 5     7.零件佈置注意事項(xiàng) (PLACEMENT NOTES)............... 5     8. PCB LAYOUT 設(shè)計(jì)............ 6     9. Transmission Line ( 傳輸線 )..... 8     10.General Guidelines – 跨Plane.. 8     11. General Guidelines – 繞線....... 9     12. General Guidelines – Damping Resistor. 10     13. General Guidelines - RJ45 to Transformer................. 10     14. Clock Routing Guideline........... 12     15. OSC & CRYSTAL Guideline........... 12     16. CPU

    標(biāo)簽: layout pcb

    上傳時(shí)間: 2013-12-20

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