隨著現(xiàn)代測(cè)控技術(shù)的發(fā)展，在精密測(cè)量領(lǐng)域，光柵傳感器在位移和角度測(cè)量中的使用越來越廣泛。由于受到光柵刻線工藝的限制，為了提高光柵傳感器的測(cè)量精度，往往需要使用電子方法對(duì)光柵信號(hào)進(jìn)行細(xì)分辨向和計(jì)數(shù)。而在實(shí)際測(cè)...
標(biāo)簽： FPGA 多路 光柵 數(shù)據(jù)采集系統(tǒng)
上傳時(shí)間： 2013-05-30
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·詳細(xì)說明：h.264標(biāo)準(zhǔn)代碼，用于視頻編碼！可以實(shí)現(xiàn)各種視頻的編碼和解碼，可以在這個(gè)代碼的基礎(chǔ)上進(jìn)行各種開發(fā)，比如算法的優(yōu)化，轉(zhuǎn)碼技術(shù)，實(shí)現(xiàn)各種分辨了的轉(zhuǎn)碼-h.264 standard code, uses in the video frequency code! May realize each kind of video frequency code and the decoding, ma
標(biāo)簽： 264 標(biāo)準(zhǔn) 代碼 視頻編碼
上傳時(shí)間： 2013-05-28
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對(duì)脈搏波信號(hào)進(jìn)行分析之前，對(duì)信號(hào)的去噪非常重要，本論文利用Mallat算法對(duì)脈搏波信號(hào)進(jìn)行多分辨分析和去噪，分別對(duì)閾值法、平移不變量法、模極大值法的降噪原理進(jìn)行分析，通過大量實(shí)驗(yàn)對(duì)比，比較了它們?cè)谔幚砻}搏波信號(hào)方面的優(yōu)缺點(diǎn)。通過對(duì)一段含噪脈搏波信號(hào)降噪，得到了滿意的去噪效果。
上傳時(shí)間： 2013-10-20
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摘要: 介紹了時(shí)鐘分相技術(shù)并討論了時(shí)鐘分相技術(shù)在高速數(shù)字電路設(shè)計(jì)中的作用。 關(guān)鍵詞: 時(shí)鐘分相技術(shù); 應(yīng)用 中圖分類號(hào): TN 79 文獻(xiàn)標(biāo)識(shí)碼:A 文章編號(hào): 025820934 (2000) 0620437203 時(shí)鐘是高速數(shù)字電路設(shè)計(jì)的關(guān)鍵技術(shù)之一, 系統(tǒng)時(shí)鐘的性能好壞, 直接影響了整個(gè)電路的 性能。尤其現(xiàn)代電子系統(tǒng)對(duì)性能的越來越高的要求, 迫使我們集中更多的注意力在更高頻率、 更高精度的時(shí)鐘設(shè)計(jì)上面。但隨著系統(tǒng)時(shí)鐘頻率的升高。我們的系統(tǒng)設(shè)計(jì)將面臨一系列的問 題。 1) 時(shí)鐘的快速電平切換將給電路帶來的串?dāng)_(Crosstalk) 和其他的噪聲。 2) 高速的時(shí)鐘對(duì)電路板的設(shè)計(jì)提出了更高的要求: 我們應(yīng)引入傳輸線(T ransm ission L ine) 模型, 并在信號(hào)的匹配上有更多的考慮。 3) 在系統(tǒng)時(shí)鐘高于100MHz 的情況下, 應(yīng)使用高速芯片來達(dá)到所需的速度, 如ECL 芯 片, 但這種芯片一般功耗很大, 再加上匹配電阻增加的功耗, 使整個(gè)系統(tǒng)所需要的電流增大, 發(fā) 熱量增多, 對(duì)系統(tǒng)的穩(wěn)定性和集成度有不利的影響。 4) 高頻時(shí)鐘相應(yīng)的電磁輻射(EM I) 比較嚴(yán)重。 所以在高速數(shù)字系統(tǒng)設(shè)計(jì)中對(duì)高頻時(shí)鐘信號(hào)的處理應(yīng)格外慎重, 盡量減少電路中高頻信 號(hào)的成分, 這里介紹一種很好的解決方法, 即利用時(shí)鐘分相技術(shù), 以低頻的時(shí)鐘實(shí)現(xiàn)高頻的處 理。 1 時(shí)鐘分相技術(shù) 我們知道, 時(shí)鐘信號(hào)的一個(gè)周期按相位來分, 可以分為360°。所謂時(shí)鐘分相技術(shù), 就是把 時(shí)鐘周期的多個(gè)相位都加以利用, 以達(dá)到更高的時(shí)間分辨。在通常的設(shè)計(jì)中, 我們只用到時(shí)鐘 的上升沿(0 相位) , 如果把時(shí)鐘的下降沿(180°相位) 也加以利用, 系統(tǒng)的時(shí)間分辨能力就可以 提高一倍(如圖1a 所示)。同理, 將時(shí)鐘分為4 個(gè)相位(0°、90°、180°和270°) , 系統(tǒng)的時(shí)間分辨就 可以提高為原來的4 倍(如圖1b 所示)。 以前也有人嘗試過用專門的延遲線或邏輯門延時(shí)來達(dá)到時(shí)鐘分相的目的。用這種方法產(chǎn)生的相位差不夠準(zhǔn)確, 而且引起的時(shí)間偏移(Skew ) 和抖動(dòng) (J itters) 比較大, 無法實(shí)現(xiàn)高精度的時(shí)間分辨。 近年來半導(dǎo)體技術(shù)的發(fā)展, 使高質(zhì)量的分相功能在一 片芯片內(nèi)實(shí)現(xiàn)成為可能, 如AMCC 公司的S4405, CY2 PRESS 公司的CY9901 和CY9911, 都是性能優(yōu)異的時(shí)鐘 芯片。這些芯片的出現(xiàn), 大大促進(jìn)了時(shí)鐘分相技術(shù)在實(shí)際電 路中的應(yīng)用。我們?cè)谶@方面作了一些嘗試性的工作: 要獲得 良好的時(shí)間性能, 必須確保分相時(shí)鐘的Skew 和J itters 都 比較小。因此在我們的設(shè)計(jì)中, 通常用一個(gè)低頻、高精度的 晶體作為時(shí)鐘源, 將這個(gè)低頻時(shí)鐘通過一個(gè)鎖相環(huán)(PLL ) , 獲得一個(gè)較高頻率的、比較純凈的時(shí)鐘, 對(duì)這個(gè)時(shí)鐘進(jìn)行分相, 就可獲得高穩(wěn)定、低抖動(dòng)的分 相時(shí)鐘。 這部分電路在實(shí)際運(yùn)用中獲得了很好的效果。下面以應(yīng)用的實(shí)例加以說明。2 應(yīng)用實(shí)例 2. 1 應(yīng)用在接入網(wǎng)中 在通訊系統(tǒng)中, 由于要減少傳輸 上的硬件開銷, 一般以串行模式傳輸 圖3 時(shí)鐘分為4 個(gè)相位 數(shù)據(jù), 與其同步的時(shí)鐘信號(hào)并不傳輸。 但本地接收到數(shù)據(jù)時(shí), 為了準(zhǔn)確地獲取 數(shù)據(jù), 必須得到數(shù)據(jù)時(shí)鐘, 即要獲取與數(shù) 據(jù)同步的時(shí)鐘信號(hào)。在接入網(wǎng)中, 數(shù)據(jù)傳 輸?shù)慕Y(jié)構(gòu)如圖2 所示。 數(shù)據(jù)以68MBös 的速率傳輸, 即每 個(gè)bit 占有14. 7ns 的寬度, 在每個(gè)數(shù)據(jù) 幀的開頭有一個(gè)用于同步檢測(cè)的頭部信息。我們要找到與它同步性好的時(shí)鐘信號(hào), 一般時(shí)間 分辨應(yīng)該達(dá)到1ö4 的時(shí)鐘周期。即14. 7ö 4≈ 3. 7ns, 這就是說, 系統(tǒng)時(shí)鐘頻率應(yīng)在300MHz 以 上, 在這種頻率下, 我們必須使用ECL inp s 芯片(ECL inp s 是ECL 芯片系列中速度最快的, 其 典型門延遲為340p s) , 如前所述, 這樣對(duì)整個(gè)系統(tǒng)設(shè)計(jì)帶來很多的困擾。 我們?cè)谶@里使用鎖相環(huán)和時(shí)鐘分相技術(shù), 將一個(gè)16MHz 晶振作為時(shí)鐘源, 經(jīng)過鎖相環(huán) 89429 升頻得到68MHz 的時(shí)鐘, 再經(jīng)過分相芯片AMCCS4405 分成4 個(gè)相位, 如圖3 所示。 我們只要從4 個(gè)相位的68MHz 時(shí)鐘中選擇出與數(shù)據(jù)同步性最好的一個(gè)。選擇的依據(jù)是: 在每個(gè)數(shù)據(jù)幀的頭部(HEAD) 都有一個(gè)8bit 的KWD (KeyWord) (如圖1 所示) , 我們分別用 這4 個(gè)相位的時(shí)鐘去鎖存數(shù)據(jù), 如果經(jīng)某個(gè)時(shí)鐘鎖存后的數(shù)據(jù)在這個(gè)指定位置最先檢測(cè)出這 個(gè)KWD, 就認(rèn)為下一相位的時(shí)鐘與數(shù)據(jù)的同步性最好(相關(guān))。 根據(jù)這個(gè)判別原理, 我們?cè)O(shè)計(jì)了圖4 所示的時(shí)鐘分相選擇電路。 在板上通過鎖相環(huán)89429 和分相芯片S4405 獲得我們所要的68MHz 4 相時(shí)鐘: 用這4 個(gè) 時(shí)鐘分別將輸入數(shù)據(jù)進(jìn)行移位, 將移位的數(shù)據(jù)與KWD 作比較, 若至少有7bit 符合, 則認(rèn)為檢 出了KWD。將4 路相關(guān)器的結(jié)果經(jīng)過優(yōu)先判選控制邏輯, 即可輸出同步性最好的時(shí)鐘。這里, 我們運(yùn)用AMCC 公司生產(chǎn)的 S4405 芯片, 對(duì)68MHz 的時(shí)鐘進(jìn)行了4 分 相, 成功地實(shí)現(xiàn)了同步時(shí)鐘的獲取, 這部分 電路目前已實(shí)際地應(yīng)用在某通訊系統(tǒng)的接 入網(wǎng)中。 2. 2 高速數(shù)據(jù)采集系統(tǒng)中的應(yīng)用 高速、高精度的模擬- 數(shù)字變換 (ADC) 一直是高速數(shù)據(jù)采集系統(tǒng)的關(guān)鍵部 分。高速的ADC 價(jià)格昂貴, 而且系統(tǒng)設(shè)計(jì) 難度很高。以前就有人考慮使用多個(gè)低速 圖5 分相技術(shù)應(yīng)用于采集系統(tǒng) ADC 和時(shí)鐘分相, 用以替代高速的ADC, 但由 于時(shí)鐘分相電路產(chǎn)生的相位不準(zhǔn)確, 時(shí)鐘的 J itters 和Skew 比較大(如前述) , 容易產(chǎn)生較 大的孔徑晃動(dòng)(Aperture J itters) , 無法達(dá)到很 好的時(shí)間分辨。 現(xiàn)在使用時(shí)鐘分相芯片, 我們可以把分相 技術(shù)應(yīng)用在高速數(shù)據(jù)采集系統(tǒng)中: 以4 分相后 圖6 分相技術(shù)提高系統(tǒng)的數(shù)據(jù)采集率 的80MHz 采樣時(shí)鐘分別作為ADC 的 轉(zhuǎn)換時(shí)鐘, 對(duì)模擬信號(hào)進(jìn)行采樣, 如圖5 所示。 在每一采集通道中, 輸入信號(hào)經(jīng)過 緩沖、調(diào)理, 送入ADC 進(jìn)行模數(shù)轉(zhuǎn)換, 采集到的數(shù)據(jù)寫入存儲(chǔ)器(M EM )。各個(gè) 采集通道采集的是同一信號(hào), 不過采樣 點(diǎn)依次相差90°相位。通過存儲(chǔ)器中的數(shù) 據(jù)重組, 可以使系統(tǒng)時(shí)鐘為80MHz 的采 集系統(tǒng)達(dá)到320MHz 數(shù)據(jù)采集率(如圖6 所示)。 3 總結(jié) 靈活地運(yùn)用時(shí)鐘分相技術(shù), 可以有效地用低頻時(shí)鐘實(shí)現(xiàn)相當(dāng)于高頻時(shí)鐘的時(shí)間性能, 并 避免了高速數(shù)字電路設(shè)計(jì)中一些問題, 降低了系統(tǒng)設(shè)計(jì)的難度。
標(biāo)簽： 時(shí)鐘 分相 技術(shù)應(yīng)用
上傳時(shí)間： 2013-12-17
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XC164CS是目前廣泛使用的C166系列單片機(jī)的一種派生型，是基于增強(qiáng)型C166SV2結(jié)構(gòu)的，優(yōu)于現(xiàn)有的16位單片機(jī)解決方案。XC164CS具有令人印象深刻的DSP性能和先進(jìn)的中斷處理，加上一種集成高效的外設(shè)集和高性能在片flash或ROM存儲(chǔ)器，使得XC164CS成為工業(yè)和汽車應(yīng)用設(shè)備的理想選擇，如同步DC馬達(dá)控制器、動(dòng)力轉(zhuǎn)向裝置等方案。其靈活的智能PWM單元簡(jiǎn)化了AC-,DC-或阻抗馬達(dá)的控制。高速、高分辨ADC處理復(fù)雜的模擬環(huán)境的快速和精確轉(zhuǎn)換。網(wǎng)絡(luò)化的方案完全可以采用高效的通信接口來解決，如具有自動(dòng)網(wǎng)關(guān)功能的高速TwinCAN模塊。
上傳時(shí)間： 2014-12-27
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摘要：超低頻信號(hào)發(fā)生器是科研、教學(xué)、制造業(yè)中一種最常用的通用儀器，輸出波形一般固定為正弦波、三角波、鋸齒波和方波，不能實(shí)現(xiàn)有時(shí)在實(shí)驗(yàn)和工程應(yīng)用中需要的特殊信號(hào)或自定義信號(hào)。而要實(shí)現(xiàn)這一要求，不是做成硬件式的專用信號(hào)發(fā)生器，就是用計(jì)算機(jī)系統(tǒng)來完成，前者仍然不靈活，后者費(fèi)用太高。然而應(yīng)用單片機(jī)技術(shù)，通過軟件與硬件的有機(jī)結(jié)合由硬件電路搭成一個(gè)環(huán)境平臺(tái)，再由軟件程序把要求的“任意函數(shù)信號(hào)”數(shù)據(jù)表嵌入在單片機(jī)程序存儲(chǔ)器內(nèi)，通過軟件程序更改輸出波形數(shù)據(jù)表，即可方便實(shí)現(xiàn)輸出任意函數(shù)信號(hào)，而無需變動(dòng)硬件電路。本原理樣機(jī)使用單片機(jī)AT89C51，對(duì)其進(jìn)行一次固化，可以安排四種任意波形，頻率范圍為0.001～800Hz，幅值范圍為0～±10V。本文中對(duì)原理樣機(jī)的軟硬件系統(tǒng)的性能和誤差進(jìn)行了定量分析，并設(shè)計(jì)了一套使用Intel公司的新一代16位單片機(jī)80296SA對(duì)該樣機(jī)進(jìn)行了性能提升的新型樣機(jī)方案，然后對(duì)新型樣機(jī)方案進(jìn)行了原理分析和性能分析，并給出了誤差的定量計(jì)算，表明此方案不但可使樣機(jī)的原理頻率范圍提高至1500Hz，輸出幅值不變，輸出分辨率提高至212，使波形質(zhì)量大為改善。希望這種性價(jià)比較高的函數(shù)信號(hào)發(fā)生器對(duì)科研、教學(xué)、制造業(yè)有所幫助。關(guān)鍵詞：?jiǎn)纹瑱C(jī)應(yīng)用 MCS51 MCS296 超低頻信號(hào)發(fā)生器
標(biāo)簽： 單片機(jī) 函數(shù)信號(hào)發(fā)生器 超低頻
上傳時(shí)間： 2013-11-20
上傳用戶：7891
18-2. D/A轉(zhuǎn)換器基本知識(shí)18-3. 光導(dǎo)智能小車硬件實(shí)現(xiàn)18-4. ADC0832基本應(yīng)用方法18-5. 光導(dǎo)智能小車軟件實(shí)現(xiàn)A/D轉(zhuǎn)換器的主要技術(shù)指標(biāo)分辨率 使輸出數(shù)字量變化一個(gè)相鄰數(shù)碼所需輸入模擬電壓的變化量。常 用二進(jìn)制的位數(shù)表示。 例如:12位ADC的分辨率就是12位，一個(gè)10V滿刻度的12位ADC能分辨 輸入電壓變化最小是: 10V×1/212=2.4mV量化誤差 ADC把模擬量變?yōu)閿?shù)字量，用數(shù)字量近似表示模擬量，這個(gè)過程稱為量化。量化誤差是ADC的有限位數(shù)對(duì)模擬量進(jìn)行量化而引起的誤差。A/D轉(zhuǎn)換器的主要技術(shù)指標(biāo)偏移誤差 指輸入信號(hào)為零時(shí)，輸出信號(hào)不為零的值，所以有時(shí)又稱為零值誤差。滿刻度誤差 滿刻度誤差又稱為增益誤差。指滿刻度輸出數(shù)碼所對(duì)應(yīng)的實(shí)際輸入電壓與理想輸入電壓之差。線性度 線性度有時(shí)又稱為非線性度，指轉(zhuǎn)換器實(shí)際的轉(zhuǎn)換特性與理想直線的最大偏差。A/D轉(zhuǎn)換器的主要技術(shù)指標(biāo)絕對(duì)精度 在一個(gè)轉(zhuǎn)換器中，任何數(shù)碼所對(duì)應(yīng)的實(shí)際模擬量輸入與理論模擬輸入之差的最大值，稱為絕對(duì)精度。對(duì)于ADC而言，可以在每一個(gè)階梯的水平中點(diǎn)進(jìn)行測(cè)量，它包括了所有的誤差。轉(zhuǎn)換速率 指ADC能夠重復(fù)進(jìn)行數(shù)據(jù)轉(zhuǎn)換的速度，即每秒轉(zhuǎn)換的次數(shù)。而完成一次A/D轉(zhuǎn)換所需的時(shí)間（包括穩(wěn)定時(shí)間），則是轉(zhuǎn)換速率的倒數(shù)。
標(biāo)簽： 單片機(jī) 應(yīng)用接口
上傳時(shí)間： 2013-11-25
上傳用戶：banlangen
相比經(jīng)典譜估計(jì)方法,文中所提方法在距離測(cè)量過程中避免了繁重的矩陣運(yùn)算,僅通過迭代運(yùn)算即可實(shí)現(xiàn)精確測(cè)量。由于該方法實(shí)現(xiàn)簡(jiǎn)單,僅為現(xiàn)有傅里葉變換的擴(kuò)展,在車載系統(tǒng)中將會(huì)獲得實(shí)時(shí)處理的效果,文末的仿真實(shí)驗(yàn)驗(yàn)證了該方法的有效性和實(shí)用性。
上傳時(shí)間： 2013-11-22
上傳用戶：xg262122
對(duì)回波信號(hào)進(jìn)行一維成像處理，以距離像幅度作為單脈沖測(cè)角幅度，利用單脈沖測(cè)角方法得到目標(biāo)在各個(gè)距離單元內(nèi)的角度信息，通過加權(quán)平均處理，得到目標(biāo)幾何中心空間角度。仿真結(jié)果表明，該方法可以抑制角閃爍偏差，提高導(dǎo)引頭角跟蹤精度。
標(biāo)簽： 高分辨雷達(dá)
上傳時(shí)間： 2013-10-28
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陣列信號(hào)處理中的DOA估計(jì)技術(shù)研究,穩(wěn)健的參數(shù)估計(jì)技術(shù)是現(xiàn)代信號(hào)處理的重要研究領(lǐng)域。采用陣列信號(hào)處高分辨新體制電子衛(wèi)星的關(guān)鍵環(huán)節(jié)。
標(biāo)簽： DOA 陣列信號(hào)處理 技術(shù)研究
上傳時(shí)間： 2013-10-17
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