任意波形發生器已成為現代測試領域應用最為廣泛的通用儀器之一，代表了信號源的發展方向。直接數字頻率合成(DDS)是二十世紀七十年代初提出的一種全數字的頻率合成技術，其查表合成波形的方法可以滿足產生任意波形的要求。由于現場可編程門陣列(FPGA)具有高集成度、高速度、可實現大容量存儲器功能的特性，能有效地實現DDS技術，極大的提高函數發生器的性能，降低生產成本。 本文首先介紹了函數波形發生器的研究背景和DDS的理論。然后詳盡地敘述了用FPGA完成DDS模塊的設計過程，接著分析了整個設計中應處理的問題，根據設計原理就功能上進行了劃分，將整個儀器功能劃分為控制模塊、外圍硬件、FPGA器件三個部分來實現。最后就這三個部分分別詳細地進行了闡述。 在實現過程中，本設計選用了Altera公司的EP2C35F672C6芯片作為產生波形數據的主芯片，充分利用了該芯片的超大集成性和快速性。在控制芯片上選用了三星公司的上S3C2440作為控制芯片。本設計中，FPGA芯片的設計和與控制芯片的接口設計是一個難點，本文利用Altera的設計工具QuartusⅡ并結合Verilog—HDL語言，采用硬件編程的方法很好地解決了這一問題。論文最后給出了系統的測量結果，并對誤差進行了一定分析，結果表明，可輸出步進為0.01Hz，頻率范圍0.01Hz～20MHz的正弦波、三角波、鋸齒波、方波，或0.01Hz～20KHz的任意波。通過實驗結果表明，本設計達到了預定的要求，并證明了采用軟硬件結合，利用FPGA技術實現任意波形發生器的方法是可行的。
上傳時間： 2013-08-03
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隨著科學技術的飛速發展，電子測量技術被廣泛應用在電子、機械、醫療、測控及航天等各個領域，而電子測量技術要用到各種形式的高質量信號源，因此任意波形發生器的研制就具有非常重要的現實意義。 本文便是基于DDS(DirectDigitalSynthesis)技術進行任意波形發生器研制的。要求可以產生正弦波、方波、三角波與鋸齒波等常規波形，而且能夠產生任意波形，從而滿足研究的需要。具體工作如下： (一)介紹國內外關于任意波形發生器研究的發展情況，闡述頻率合成技術的各種方式與技術對比情況，并選定直接數字頻率合成技術進行研制。 (二)介紹系統的硬件設計構成與功能實現，并對系統部件進行逐一細述。選用單片機作為控制模塊，使用FPGA實現DDS功能作為技術核心，并對外圍電路的設計與接口技術進行分析。 (三)講述DDS的工作原理、工作特點與技術指標，并基于FPGA芯片EP1C3T144C8進行設計，通過使用相位累加器與波形ROM等模塊，實現DDS功能。同時輔以使能模塊與行列式鍵盤，實現各種波形的靈活輸出。 (四)給出系統產生的測試數據，并對影響頻譜純度的雜散與噪聲產生的原因進行分析。
上傳時間： 2013-04-24
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由可編程器件控制的信號發生器可輸出正弦波、方波、鋸齒波，其頻率可調。能輸出正 弦波、方波、鋸齒波的組合波形，且組合波形的頻率可調。還能輸出占空比和頻率可調的方 波。
標簽： 信號發生器
上傳時間： 2013-05-28
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隨著國民經濟的發展和社會的進步，人們越來越需要便捷的交通工具，從而促進了汽車工業的發展，同時汽車發動機檢測維修等相關行業也發展起來。在汽車發動機檢測維修中，發動機電腦(Electronic Control．Unit-ECU)檢測維修是其中最關鍵的部分。發動機電腦根據發動機的曲軸或凸輪軸傳感器信號控制發動機的噴油、點火和排氣。所以，維修發動機電腦時，必須對其施加正確的信號。目前，許多發動機的曲軸和凸輪軸傳感器信號已不再是正弦波和方波等傳統信號，而是多種復雜波形信號。為了能夠提供這種信號，本文研究并設計了一種能夠產生復雜波形的低成本任意波形發生器(Arbitrary Waveform Generator-AWG)。 本文提出的任意波形發生器依據直接數字頻率合成(Direct Digial FrequencySynthesis-DDFS)原理，采用自行設計現場可編程門陣列(FPGA)的方案實現頻率合成，擴展數據存儲器存儲波形的量化幅值(波形數據)，在微控制單元(MCU)的控制與協調下輸出頻率和相位均可調的信號。 任意波形發生器主要由用戶控制界面、DDFS模塊、放大及濾波、微控制器系統和電源模塊五部分組成。在設計中采用FPGA芯片EPF10K10QC208-4實現DDFS的硬件算法。波形調整及濾波由兩級放大電路來完成：第一級對D/A輸出信號進行調整；第二級完成信號濾波及信號幅值和偏移量的調節。電源模塊利用三端集成穩壓器進行電壓值變換，利用極性轉換芯片ICL7660實現正負極性轉換。 該任意波形發生器與通用模擬信號源相比具有：輸出頻率誤差小，分辨率高，可產生任意波形，成本低，體積小，使用方便，工作穩定等優點，十分適合汽車維修行業使用，具有較好的市場前景。
上傳時間： 2013-05-28
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一位老工程師寫的關于FPGA方面的書，把多年從事FPGA設計的經驗寫入書中，讀完受益頗多
標簽： The_Design_Warrior_Guide_To_FPGA
上傳時間： 2013-06-03
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40kHZ 超聲波發射電路之一，由F1~F3 三門振蕩器在F3 的輸出為40kHZ 方波，工作頻率主要由C1、R1 和RP 決定，用RP 可調電阻來調節頻率。 F3 的輸出激勵換能器T40-1
上傳時間： 2013-07-28
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描述了將Linu移植到基于$3C2410處理器目標板上的方法與過程。介紹了目標平臺和Lin并說明了如何搭建移植環境，著重介紹了Bootlaoder的架構和功能以及unu內核的移植。結果證明該方
上傳時間： 2013-06-19
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本文分析了目前軟PLC 編輯器中功能塊編程的不足，提出了使用面向對象的概念來設計功能塊圖的方法。通過研究軟PLC 開發系統和編譯系統的模型，詳細討論了PLC 梯形圖中圖元的設計方法，并基于此方
上傳時間： 2013-06-21
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本文針對工業測試現場中方波頻率信號的高頻噪聲污染問題，選用LabVIEW 中提供的脈寬濾波、數據采集等功能模塊組建了虛擬計數濾波器，設計并實現了一種可靠、便捷的方波頻率信號的數字濾波。工程實踐
上傳時間： 2013-04-24
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本文以數字信號處理系統為應用背景，圍繞基于FPGA的ⅡR數字濾波器的實現技術展開了研究。 首先以ⅡR數字濾波器的優化設計基本理論為依據，研究了在頻域上的最小均方誤差設計法和在時域上的最小平方誤差設計法。以四階和六階兩個ⅡR低通數字濾波器設計為例，利用Matlab軟件進行輔助設計，探討了濾波器的設計過程。 然后著重研究了FPGA的設計方法和設計流程，在設計中采用了層次化、模塊化的設計思想，將整個濾波器劃分為多個功能模塊，利用VHDL語言編程和原理圖兩種設計技術進行了ⅡR濾波器的各個功能模塊的設計，采用EPlCl2Q240器件實現了基于FPGA的二個二階節級聯型結構的四階ⅡR低通數字濾波器，并類推了設計六階ⅡR低通數字濾波器。最后用QuartusⅡ4.0軟件進行了綜合與仿真，用MATLAB7.0軟件對仿真結果進行了分析，最終在GW48-PK2開發系統中進行了硬件電路驗證，得出了實際濾波效果測試波形，驗證了所設計濾波器的正確性。 本設計對于用二階節級聯型結構構成的ⅡR數字濾波器硬件電路具有通用性，通過改變二階節級聯型結構的數量，可以構成任意偶數階的濾波器；同時，通過上模型中系數的變換，也可以構成相應階數的高通、帶通、帶阻等濾波器。
上傳時間： 2013-06-20
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