MOS集成運(yùn)算放大器的版圖設(shè)計(jì) 集成電路設(shè)計(jì)綜合實(shí)驗(yàn)指導(dǎo)書
標(biāo)簽: MOS 集成運(yùn)算放大器 版圖設(shè)計(jì)
上傳時(shí)間: 2013-04-24
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單電源運(yùn)算放大器電路應(yīng)用圖集單電源運(yùn)算放大器電路應(yīng)用圖集
標(biāo)簽: 單電源 運(yùn)算放大器 電路應(yīng)用
上傳時(shí)間: 2013-06-15
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運(yùn)算放大器、比較器設(shè)計(jì)指南,運(yùn)算放大器、比較器設(shè)計(jì)指南
標(biāo)簽: 運(yùn)算放大器 比較器 設(shè)計(jì)指南
上傳時(shí)間: 2013-07-19
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數(shù)字D類音頻放大器,也叫數(shù)字脈沖調(diào)制放大器,具有效率高,低電壓,低失真的特點(diǎn),在低成本,高性能的消費(fèi)類產(chǎn)品特別是便攜式設(shè)備中得到越來越廣泛的應(yīng)用。數(shù)字D類放大器包括數(shù)字脈沖寬度調(diào)制(PWM)和輸出級(jí)(含低通濾波器)兩個(gè)部分,數(shù)字PWM又包括兩個(gè)部分,采樣處理和脈沖產(chǎn)生。傳統(tǒng)的采樣處理算法運(yùn)算復(fù)雜,硬件實(shí)現(xiàn)成本高,面積大,從而導(dǎo)致功耗也大,不適合當(dāng)今向低功耗發(fā)展的趨勢(shì)。 本文在傳統(tǒng)算法的基礎(chǔ)上提出了一種新的算法,該算法不包括乘法或者除法這些計(jì)算復(fù)雜和非常消耗硬件資源的單元,只含加法和減法運(yùn)算。在推導(dǎo)出該算法的傅立葉表達(dá)式后,在MATLAB的simulink中建立系統(tǒng)模型進(jìn)行仿真以驗(yàn)證算法的可行性,在輸入信號(hào)頻率為1kHZ,采樣頻率為48kHZ,電源電壓為10V,輸出負(fù)載為4Ω的條件下,得到的總諧波失真為0.12%,符合D類放大器的性能要求。本文還在基于Xilinx公司的Spartan-3系列FPGA的基礎(chǔ)上實(shí)現(xiàn)了該算法的電路結(jié)構(gòu),綜合結(jié)果表明,實(shí)現(xiàn)基于本文算法的數(shù)字D類音頻系統(tǒng)所需要的硬件資源大大減少,從而減少了功耗。 關(guān)鍵詞:D類放大器;脈沖寬度調(diào)制;采樣算法;數(shù)字音頻放大器;FPGA
標(biāo)簽: FPGA PWMD 音頻功率放大器
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主要介紹如何使用運(yùn)算放大器,既有理論,又有實(shí)踐電路
標(biāo)簽: 運(yùn)算放大器
上傳時(shí)間: 2013-07-25
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運(yùn)算放大器是一種應(yīng)用非常廣泛的器件,如何調(diào)整運(yùn)算放大器的反饋環(huán),以及如何面對(duì)各種不同特性的負(fù)載等等,是我們必須面對(duì)的一個(gè)問題。相信你讀完本文你會(huì)有所斬獲。
上傳時(shí)間: 2013-05-26
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帶有負(fù)反饋的光電耦合線性放大器,含原理圖,PCB及multisim仿真
標(biāo)簽: 光電耦合 線性放大器
上傳時(shí)間: 2013-06-23
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射頻低噪聲放大器的ADS設(shè)計(jì):本文首先簡(jiǎn)要介紹了低噪聲放大器設(shè)計(jì)的理論基礎(chǔ),并以2.1-2.4Ghz 低噪聲放大器為例,詳細(xì)闡述了如何利用Agilent 公司的ADS 軟件進(jìn)行分析和優(yōu)化設(shè)計(jì)該電
標(biāo)簽: ADS 射頻 低噪聲放大器
上傳時(shí)間: 2013-06-18
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放大器及數(shù)據(jù)轉(zhuǎn)換器選擇指南
標(biāo)簽: 放大器 數(shù)據(jù)轉(zhuǎn)換器 選擇指南
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寬帶放大器:本設(shè)計(jì)利用可變?cè)鲆鎸拵Х糯笃鰽D603 來提高增益和擴(kuò)大AGC 控制范圍,通過軟件補(bǔ)償減小增益調(diào)節(jié)的步進(jìn)間隔和提高準(zhǔn)確度。輸入部分采用高速電壓反饋型運(yùn)放OPA642作跟隨器提高輸入阻抗,并
標(biāo)簽: 寬帶放大器
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