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半導體器件

  • 可重構24bit音頻過采樣DAC的FPGA

    基于過采樣和∑-△噪聲整形技術的DAC能夠可靠地把數字信號轉換為高精度的模擬信號(大于等于16位)。采用這一架構進行數模轉換具有諸多優點,例如極低的失配噪聲和更高的可靠性,便于實現嵌入式集成等,最重要的是可以得到其他DAC結構所無法達到的精度和動態范圍。在高精度測量,音頻轉換,汽車電子等領域有著廣泛的應用價值。 本文采用∑-△結構以FPGA方式實現了一個具有高精度的數模轉換器,在24比特的輸入信號下,達到了約150dB的信噪比。作為一個靈活的音頻DAC實現方案。該DAC可以對CD/DVD/HDCD/SACD等多種制式下的音頻信號進行處理,接受并轉換采樣率為32/44.1/48/88.2/96/192kHz,字長為16/18/20/24比特的PCM數據,具備良好的兼容性和通用性。 由于非線性和不穩定性的存在,高階∑-△調制器的設計與實現存在較大的難度。本文綜合大量文獻中的經驗原則和方法,闡述了穩定的高階高精度調制器的設計流程;并據此設計了達到24bit精度和滿量程輸入范圍的的5階128倍調制器。本文創新性地提出了∑-△調制器的一種高效率流水線實現結構。分析表明,與其他常見的∑-△調制器實現結構相比,本方案具有結構簡單、運算單元少等優點;此外在同樣信號采樣率下,調制器所需的時鐘頻率大大降低。 文中的過采樣濾波模塊采用三級半帶濾波器和一個可變CIC濾波器級聯組成,可以達到最高128倍的過采樣比,同時具有良好的通帶和阻帶特性。在半帶濾波器的設計中采用了CSD編碼,使結構得到了充分的簡化。 本文提出的過采樣DAC方案具有可重配置結構,讓使用者能夠方便地控制過采樣比和調制器階數。通過積分梳狀濾波器的配置,能夠獲得32/64/128倍的不同過采樣比,從而實現對于32~192kHz多種采樣率輸入的處理。在不同輸入字長情況下,通過調制器的重構,則可以將調制器由高精度的5階模式改變為功耗更低的3階模式,滿足不同分辨率信號輸入時的不同精度要求。這是本文的另一創新之處。 目前,該過采樣DAC已經在XilinxVirtexⅡ系列FPGA器件下得到硬件實現和驗證。測試表明,對于從32kHz到192kHz的不同輸入信號,該DAC模塊輸出1比特碼流的帶內信噪比均能滿足24比特數據轉換應用的分辨率要求。

    標簽: FPGA bit DAC 24

    上傳時間: 2013-07-08

    上傳用戶:從此走出陰霾

  • 有線數字電視廣播系統信道編碼

    隨著數字電視全國范圍丌播時間表的臨近,數字電視技術得到很大發展,數字電視信號在信源基帶數據和信道傳輸等方面已經進一步標準化,數字電視傳播途徑也越來越廣,在衛星、地面及有線電視網中傳輸數字電視信號得到迅速發展。借著2008年奧運的東風,數字電視領域的應用研究方興未艾。 本課題目的是完成有線數字電視廣播系統的重要設備--調制器的設計和實現,核心器件選用FPGA芯片。系統硬件實現以國家標準GY/T 170-2001(有線數字電視廣播信道編碼與調制規范)為主要依據,以Xilinx公司的Virtex系列(Virtex 4,Virtex 5)芯片及相關開發板(ML402、ML506)為平臺,主要任務是基于相關標準對其實用技術進行研究和開發。完成了信道編碼和調制的模塊劃分、Verilog HLD程序的編寫(或IP核的調用)和仿真以及在板調試和聯調等工作,設計目的是在提高整個系統集成度的前提下實現多頻點調制。 本文在研究現有數字電視網絡技術和相關產品的基礎上,以國標GY/T170-2001為主要依據并參閱了其他的相關標準,提出了多頻點QAM調制器的實現方案。整個工作包括:模塊劃分,完成了基帶物理接口(輸入)、包頭反轉與隨機化、RS編碼、卷積交織、碼流變換、差分編碼、星座映射、基帶成型(包括Nyquist濾波器、半帶濾波器、CIC濾波器的設計或模塊調用)、高端DAC的配置(輸出)等模塊的Verilog HLD程序的編寫(或者IP核調用)和仿真等工作;成功進行了開發板板級調試,調試的過程中充分利用Xilinx公司的開發板和調試軟件ChipScope,成功設計了驗證方案并進行了模塊驗證;最后進行了各模塊聯調工作,設計了系統驗證方案并成功完成對整個系統的驗證工作。 經測試表明,該系統主要性能達到國家相關標準GY/T 198-2003(有線數字電視廣播QAM調制器技術要求和測量方法)規定的技術指標,可以進入樣機試生產環節。

    標簽: 有線數字電視 廣播系統 信道編碼

    上傳時間: 2013-04-24

    上傳用戶:jiangfire

  • 基于DSPFPGA的捷聯慣性導航系統設計

    在慣性導航系統中,捷聯式慣性導航系統以其體積小、成本低和可靠性高等優點正逐步取代平臺式慣性導航系統,成為慣性導航系統的發展趨勢。    為了適應捷聯慣性導航系統小型化、低成本和高性能的發展方向,本文設計了DSP與FPGA相結合的系統方案:系統采用MEMS器件和高性能A/D轉換器構成慣性信號檢測單元,FPGA進行I/O控制,DSP完成導航計算。方案綜合考慮了系統成本、計算速度、精度、體積等各方面的因素,并通過GPS、磁航向計等信息融合進一步提高導航精度。    數據采集是捷聯慣導系統設計的關鍵,本文數據采集由信號調理、A/D轉換和。FPGA等幾部分組成。其中,FPGA是整個數據采集部分的核心,其主要功能包括:實現了ADC控制邏輯和時序生成;配置了FIFO寄存器,緩沖了ADC與DSP之間的轉換數據;擴展了UART串口,以實現系統的外部信息接口。在完成電路設計的基礎上,對各功能模塊進行了全面的半實物仿真,驗證了系統方案及各主要功能模塊的可行性。    論文簡述了慣性導航系統的應用背景及發展狀況,介紹了捷聯慣導系統的基本原理,設計了基于DSP/FPGA的捷聯慣導系統方案,實現了系統各部分硬件電路以及FPGA功能模塊,并通過搭建硬件驗證平臺和利用第三方仿真軟件,對傳感器的性能以及FPGA各功能模塊進行了較全面的驗證和仿真。結果表明:基于DSP/FPGA的捷聯慣導系統能夠滿足應用的要求,并在小型化、低成本和高性能等方面有一定的優勢。

    標簽: DSPFPGA 捷聯 慣性導航 系統設計

    上傳時間: 2013-04-24

    上傳用戶:1966640071

  • 單片機外圍器件實用手冊存儲器分冊

    ·單片機外圍器件實用手冊存儲器分冊

    標簽: 單片機 外圍器件 實用手冊

    上傳時間: 2013-04-24

    上傳用戶:xiehao13

  • 用DSP器件實現Modbus協議與GP觸摸屏通訊

    ·摘要:  本文提出了在DSP器件上實現Modbus協議,并在此基礎上與GP觸摸屏通訊.這不僅擴展了GP觸摸屏可連接器件的范圍,而且對開發者采用GP觸摸屏作為帶串口的智能設備的上位機和人機界面(HMI)提供了參考.  

    標簽: Modbus DSP 器件 協議

    上傳時間: 2013-06-26

    上傳用戶:Ruzzcoy

  • ALTERA器件選型手冊-中文

    Altera大部分主流的器件選型手冊,包括編程芯片、數據線、開發板的介紹等。

    標簽: ALTERA 器件選型

    上傳時間: 2013-07-23

    上傳用戶:ommshaggar

  • TI器件命名規則

    方便用戶查詢TI器件,縮短方案選擇周期,加快開發速度

    標簽: 器件 命名規則

    上傳時間: 2013-08-03

    上傳用戶:tb_6877751

  • 單片機外圍器件實用手冊電源器件分冊

    ·單片機外圍器件實用手冊電源器件分冊

    標簽: 單片機 外圍器件 實用手冊

    上傳時間: 2013-05-23

    上傳用戶:小火車啦啦啦

  • 單片機外圍器件實用手冊輸入通道器件分冊

    ·單片機外圍器件實用手冊輸入通道器件分冊

    標簽: 單片機 外圍器件 器件

    上傳時間: 2013-04-24

    上傳用戶:wmwai1314

  • protues 7.0器件庫名大全

    protues 7.0器件庫名大全幫組你更好的搜索到你做需要的器件

    標簽: protues 7.0 器件

    上傳時間: 2013-05-20

    上傳用戶:小小小熊

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