在慣性導航系統中，捷聯式慣性導航系統以其體積小、成本低和可靠性高等優點正逐步取代平臺式慣性導航系統，成為慣性導航系統的發展趨勢。 為了適應捷聯慣性導航系統小型化、低成本和高性能的發展方向，本文設計了DSP與FPGA相結合的系統方案：系統采用MEMS器件和高性能A/D轉換器構成慣性信號檢測單元，FPGA進行I/O控制，DSP完成導航計算。方案綜合考慮了系統成本、計算速度、精度、體積等各方面的因素，并通過GPS、磁航向計等信息融合進一步提高導航精度。 數據采集是捷聯慣導系統設計的關鍵，本文數據采集由信號調理、A/D轉換和。FPGA等幾部分組成。其中，FPGA是整個數據采集部分的核心，其主要功能包括：實現了ADC控制邏輯和時序生成；配置了FIFO寄存器，緩沖了ADC與DSP之間的轉換數據；擴展了UART串口，以實現系統的外部信息接口。在完成電路設計的基礎上，對各功能模塊進行了全面的半實物仿真，驗證了系統方案及各主要功能模塊的可行性。 論文簡述了慣性導航系統的應用背景及發展狀況，介紹了捷聯慣導系統的基本原理，設計了基于DSP/FPGA的捷聯慣導系統方案，實現了系統各部分硬件電路以及FPGA功能模塊，并通過搭建硬件驗證平臺和利用第三方仿真軟件，對傳感器的性能以及FPGA各功能模塊進行了較全面的驗證和仿真。結果表明：基于DSP/FPGA的捷聯慣導系統能夠滿足應用的要求，并在小型化、低成本和高性能等方面有一定的優勢。
標簽： DSPFPGA 捷聯 慣性導航 系統設計
上傳時間： 2013-04-24
上傳用戶：1966640071
多抽樣率信號處理是現代信號處理理論的一個重要分支，在最近十幾年取得了巨大的發展，并在很多方面得到了成功的應用。本文分別從時域和頻域的角度深入分析了抽樣率變換的規律，并進一步研究了多抽樣率系統的高效實現理論和方案。多抽樣率系統需要通過濾波器來改善其性能。本文分析了一般濾波器設計的方法與理論，著重研究了積分梳狀濾波器和半帶濾波器這兩種多抽樣率濾波器，并根據多抽樣率信號處理的特點以及幾種高效濾波結構和濾波器，利用積分梳狀濾波器和半帶濾波器在FPGA上設計了2～256倍可編程抽取器。為了進一步分析多相結構在多抽樣率信號處理中的應用，使用多相結構設計了具有固定倍數的內插器。在論文的最后，詳細介紹了某型號雷達信號處理機的硬件設計及其FPGA設計。關鍵字：多抽樣率信號處理 抽取 內插 多相濾波 積分梳狀濾波器 半帶濾波器
標簽： FPGA 抽樣 數字信號處理
上傳時間： 2013-06-12
上傳用戶：fxf126@126.com
· 摘要： 以四相8/6極、5.5KW開關磁阻電動機(SRM)為研究對象,設計了一種結構簡單、性能可靠的開關磁阻電機調速(SRD)系統.該系統采用TMS320F240為主控單元,詳細介紹了功率電路和控制器的結構組成和工作原理,采用了改進型的不對稱半橋結構的功率變換器,并針對EXB841的不足之處加以改進.實驗表明此系統不僅結構簡單,而且運行效果良好.
標簽： 320F F240 TMS 320
上傳用戶：離殤
·CCS是TI開發的一個完整的DSP集成開發環境，也是目前使用得最為廣泛的DSP開發軟件之一。 本書詳細地介紹了CCS中各種開發工具的使用，特別是對DSP／BIOS的應用做了較為詳細的介紹。本書前半部分從CCS的基本使用開始，由淺入深地闡述了使用CCS開發環境完成DSP項目的建立、編輯、編譯并最終完成調試的過程；接著，對DSP／BIOS的應用做了詳細說明；本書的最后部分介紹了片級支持庫(CSL)的使
標簽： DSP BIOS CCS 集成開發環境
上傳時間： 2013-07-09
上傳用戶：zhichenglu
安捷倫六位半數字表自動化編程必備參考文檔
標簽： 34410A 安捷倫 程序員
上傳時間： 2013-08-02
上傳用戶：ccsdebug
· 摘要： 提出并設計了一種新型音頻功率放大器.該系統通過高速采樣,多采樣率的插值運算,半帶低通濾波以及∑-△調制,將音頻PCM信號轉換成二進制序列,經過高速開關管還原出具有原始功率譜的功率信號.該功率放大器具有D類數字功放高效率特點的同時,能夠保證高保真的還原性,并且具有進一步提升信噪比的空間.
標簽： DSP 數字音頻 功率放大器
上傳時間： 2013-05-28
上傳用戶：assss
對講4811DATASHEET,BK4811是一款半雙工FM語音收發芯片，集成完整的射頻和基帶功能，附加一塊簡單的MCU就能夠實現個人雙向語音通信系統。內置模擬和數字信令、低速率數據通信以及語音加密，使得芯片適用于從玩具、個人通信到集群通信的各種應用
標簽： 4811 BK
上傳時間： 2013-06-05
上傳用戶：dongbaobao
ICL7107是三位半LCD，LED顯示AD轉換器
標簽： 7107 ICL
上傳用戶：chengli008
針對嵌入式系統的底層網絡接口給出了一種由FPGA實現的以太網控制器的設計方法．該控制器能支持10Mbps和100Mbps的傳輸速率以及半雙工和全雙工模式，同時可提供MII接口，可并通過外接以太網物理層（PHY）芯片來實現網絡接入\r\n
標簽： FPGA 嵌入式系統 以太網控制器 底層
上傳時間： 2013-08-18
上傳用戶：青春給了作業95
fpga cpld 常見模塊設計，包括基于fpga 的全數字鎖向環，基于fpga cpld 的半整數分頻器的設計等，很有用
標簽： fpga cpld 模塊設計
上傳時間： 2013-08-30
上傳用戶：mhp0114
蟲蟲下載站版權所有 京ICP備2021023401號-1
