可編程系統(tǒng)級芯片提供了最大設(shè)計的靈活性 極端靈活且完全可編程的混合信號SOC 的基本原理是促使賽普拉斯微系統(tǒng)公司（Cypress MicroSystems）推出名為PSoCTM（Programmable System-On-ChipTM，可編程系統(tǒng)級芯片）的全新一代器件的動力所在。
標(biāo)簽： 可編程 系統(tǒng)級芯片
上傳時間： 2013-10-22
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EDA技術(shù)課程設(shè)計：可控計數(shù)器的設(shè)計 設(shè)計要求：1.設(shè)計一個五進制計數(shù)器，由兩個控制鍵sel控制不同的計數(shù)方式；2.當(dāng)sel=00時，按0、1、2、3、4、0、1、2、3、4......順序計數(shù)；3.當(dāng)sel=01時，按0、2、4、6、8、0、2、4、6、8......順序計數(shù)4.當(dāng)sel=10時，按1、3、5、7、9、1、3、5、7、9......順序計數(shù)5.當(dāng)sel=11時，按5、4、3、2、1、5、4、3、2、1......順序計數(shù)6.由數(shù)碼管分別譯碼顯示控制信號和計數(shù)狀態(tài)，分別用3位數(shù)碼管動態(tài)顯示；7.給出VHDL設(shè)計的源程序。
上傳時間： 2013-12-16
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可編程計數(shù)器陳列PCA原理及應(yīng)用設(shè)計P89C51Rx2的可編程計數(shù)器陳列是由5個相同的、以計數(shù)器為主的模塊組成。每個模塊除為主的計數(shù)器外，還輔之以比較器/沿捕捉器。
標(biāo)簽： PCA 可編程計數(shù)器 應(yīng)用設(shè)計
上傳時間： 2013-10-12
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介招用AT8 9 c5 單片機構(gòu)成微型可鳊程控制器PLc的設(shè)計思路一系統(tǒng)硬件配置和軟件設(shè)計方法，最后給出此微型可鳊程控制器在水塔水位控制中應(yīng)用的實例。
上傳時間： 2013-11-19
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本文介紹了基于SRAM 查找表的現(xiàn)場可重配置FPGA 的結(jié)構(gòu)和原理，及其配置方法，通過對多種配置方法的比較，提出了由單片機和EPROM 存儲器組成的串行配置方式。這種方式結(jié)構(gòu)簡單，設(shè)計保密性好，易于升級，降低設(shè)計成本。在大規(guī)模可編程邏輯器件出現(xiàn)以前，把器件焊接在電路板上是設(shè)計數(shù)字系統(tǒng)的最后一步。當(dāng)設(shè)計存在問題并解決后，設(shè)計者往往不得不重新設(shè)計印制電路板。設(shè)計周期長，設(shè)計效率低。CPLD 、FPGA 出現(xiàn)后，利用其在系統(tǒng)可編程或可重配置功能，設(shè)計者可以在進行邏輯設(shè)計而未進行電路設(shè)計時就把CPLD、FPGA 焊接在電路板上，然后在設(shè)計調(diào)試時可一次次隨心所欲的改變電路的硬件邏輯關(guān)系，而不用改變電路板的結(jié)構(gòu)。
標(biāo)簽： 單片機 現(xiàn)場可編程門陣列
上傳時間： 2013-10-29
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這一顆，我們學(xué)習(xí)如何讓跑馬燈自動按照我們預(yù)定的順序進行。這種控制在工控場合經(jīng)常用到。這個程序里，我們預(yù)先定義了一個變化的順序speedcode，每跑一圈燈就根據(jù)預(yù)定設(shè)置的表格數(shù)據(jù)來決定下一圈的跑馬速度。這樣我們就實現(xiàn)了按照預(yù)定的順序自動變化運行。請看代碼：-----------------------------------#define uchar unsigned char //定義一下方便使用#define uint unsigned int#define ulong unsigned long#include <reg52.h> //包括一個52 標(biāo)準(zhǔn)內(nèi)核的頭文件sbit P10 = P1^0; //頭文件中沒有定義的IO 就要自己來定義了sbit P11 = P1^1;sbit P12 = P1^2;sbit P13 = P1^3;bit ldelay=0; //長定時溢出標(biāo)記,預(yù)置是0uchar speed=10; //設(shè)置一個變量保存跑馬燈的移動速度uchar code speedcode[10]={3,1,5,12,3,20,2,10,1,4}; //10 個預(yù)定義的速度char code dx516[3] _at_ 0x003b;//這是為了仿真設(shè)置的//可編程自動控制跑馬燈void main(void) // 主程序{uchar code ledp[4]={0xfe,0xfd,0xfb,0xf7};//預(yù)定的寫入P1 的值uchar ledi; //用來指示顯示順序uchar i;RCAP2H =0x10; //賦T2 的預(yù)置值0x1000，溢出30 次就是1 秒鐘RCAP2L =0x00;TR2=1; //啟動定時器ET2=1; //打開定時器2 中斷EA=1; //打開總中斷
上傳時間： 2013-11-20
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82C59A-2是為簡化微處理機系統(tǒng)中斷接口而實現(xiàn)的LSI外圍芯片。也叫做PIC（Programmable Interrupt Controller）。是高性能高速度芯片。在多級優(yōu)先級中斷系統(tǒng)內(nèi)82C59A-1402已經(jīng)把CPU從對任務(wù)的輪詢中解救出來。PCI可由軟件進行控制，使用于各種不同的環(huán)境，聯(lián)級可接受8~64個中斷輸入。 管腳與NMOS8259A-2兼容單片8級優(yōu)先級，級聯(lián)可擴64級多種可編程中斷方式各自專用的請求屏蔽能力與Intel系列機兼容全部采用靜態(tài)設(shè)計低功耗5V的電源供電。
上傳時間： 2013-10-30
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高性能可編程DMA控制接口82C37A-54.1 概述對象實體：直接存儲器訪問（DMA）控制接口芯片82C37A-5芯片的特點：1、管腳引線與NMOS 8237A-5兼容。2、允許/禁止單獨DMA請求控制。3、頻率從0~5MHz區(qū)間全靜態(tài)設(shè)計。4、低電平操作。 5、4個各自獨立的DMA通道并獨立的進行初始化。6、存儲器到存儲器之間傳送。7、存儲器模塊初始化處理。8、地址的增量和減量。9、傳送速率可達1.6MB/s.10、可直接擴展成任意數(shù)量的通道。11 、終止傳送的過程即輸入結(jié)束。12、軟件請求。13、獨立信號DREQ和信號DACK的極性控制。4.2 82C37A-5的體系結(jié)構(gòu)4.2.1 基本結(jié)構(gòu)描述1. 82C37A-5內(nèi)部配備了規(guī)模為344位的內(nèi)部存儲器，它是以寄存器的形式出現(xiàn)的。2. 配有3個基本的控制模塊： （1）定時及控制模塊； （2）優(yōu)先級編碼及循環(huán)優(yōu)先級控制模塊；（3）命令控制模塊； 3. 12個不同類型的寄存器 。圖 4-1 82C37A-5結(jié)構(gòu)圖EOP# A0~A3RESETCS#. IOW# DREQ0~DREQ3HLDAHRQ DB0~DB7DACK0~DACK3
上傳時間： 2013-10-21
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82C54是專為Intel系列微處理機而設(shè)計的一種可編程時間間隔定時器/計數(shù)器，它是一種通用芯片，在系統(tǒng)軟件中可以把多級定時元素當(dāng)成輸入/輸出端口中的一個陣列看待。1. 與所有Intel系列兼容2. 操作速度高，與8MHz的8086、80186一起可實現(xiàn)“零等待狀態(tài)”的操作。3. 可處理從直流到10M頻率的輸入。4. 適應(yīng)性強5. 三個獨立的16位計數(shù)器6. 低功耗的CHMOS7. 與TTL完全兼容8. 6 種可編程的計數(shù)模式9. 以二進制或BCD計數(shù)10. 狀態(tài)讀返回命令
標(biāo)簽： CHMOS 82C54 可編程 時間間隔
上傳時間： 2013-11-16
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82C55A是高性能，工業(yè)標(biāo)準(zhǔn)，并行I/O的LSI外圍芯片；提供24條I/O腳線。 在三種主要的操作方式下分組進行程序設(shè)計82C88A的幾個特點：(1)與所有Intel系列微處理器兼容；(2)有較高的操作速度；(3)24條可編程I/O腳線；(4)底功耗的CHMOS；(5)與TTL兼容；(6)擁有控制字讀回功能；（7）擁有直接置位/復(fù)位功能；（8）在所有I/O輸出端口有2.5mA DC驅(qū)動能力；（9）適應(yīng)性強。方式0操作稱為簡單I/O操作，是指端口的信號線可工作在電平敏感輸入方式或鎖存輸出。所以，須將控制寄存器設(shè)計為：控制寄存器中:D7=1; D6 D5=00; D2=0。D7位為1代表一個有效的方式。通過對D4 D3 D1和D0的置位/復(fù)位來實現(xiàn)端口A及端口B是輸入或輸出。P56表2-1列出了操作方式0端口管腳功能。
上傳時間： 2013-10-26
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