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可重構(gòu)密碼芯片

SATA2.0硬盤加解密接口芯片數(shù)據(jù)通路的設(shè)計與FPGA實現(xiàn).rar

SATA接口是新一代的硬盤串行接口標(biāo)準(zhǔn)，和以往的并行硬盤接口比較它具有支持熱插拔、傳輸速率快、執(zhí)行效率高的明顯優(yōu)勢。SATA2．0是SATA的第二代標(biāo)準(zhǔn)，它規(guī)定在數(shù)據(jù)線上使用LVDS NRZ串行數(shù)據(jù)流傳輸數(shù)據(jù)，速率可達(dá)3Gb/s。另外，SATA2．0還具有支持NCQ（本地命令隊列）、端口復(fù)用器、交錯啟動等一系列技術(shù)特征。正是由于以上的種種技術(shù)優(yōu)點(diǎn)，SATA硬盤業(yè)已被廣泛的使用于各種企業(yè)級和個人用戶。硬盤作為主要的信息載體之一，其信息安全問題尤其引起人們的關(guān)注。由于在加密時需要實時處理大量的數(shù)據(jù)，所以對硬盤數(shù)據(jù)的加密主要使用帶有密鑰的硬件加密的方式。因此將硬盤加密和SATA接口結(jié)合起來進(jìn)行設(shè)計和研究，完成基于SATA2．0接口的加解密芯片系統(tǒng)設(shè)計具有重要的使用價值和研究價值。本論文首先介紹了SATA2．0的總線協(xié)議，其協(xié)議體系結(jié)構(gòu)包括物理層、鏈路層、傳輸層和命令層，并對系統(tǒng)設(shè)計中各個層次中涉及的關(guān)鍵問題進(jìn)行了闡述。其次，本論文對ATA協(xié)議和命令進(jìn)行了詳細(xì)的解釋和分析，并針對設(shè)計中涉及的命令和對其做出的修改進(jìn)行了說明。接著，本論文對SATA2．0加解密控制芯片的系統(tǒng)設(shè)計進(jìn)行了講解，包括硬件平臺搭建和器件選型、模塊和功能劃分、系統(tǒng)工作原理等，剖析了系統(tǒng)設(shè)計中的難點(diǎn)問題并給出解決問題的方法。然后，對系統(tǒng)數(shù)據(jù)通路的各個模塊的設(shè)計和實現(xiàn)進(jìn)行詳盡的闡述，并給出各個模塊的驗證結(jié)果。最后，本文簡要的介紹了驗證平臺搭建和測試環(huán)境、測試方法等問題，并分析測試結(jié)果。本SATA2．0硬盤加解密接口電路在Xilinx公司的Virtex5 XC5VLX50T FPGA上進(jìn)行測試，目前工作正常，性能良好，已經(jīng)達(dá)到項目性能指標(biāo)要求。本論文在SATA加解密控制芯片設(shè)計與實現(xiàn)方面的研究成果，具有通用性、可移植性，有一定的理論及經(jīng)濟(jì)價值。

標(biāo)簽： SATA FPGA 2.0

上傳時間： 2013-04-24

上傳用戶：JIUSHICHEN
MP3音頻解碼器的FPGA原型芯片設(shè)計與實現(xiàn).rar

MP3音樂是目前最為流行的音樂格式，因其音質(zhì)、復(fù)雜度與壓縮比的完美折中，占據(jù)著廣闊的市場，不僅在互聯(lián)網(wǎng)上廣為流傳，而且在便攜式設(shè)備領(lǐng)域深受人們喜愛。本文以MPEG-1的MP3音頻解碼器為研究對象，在實時性、面積等約束條件下，研究MP3解碼電路的設(shè)計方法，實現(xiàn)FPGA原型芯片，研究MP3原型芯片的驗證方法。論文的主要貢獻(xiàn)如下： (1)使用算法融合方法合并MP3解碼過程的相關(guān)步驟，以減少緩沖區(qū)存儲單元的容量和訪存次數(shù)。如把重排序步驟融合到反量化模塊，可以減少一半的讀寫RAM操作；把IMDCT模塊內(nèi)部的三個算法步驟融合在一起進(jìn)行設(shè)計，可以省去存儲中間計算結(jié)果的緩存區(qū)單元。 (2)反量化、立體聲處理等模塊中，采用流水線設(shè)計技術(shù)，設(shè)置寄存器把較長的組合邏輯路徑隔開，提高了電路的性能和可靠性；使用連續(xù)訪問公共緩存技術(shù)，合理規(guī)劃各計算子模塊的工作時序，將數(shù)據(jù)計算的時間隱藏在訪存過程中；充分利用頻率線的零值區(qū)特性，有效地減少數(shù)據(jù)計算量，加快了數(shù)據(jù)處理的速度。 (3)設(shè)計了MP3硬件解碼器的FPGA原型芯片。采用Verilog HDL硬件描述語言設(shè)計RTL級電路，完成功能仿真，以Altera公司Stratix II系列的EP2S180 FPGA開發(fā)板為平臺，實現(xiàn)MP3解碼器的FPGA原型芯片。MP3硬件解碼器在Stratix II EP2S180器件內(nèi)的資源利用率約為5％，其中組合邏輯查找表ALUT為7189個，寄存器共有4024個，系統(tǒng)頻率可達(dá)69.6MHz，充分滿足了MP3解碼過程的實時性要求。實驗結(jié)果表明，MP3音頻解碼FPGA原型芯片可正常播放聲音，解碼音質(zhì)良好。

標(biāo)簽： FPGA MP3 音頻解碼器

上傳時間： 2013-07-01

上傳用戶：xymbian
基于FPGA的計算機(jī)可編程外圍接口芯片的設(shè)計與實現(xiàn)

隨著電子技術(shù)和EDA技術(shù)的發(fā)展,大規(guī)模可編程邏輯器件PLD(Programmable Logic Device)、現(xiàn)場可編程門陣列FPGA(Field Programmable Gates Array)完全可以取代大規(guī)模集成電路芯片,實現(xiàn)計算機(jī)可編程接口芯片的功能,并可將若干接口電路的功能集成到一片PLD或FPGA中.基于大規(guī)模PLD或FPGA的計算機(jī)接口電路不僅具有集成度高、體積小和功耗低等優(yōu)點(diǎn),而且還具有獨(dú)特的用戶可編程能力,從而實現(xiàn)計算機(jī)系統(tǒng)的功能重構(gòu).該課題以Altera公司FPGA(FLEX10K)系列產(chǎn)品為載體,在MAX+PLUSⅡ開發(fā)環(huán)境下采用VHDL語言,設(shè)計并實現(xiàn)了計算機(jī)可編程并行接芯片8255的功能.設(shè)計采用VHDL的結(jié)構(gòu)描述風(fēng)格,依據(jù)芯片功能將系統(tǒng)劃分為內(nèi)核和外圍邏輯兩大模塊,其中內(nèi)核模塊又分為RORT A、RORT B、OROT C和Control模塊,每個底層模塊采用RTL(Registers Transfer Language)級描述,整體生成采用MAX+PLUSⅡ的圖形輸入法.通過波形仿真、下載芯片的測試,完成了計算機(jī)可編程并行接芯片8255的功能.

標(biāo)簽： FPGA 計算機(jī) 可編程外圍接口

上傳時間： 2013-06-08

上傳用戶：asddsd
可實現(xiàn)一鍵開關(guān)機(jī)的專用芯片

可實現(xiàn)一鍵開關(guān)機(jī)的專用芯片,上電復(fù)位，長按開機(jī)，長按關(guān)機(jī)

標(biāo)簽： 開關(guān)機(jī) 專用芯片

上傳時間： 2013-04-24

上傳用戶：llandlu
555芯片用于組成單穩(wěn)態(tài)觸發(fā)器、施密特觸發(fā)器以及多諧振蕩器

555芯片用于組成單穩(wěn)態(tài)觸發(fā)器、施密特觸發(fā)器以及多諧振蕩器。

標(biāo)簽： 555 芯片單穩(wěn)態(tài)觸發(fā)器施密特觸發(fā)器

上傳時間： 2013-10-19

上傳用戶：fredguo
在系統(tǒng)可編程電源管理芯片及其應(yīng)用

摘要:簡述了在系統(tǒng)可編程電源管理芯片ispPAC-POWER1208的結(jié)構(gòu)、功能和開發(fā)環(huán)境PAC-De2signer,給出了基于該器件的多電壓系統(tǒng)的電源管理應(yīng)用實例,并主要討論了電源時序管理和監(jiān)控的實現(xiàn),比較了對供電異常情況處理的兩種方法,同時簡要介紹了設(shè)計仿真。該器件可使多電壓供電系統(tǒng)的設(shè)計大為簡化,縮短開發(fā)時間。關(guān)鍵詞:可編程邏輯器件;電源管理;多電壓供電;時序

標(biāo)簽： 可編程電源管理芯片

上傳時間： 2013-12-29

上傳用戶：zyt
DM634 16通道LED恒流驅(qū)動芯片可編程PWM輸出

DM634 16通道LED恒流驅(qū)動芯片可編程PWM輸出

標(biāo)簽： 634 LED PWM DM

上傳時間： 2013-11-04

上傳用戶：llandlu
PSD3系列可編程單片機(jī)通用外圍接口芯片原理編程及應(yīng)用

內(nèi)容提要： SD3系列器件介紹可編程通用外圍芯片PSD301 可編程通用外圍芯PSD311等介紹。 1.1 簡介 1.1.1 引言 1.2.2 器件命名方式 1.1.3 PSD3系列器件簡介 1.1.4 PSD3系列器件性能簡介 1.1.5 支持PSD系列的WSI軟件 1.2 系統(tǒng)結(jié)構(gòu) 1.2.1 PSD3系列器件結(jié)構(gòu)和引腳說明 1.2.2 地址輸入 1.2.3 性能參數(shù) 1.2.4 微控制器/微處理器控制輸入 1.3 PSD3系列器件的操作方式 1.3.1多路復(fù)用8位地址/數(shù)據(jù)總線 1.3.2多路復(fù)用16位/數(shù)據(jù)總線 ............................ ............................

標(biāo)簽： PSD3 可編程單片機(jī) 外圍接口

上傳時間： 2013-10-22

上傳用戶：座山雕牛逼
QL310多功能識別主人電話遙控報警芯片用戶手冊

□基于來電顯示技術(shù)，識別主人，利用手機(jī)或固定電話實現(xiàn)免接通，免費(fèi)用的絕密遙控關(guān)及撤防。□單芯片多功能可編程設(shè)計，ＭＣＵ內(nèi)核，有著十分靈活廣泛的應(yīng)用（可定制特殊功能）。自動撥號的電話報警器方面：室內(nèi)手動延時布防，手機(jī)或固定電話免接通遙控撤防；撥號報警+現(xiàn)場報警（可選）。電話遙控開關(guān)方面：用于開啟電控門鎖，保險柜電控鎖，車庫電動門，電器開關(guān)...等。更多應(yīng)用......。□單芯片最多可存入6組電話號碼（6個主人）不重碼，最后一組號碼可刷新，掉電不丟失，可保100年。□非主人撥入無效，主人需20秒內(nèi)連續(xù)撥通兩次遙控才有效（撤防或開關(guān)），操縱成功后會自動回?fù)苓b控者電話一次，以表示遙控成功。絕不影響電話的正常使用。□循環(huán)撥打1-6組主人電話號碼報警15次，接聽報警時警聲提示，可同時選擇現(xiàn)場報警。無注冊用戶時，觸發(fā)報警將自動轉(zhuǎn)入連續(xù)現(xiàn)場報警１分鐘。□接警處理功能，接聽報警期間，手機(jī)或固定電話按"#"鍵退出報警。未接警的號碼繼續(xù)打報警。□僅設(shè)計兩按鈕實現(xiàn)用戶注冊、信息刪除、室那手動布防撤防、輸出開關(guān)控制、報警模式設(shè)定，報警期間無法手動撤防。□兩種反復(fù)可編程報警模式。掉電不丟失。模式1：報警完畢自動撤防；模式2：報警完畢保持布防。□兩種自適應(yīng)電路模式：DTMF解碼器接入模式和DTMF解碼器不接入模式。自動實現(xiàn)不同的電路設(shè)計實現(xiàn)不同的輸出控制功能。同一電路設(shè)計，通過增減硬部件即可實現(xiàn)不同的輸出功能，QL310上電時自動識別DTMF解碼器是否存在。□兩路警聲輸出：其中一路輸出用于操作音提示及報警時加載到電話線路中供監(jiān)聽用。另一路為現(xiàn)場報警使用（可根據(jù)需要選用，這路只有在報警時才有輸出，設(shè)計時可通過加大功率提高警聲）。□狀態(tài)記憶功能：布撤防狀態(tài)都有記憶功能（掉電不丟失）。可避免布撤防期間的偶然的停電再上電是狀態(tài)發(fā)生變化。比如，當(dāng)前為布防狀態(tài)，掉電再上電后還是保持布防狀態(tài)。□手動布撤防提示音，布撤防ＬＥＤ指示燈。□上電開機(jī)報警模式提示音，模式1發(fā)一聲提示音；模式2發(fā)兩聲提示音。□觸發(fā)端的信號智能檢測，因此可適應(yīng)任何觸發(fā)信號：或高電平，或低電平，或高/低脈沖信號；無源的開關(guān)信號，如繼電器，干簧管或門磁開關(guān)等（由于觸發(fā)端內(nèi)部有上拉電阻）。標(biāo)準(zhǔn)的ＴＴＬ電平，通過外接簡單的限幅電路可實現(xiàn)更高電平或脈沖的輸入（紅外探頭，防火探頭等）。特強(qiáng)抗干擾處理,長距離布線可抗強(qiáng)電磁干擾。□20腳PDIP封裝及20腳SOP封裝。□5V低功耗。使用3.5８M晶振。□工業(yè)級設(shè)計，工作溫度:-４０℃～+８５℃

標(biāo)簽： 310 QL 多功能識別

上傳時間： 2013-11-13

上傳用戶：lacsx
CHMOS可編程時間間隔定時器芯片82C54

82C54是專為Intel系列微處理機(jī)而設(shè)計的一種可編程時間間隔定時器/計數(shù)器，它是一種通用芯片，在系統(tǒng)軟件中可以把多級定時元素當(dāng)成輸入/輸出端口中的一個陣列看待。1. 與所有Intel系列兼容2. 操作速度高，與8MHz的8086、80186一起可實現(xiàn)“零等待狀態(tài)”的操作。3. 可處理從直流到10M頻率的輸入。4. 適應(yīng)性強(qiáng)5. 三個獨(dú)立的16位計數(shù)器6. 低功耗的CHMOS7. 與TTL完全兼容8. 6 種可編程的計數(shù)模式9. 以二進(jìn)制或BCD計數(shù)10. 狀態(tài)讀返回命令

標(biāo)簽： CHMOS 82C54 可編程時間間隔

上傳時間： 2013-11-16

上傳用戶：elinuxzj