ACTEL的FPGA完整開(kāi)發(fā)文擋 含測(cè)試源碼
標(biāo)簽: ACTEL FPGA 測(cè)試 源碼
上傳時(shí)間: 2013-08-16
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ACTEL A3P StartKit FPGA開(kāi)發(fā)全套文擋(含測(cè)試源碼)
標(biāo)簽: StartKit ACTEL FPGA A3P
上傳時(shí)間: 2013-08-28
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關(guān)于FPGA的一些常識(shí)及含IP核的VHDL設(shè)計(jì)源代碼。
標(biāo)簽: FPGA VHDL 常識(shí) IP核
上傳時(shí)間: 2013-09-03
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含穩(wěn)幅RC正弦波振蕩電路 multisim仿真
標(biāo)簽: multisim 穩(wěn)幅 RC正弦 振蕩電路
上傳時(shí)間: 2014-01-22
上傳用戶:zhoujunzhen
在非相參雷達(dá)測(cè)試系統(tǒng)中,頻率合成技術(shù)是其中的關(guān)鍵技術(shù).針對(duì)雷達(dá)測(cè)試系統(tǒng)的要求,介紹了一種用DDS激勵(lì)PLL的X波段頻率合成器的設(shè)計(jì)方案。文中給出了主要的硬件選擇及具體電路設(shè)計(jì),通過(guò)對(duì)該頻率合成器的相位噪聲和捕獲時(shí)間的分析,及對(duì)樣機(jī)性能的測(cè)試,結(jié)果表明該X波段頻率合成器帶寬為800 MHz、輸出相位噪聲優(yōu)于-80 dBc/Hz@10 kHz、頻率分辨率達(dá)0.1 MHz, 可滿足雷達(dá)測(cè)試系統(tǒng)系統(tǒng)的要求。測(cè)試表明,該頻率合成器能產(chǎn)生低相噪、高分辨率、高穩(wěn)定度的X波段信號(hào),具有較好的工程應(yīng)用價(jià)值。
標(biāo)簽: X波段 頻率合成器 設(shè)計(jì)方案
上傳時(shí)間: 2013-10-21
上傳用戶:pkkkkp
結(jié)合直接數(shù)字頻率合成(DDS)和鎖相環(huán)(PLL)技術(shù)完成了X波段低相噪本振跳頻源的設(shè)計(jì)。文章通過(guò)軟件仿真重點(diǎn)分析了本振跳頻源的低相噪設(shè)計(jì)方法,同時(shí)給出了主要的硬件選擇和詳細(xì)電路設(shè)計(jì)過(guò)程。最后對(duì)樣機(jī)的測(cè)試結(jié)果表明,本方案具有相位噪聲低、頻率控制靈活等優(yōu)點(diǎn),滿足了實(shí)際工程應(yīng)用。
標(biāo)簽: X波段 跳頻源
上傳時(shí)間: 2013-11-12
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X電容是指跨于L-N之間的電容器, Y電容是指跨于L-G/N-G之間的電容器。(L=Line, N=Neutral, G=Ground).
標(biāo)簽: 電容
上傳時(shí)間: 2014-12-23
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Altium.Designer.6(6.6含破解文件)安裝、升級(jí)總結(jié)
標(biāo)簽: Designer Altium Crack 6.6
上傳時(shí)間: 2013-11-17
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Allegro15[1].X培訓(xùn)教材
標(biāo)簽: Allegro 15 培訓(xùn)教材
上傳時(shí)間: 2013-10-22
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一款開(kāi)關(guān)電源設(shè)計(jì)筆記(含參數(shù)選取,設(shè)計(jì)原理圖)
標(biāo)簽: 開(kāi)關(guān)電源設(shè)計(jì) 參數(shù) 設(shè)計(jì)原理
上傳時(shí)間: 2013-10-16
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