基于Verilog-HDL的硬件電路的實現 9.5 脈沖周期的測量與顯示 9.5.1 脈沖周期的測量原理 9.5.2 周期計的工作原理 9.5.3 周期測量模塊的設計與實現 9.5.4 forever循環語句的使用方法 9.5.5 disable禁止語句的使用方法 9.5.6 時標信號發生模塊的設計與實現 9.5.7 周期計的Verilog-HDL描述 9.5.8 周期計的硬件實現 9.5.9 周期測量模塊的設計與實現之二 9.5.10 改進型周期計的Verilog-HDL描述 9.5.11 改進型周期計的硬件實現 9.5.12 兩種周期計的對比
標簽: Verilog-HDL 周期 9.5 脈沖
上傳時間: 2015-09-16
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應用VHDL、CPLD、EDA開發軟件設計數字系統,能夠顯著增強設計的靈活性,提高產品的性能,減輕設計的工作量,縮短設計周期。傳統的“固定功能集成塊+連線”的設計方法正逐步地縮小應用范圍,而基于芯片的設計方法正成為電子系統設計的主流。VHDL語言、CPLD/FPGA、EDA開發軟件已成為設計復雜數字電路系統的重要工具。
標簽: 開發軟件 減 周期 數字系統
上傳時間: 2014-12-08
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IEEE軟件生命周期過程管理標準 IEEE Standard for Information Technology - Software Life Cycle
標簽: IEEE Information Technology Standard
上傳時間: 2014-11-11
上傳用戶:xlcky
利用duffing振子檢測微弱信號頻率的matlab程序。可以檢測與周期策動力頻率相差0.03之內的微弱信號頻率。信噪比達到-68db
標簽: duffing matlab 0.03 頻率
上傳時間: 2013-12-31
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對周期排布的介質柱上鉆有小孔的結果進行平面波的分析
標簽: 周期 介質 分
上傳時間: 2015-09-22
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本設計以AT89C52為核心,充分利用AT89C52的三個定時/計時器,采用測量N個周期信號波形的算法.實現了頻率,周期高精度的測量.
標簽: 89C C52 AT 89
上傳時間: 2015-09-24
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頻率測量和周期測量的基本方法是采用以固定時鐘作為參考時鐘,分別測量單個周期的計數為周期,單位時間的計數為頻率。但是由于被測信號的頻率不同,測量精度會發生變化,采用低頻測量周期,高頻測量頻率,然后分別求倒數,便可得到對應的頻率和周期
標簽: 頻率測量 周期 測量 定時
上傳時間: 2013-12-23
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本人所傳是周期圖代碼,希望能夠對大家能有所幫助.
標簽: 周期 代碼 家
上傳時間: 2015-09-30
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自己編的周期圖法譜估計,對初學者有所幫助,內還有一本書可供參考
標簽: 周期 譜估計
上傳時間: 2014-01-19
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傅里葉變換和傅里葉變換的性質,周期信號和非周期信號的頻譜分析,卷積和卷積定理,抽樣信號的傅里葉變換和抽樣定理,相關、能量譜和功率譜.
標簽: 傅里葉變換 信號 抽樣 周期信號
上傳時間: 2014-01-01
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