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噪聲增益

  • 基于ARM和DSP的便攜式超聲波無損探傷儀的設計

    隨著超聲檢測理論逐漸成熟,以及現代集成電路的快速發展,超聲檢測技術以其快速、準確、無污染、低成本等特點,成為國內外應用廣泛、發展迅速、使用頻率最高的一種無損檢測技術。其中超聲儀器的發展水平直接影響著超聲檢測技術的發展。數字化、圖像化、小型化和實時化等是超聲檢測儀器的發展趨勢。傳統的超聲檢測系統中,PC機存在難以適應惡劣的工作環境,體積大,攜帶不方便,功耗大,數據傳輸率不高等問題,并且大部分便攜式超聲探傷儀缺乏對復雜數字信號處理算法的支持,因此開發與設計一種高性能、小型化的便攜式超聲探傷檢測系統尤為重要。 ARM的數字信號處理能力和DSP的系統控制能力都有其各自弱點,所以文中提出了一種基于ARM與DSP雙CPU方案的便攜式超聲探傷儀,充分利用了ARM與DSP的處理性能,接口簡單。ARM利用DSP的主機接口與DSP通信,不會打斷DSP的正常運行。本方案為復雜的信號處理算法提供硬件支持,可以有效的提高便攜式超聲探傷儀器的信號處理能力。 超聲探傷回波中的缺陷信號往往與系統的電噪聲、金屬組織噪聲混在一起,影響超聲檢測回波的信噪比。粗晶材料由于其微觀結構對超聲的強烈散射,造成嚴重的材料噪聲和信號衰減,致使超聲檢測靈敏度和信噪比嚴重下降。目前,對粗晶材料的檢測仍然是超聲檢測技術的一大難題。采用信號處理技術提高超聲檢測能力和信噪比是無損檢測領域的重要研究課題。本文在設計具備復雜信號處理能力的便攜式探傷儀的基礎上,進行了適合在便攜式儀器上實現的小波變換算法的研究,嘗試提高便攜式儀器對粗晶材料缺陷的檢測能力。

    標簽: ARM DSP 便攜式 儀的設計

    上傳時間: 2013-04-24

    上傳用戶:cuibaigao

  • LDPC碼編碼器FPGA實現研究

    LDPC(低密度奇偶校驗碼)編碼是提高通信質量和數據傳輸速率的關鍵技術。LDPC碼應用于實際通信系統是本課題的研究重點。實際通信要求在LDPC碼長盡量短、碼率盡量高及硬件可實現的前提下,結合連續相位MSK調制,滿足歸一化信噪比SNR=2dB時,系統誤碼率低于10-4。根據課題背景,本文主要研究基于FPGA的LDPC編碼器設計與實現。 LDPC碼的編碼復雜度往往與其幀長的平方成正比,編碼復雜度大,成為編碼硬件實現的一個障礙;論文針對實際系統的預期指標,通過對多種矩陣構造算法的預選方案及影響LDPC碼性能參數仿真分析,基于1/2碼率,1024和2048兩種幀長,設計了三種編碼器的備選方案,分別為直接下三角編碼器,串行準循環編碼器和二階準循環編碼器。 對于每種編碼器,分別設計了其整體結構,并對每種編碼器的功能模塊進行深入研究,設計完成后利用第3方軟件MODELSIM對編碼器進行了時序仿真;根據時序仿真結果和綜合報告對三種編碼方案進行比較,最終選擇串行準循環編碼器作為硬件實現的編碼方案。 最后,在FPGA中硬件實現了串行準循環編碼器并對其進行測試,利用MATLAB仿真程序和串口通信工具最終驗證了這種編碼器的正確性和硬件可實現性。

    標簽: LDPC FPGA 編碼器 實現研究

    上傳時間: 2013-08-02

    上傳用戶:林魚2016

  • TTC側音測距關鍵技術研究及FPGA實現

    航天測控通信網是航天工程的重要組成部分。迄今為止,我國已建成“C頻段測控網”,及正在建設的“S頻段測控網”和“TDRSS測控網”。測距單元是測控系統基帶設備中的重要功能單元,為航天飛行器提供定位元素。目前,在航天測距系統中側音測距技術具有最高的測距精度。本文以中國電子科技集團第十研究所某項目為背景,對側音測距系統中的關鍵技術進行了詳細的研究,提出了一些改進測距精度的方法,最后用FPGA實現了側音測距功能單元。 本論文主要完成以下工作: 1)完成了直接數字頻率合成的雜散分析。采用嚴格的信號分析方法,運用離散傅立葉變換(DFT)和傅立葉變換(FT),推導了理想狀態和相位截短條件下的DDS輸出頻譜的數學表達式,并利用systemview仿真軟件建立了DDS相位截短模型,通過仿真驗證了分析結論的正確性。 2)改進了TT&C系統中經典的FFT頻率引導算法,增加了頻譜對稱性分析,在實現頻率引導的同時完成了防載波頻率錯鎖的功能。 3)首次采用基于正交雙通道相關原理的數字相關相位估計法來實現次側音匹配和解模糊,降低了設備復雜度,提高了測距精度。針對低信噪比的情況,提出了基于平滑濾波的數據處理方法,提高了相位測量精度。對測距信道中加限幅器導致的測距信號信噪比惡化程度做了深入的理論分析。最后,分析了測距誤差,并對其中一些引起測距誤差的因素提出了改善方法。 通過本論文的工作,成功的完成了TT&C側音測距終端的研制,系統現已通過測試,達到系統任務書的各項指標要求。

    標簽: FPGA TTC 關鍵技術

    上傳時間: 2013-04-24

    上傳用戶:assss

  • WiMAX接收機中AGC的算法研究和FPGA實現

    用戶對寬帶無線接入業務、尤其是對于寬帶無線化以及移動化的需求日益增加,使無線寬帶接入技術WiMAX(World interoperability for Microwave Access,即全球微波接入互操作性技術)應運而生、迅猛發展,成為這兩年業界關注的焦點。除了通常的互聯網接入應用外,它還將在提供IPTV和VOIP等寬帶業務方面取得成功,它還有可能成為一種先進的4G蜂窩電話技術。WiMAX未來將進入蜂窩電話、筆記本電腦和機頂盒等應用中。 本文在介紹WiMAX傳輸標準802.16d基礎上,詳細闡述了WiMAX接收機中信道解調芯片中的自動增益控制(Automatic Gain Control,AGC)部分。首先介紹了自動增益控制系統的基本組成和其主要特性指標,通過對一個步進式AGC的分析,得到AGC模型的輸出公式。然后針對WiMAX接收機內AGC系統中的模數轉換器以及AGC電路進行介紹和理論分析。本文采用SPW(Signal Processing WorkSystem)模型對AGC電路基本結構的算法分析,并結合仿真結果對AGC電路做了詳盡解說并對參數進行了解釋說明。 最后給出了基于SPW和FPGA(Field Programmable Gate Array)驗證的結果。通過SPW對AGC進行了單獨的性能測試,并結合整個系統的性能測試來說明AGC可以和系統的其他模塊協同工作。在FPGA測試中,可以證明用Verilog實現后AGC也同樣能較好的工作。 本文實現的基于導頻的步進式的數字AGC是針對WiMAX系統的自動增益控制電路提出的解決方案。此算法結合WiMAX系統的傳輸方式,提出的算法具有迅速鎖定信號的特點,能夠滿足WiMAX系統的要求。同時,由于各種關鍵參數設計為寄存器可配的方式,具有很好的靈活性,也就具有了更高的移植性,可以作為一種通用的數字AGC算法。

    標簽: WiMAX FPGA AGC 接收

    上傳時間: 2013-04-24

    上傳用戶:zhanditian

  • 常模算法的FPGA實現

    常模信號是一類非常重要的信號,而專門應用于常模信號的常模算法[1]具有復雜度較低、實現起來比較簡單、對陣列模型的偏差不敏感等顯著的優點。因此,常模算法引起了眾多學者的廣泛關注。近年來,常模算法在多用戶檢測領域[2]的研究越來越受到諸多學者的關注。不僅如此,常模算法在其他領域也是備受矚目,如常模算法在盲均衡以及波束形成等領域的應用也是目前研究的熱點。除此之外,常模算法已經不僅僅局限在應用于常模信號,也可應用于多模信號[3]等。 本文對常模算法在多用戶檢測領域的應用以及FPGA[4]實現作了較多的研究工作,共分六章進行闡述。第一章為緒論,介紹了論文相關背景和本文的結構;第二章首先對常模算法作了理論分析,并改進了傳統的2-2型常模算法,我們稱之為M2-2CMA,它在誤碼率性能上有一些改善;之后在MATLAB平臺上搭建了仿真平臺,分析了常模算法在多用戶檢測中的應用;第三章研究了相關文獻,簡單介紹了FPGA概念及其設計流程和設計方法,并對VerilogHDL以及Quartus軟件做了簡要介紹;第四章則詳細介紹了常模算法的FPGA實現,用一種基于統計數據的方法確定了數據位長及精度,提出了其實現的系統框圖,并詳細闡述了各主要模塊的設計與實現,同時給出了最后的報告文件以及最高數據處理速度;第五章則在MATLAB平臺和QuartuslI的基礎上搭建了一個仿真平臺,借助于平臺分析了2-2型常模算法移植到FPGA平臺后的性能,對不同的精度對系統性能的影響做了討論,也統計了不同信噪比、多址干擾下的誤碼率性能。最后一章是對全文的總結和對未來的展望。

    標簽: FPGA 算法

    上傳時間: 2013-06-23

    上傳用戶:hzy5825468

  • 基于FPGA的CDMA基站基帶系統

    移動通信是目前通信技術中發展最快的領域之一,CDMA技術憑借其良好的抗噪性、保密性和低功率等優勢成為第三代移動通信的關鍵技術。目前大規??删幊踢壿嬈骷﨔PGA為CDMA移動通信系統的設計提供了新的技術手段。 本文在深入分析CDMA通信系統的原理和特點的基礎上,提出了CDMA基站基帶系統的總體設計方案,論述了CDMA基站基帶系統前向鏈路和反向鏈路中各個信號處理模塊的工作原理,對CRC編碼模塊、卷積編碼模塊、塊交織器、PN碼生成器、Walsh碼發生器、基帶成形濾波器、QPSK調制器、PN碼捕獲與跟蹤模塊、Viterbi譯碼器等CDMA基站基帶系統的各個模塊進行了基于FPGA的建模和設計,取得了一些有價值的階段性成果。這些對CDMA移動通信系統進行深入探索、研究和設計,具有一定的學術意義和應用價值。

    標簽: FPGA CDMA 基站 基帶系統

    上傳時間: 2013-04-24

    上傳用戶:daguda

  • 基于FPGA的FFT信號處理器的設計與實現

    現場可編程門陣列(FPGA)是作為專用集成電路(ASIC)領域中的一種半定制電路而出現的,它結合了微電子技術、電路技術和EDA(Electronics Design Automation)技術。隨著它的廣泛應用和快速發展,使設計電路的規模和集成度不斷提高,同時也帶來了電子系統設計方法和設計思想的不斷推陳出新。 隨著數字電子技術的發展,數字信號處理的理論和技術廣泛的應用于通訊、語音處理、計算機和多媒體等領域。離散傅立葉變換(DFT)作為數字信號處理中的基本運算,發揮著重要作用。而快速傅里葉變換(FFT)算法的提出,使離散傅里葉變換的運算量減小了幾個數量級,使得數字信號處理的實現變得更加容易。FFT已經成為現代數字信號處理的核心技術之一,因此對FFT算法及其實現方法的研究具有很強的理論和現實意義。 本文主要研究如何利用FPGA實現FFT算法,研制具有自主知識產權的FFT信號處理器。該設計采用高效基-16算法實現了一種4096點FFT復數浮點運算處理器,其蝶形處理單元的基-16運算核采用兩級改進的基-4算法級聯實現,僅用8個實數乘法器就可實現基-16蝶形單元所需的8次復數乘法運算,在保持處理速度的優勢下,比傳統的基-16算法節省了75%的乘法器邏輯資源。 在重點研究處理器蝶形單元設計的基礎上,本文完成了整個FFT處理器電路的FPGA設計。首先基于對處理器功能和特點的分析,研究了FFT算法的選取和優化,并完成了處理器體系結構的設計;在此基礎上,以提高處理器處理速度和減小硬件資源消耗為重點研究了具體的實現方案,完成了1.2萬行RTL代碼編程,并在XILINX公司提供的ISE 9.1i集成開發環境中實現了處理器各個模塊的RTL設計:隨后,以XILINX Spartan-3系列FPGA芯片xc3S1000為硬件平臺,完成了整個FFT處理器的電路設計實現。 經過仿真驗證,本文所設計的FFT處理器芯片運行速度達到了100MHz,占用的FPGA門數為552806,電路的信噪比可以達到50dB以上,達到了高速高性能的設計要求。

    標簽: FPGA FFT 信號處理器

    上傳時間: 2013-04-24

    上傳用戶:科學怪人

  • 基于FPGA的π4DQPSK調制解調技術

    本文的設計采用FPGA來實現π/4DQPSK調制解調。采用π/4DQPSK的調制解調方式是基于頻帶利用率、誤比特率(即抗噪性)和實現復雜性等綜合因素的考慮;采用FPGA進行實現是考慮到高速的數據處理以及AD和DA的高速采樣。 本課題主要包含以下幾個方面的研究: 首先對π/4DQPSK技術的應用發展情況做簡單介紹,并對其調制解調原理進行了詳細的闡述。在理解原理的基礎上,將調制解調進行模塊化劃分,提出了實現的思路和方法。其中包括串并轉換,差分相位編碼,內插,成形濾波器,正交調制,帶通濾波器及希爾伯特變換,解調,位同步,載波同步,差分相位解碼。 其次在FPGA上實現了π/4DQPSK的大部分模塊。其中調制端的各個模塊的功能都已經實現,并綜合在一起,下載到開發板上進行了在線仿真。其中成形濾波器的設計大大降低了FPGA的資源開銷,是本次設計的創新;解調端對載波同步和位同步提出了設計思路,具體的實現還需要進一步的研究;接口電路的測試和在線仿真已經完成。 最后提出了硬件實現的方案以及三種芯片的選型與設計,給出了簡要的電路圖和時序圖。

    標簽: 4DQPSK FPGA 調制 解調技術

    上傳時間: 2013-08-03

    上傳用戶:fzy309228829

  • 基于FPGA的雷達信號數字接收機的實現

    在雷達信號偵察中運用寬帶數字接收技術是電子偵察的一個重要發展方向。數字信號處理由于其精度高、靈活性強、以及易于集成等特點而應用廣泛。電子系統數字化的最大障礙是寬帶高速A/D變換器的高速數據流與通用DSP處理能力的不匹配。而FPGA的廣泛應用,為解決上述矛盾提供了一種有效的方法。 本文利用FPGA技術,設計了具備高速信號處理能力的寬帶數字接收機平臺,并提出了數字接收機實現的可行性方法,以及對這些方法的驗證。具體來說就是如何利用單片的FPGA實現對雷達信號并行地實時檢測和參數估計。所做工作主要分為兩大部分: 1、適合于FPGA硬件實現的算法的確定及仿真:對A/D采樣信號采用自相關累加算法進行信號檢測,利用信號的相關性和噪聲的獨立性提高信噪比,通過給出檢測門限來估計信號的起止點。對于常規信號的頻率估計,采用Rife算法。通過Matlab仿真,表明上述算法在運算量和精度方面均有良好性能,適合用作FPGA硬件實現。 2、算法的FPGA硬件實現:針對原算法中極大消耗運算量的相關運算,考慮到FPGA并行處理的特點,將原算法修改為并行相關算法,并加入流水線,這樣處理極大地提高了系統的數據吞吐率。采用Xilinx公司的Virtex-4系列中的XC4VSX55芯片作為開發平臺完成設計,系統測試結果表明,本設計能正常工作,滿足系統設計要求。 文章的最后,結合系統設計給出幾種VHDL優化方法,主要圍繞系統的速度、結構和面積等問題展開討論。

    標簽: FPGA 雷達信號 數字接收機

    上傳時間: 2013-06-25

    上傳用戶:songnanhua

  • 基于FPGA的多普勒測頻系統設計

    多普勒計程儀是根據聲波在水中的多普勒效應原理而制成的一種精密測速和計算航程的儀器,它是船用導航設備的重要組成之一。針對于多普勒計程儀的核心問題——頻率估計,本文提出了一種基于FPGA實現的多普勒測頻方案,它具有抗干擾能力強、運算速度快等特點。本論文主要是圍繞系統的測頻方案的設計與實現展開的。 本文主要研究工作包括:設計和調試基于FPGA的多普勒測頻系統的硬件電路;通過對測頻算法的研究,采用VHDL語言設計和實現系統的測頻算法和其它接口控制程序,并通過軟件仿真,測試設計的正確性。 測頻系統的硬件電路設計是本論文工作的主要部分之一,也是基于FPGA的多普勒測頻系統的核心部分。整個系統以FPGA作為主處理器,完成系統中所有的數字信號處理和外圍接口控制,同時,基于FPGA豐富的片內可編程邏輯資源和外部I/O資源,系統還擴展了豐富的通信接口(UART、USB和以太網接口)和顯示電路(LCD和LED),使系統便于與PC機進行數據交換和控制。 系統的軟件實現是本文工作的另一重要部分。本文通過對測頻算法的研究,完成了基于VHDL實現的過零檢測法和FFT算法,同時也實現了對接收機信號的自動增益控制、信號采集和與計算機的通信功能等。

    標簽: FPGA 多普勒 測頻 系統設計

    上傳時間: 2013-04-24

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