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噪聲發生器

  • 艾默生EV系列變頻器與PC通訊的程序

    艾默生EV系列變頻器與PC通訊的程序,用VB編寫的,十分適合工控人士使用

    標簽: 變頻器 PC通訊 程序

    上傳時間: 2017-06-29

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  • 德州儀器新款dsp TMS320F28335 看門狗程式設計,簡易重置看門狗計數功能,方便使用者開發程式!

    德州儀器新款dsp TMS320F28335 看門狗程式設計,簡易重置看門狗計數功能,方便使用者開發程式!

    標簽: F28335 28335 320F dsp

    上傳時間: 2013-12-20

    上傳用戶:woshini123456

  • 德州儀器發表之新款DSP TMS320F28335 的MCBSP匯流排控制程式,以簡單程式描述匯流排使用方式!

    德州儀器發表之新款DSP TMS320F28335 的MCBSP匯流排控制程式,以簡單程式描述匯流排使用方式!

    標簽: F28335 28335 MCBSP 320F

    上傳時間: 2017-07-14

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  • 信用卡號碼生產器 請大家多看看 能生產個人資料以及卡號

    信用卡號碼生產器 請大家多看看 能生產個人資料以及卡號

    標簽: 信用卡

    上傳時間: 2014-08-27

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  • 超聲波電機之設計及分析

    1-1前言一般人所能夠感受到聲音的頻率約介於5H2-20KHz,超音波(Ultrasonic wave)即爲頻率超過20KHz以上的音波或機械振動,因此超音波馬達就是利用超音波的彈性振動頻率所構成的制動力。超音波馬達的內部主要是以壓電陶瓷材料作爲激發源,其成份是由鉛(Pb)、結(Zr)及鈦(Ti)的氧化物皓鈦酸鉛(Lead zirconate titanate,PZT)製成的。將歷電材料上下方各黏接彈性體,如銅或不銹鋼,並施以交流電壓於壓電陶瓷材料作爲驅動源,以激振彈性體,稱此結構爲定子(Stator),將其用彈簧與轉子Rotor)接觸,將所産生摩擦力來驅使轉子轉動,由於壓電材料的驅動能量很大,並足以抗衡轉子與定子間的正向力,雖然伸縮振幅大小僅有數徵米(um)的程度,但因每秒之伸縮達數十萬次,所以相較於同型的電磁式馬達的驅動能量要大的許多。超音波馬達的優點爲:1,轉子慣性小、響應時間短、速度範圍大。2,低轉速可產生高轉矩及高轉換效率。3,不受磁場作用的影響。4,構造簡單,體積大小可控制。5,不須經過齒輸作減速機構,故較爲安靜。實際應用上,超音波馬達具有不同於傳統電磁式馬達的特性,因此在不適合應用傳統馬達的場合,例如:間歇性運動的裝置、空間或形狀受到限制的場所;另外包括一些高磁場的場合,如核磁共振裝置、斷層掃描儀器等。所以未來在自動化設備、視聽音響、照相機及光學儀器等皆可應用超音波馬達來取代。

    標簽: 超聲波電機

    上傳時間: 2022-06-17

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  • 一種16位音頻SigmaDelta模數轉換器的研究與設計.rar

    Sigma-Delta A/D轉換器利用過采樣,噪聲整形和數字濾波技術,有效衰減了輸出信號帶內的量化噪聲,提高了信噪比。與傳統的Nyquist轉換器相比,它降低了對模擬電路性能指標和元件精度的要求,簡化了模擬電路的設計,降低了生產成本。 本論文在對Sigma-Delta A/D轉換器原理研究的基礎上,基于TSMC0.18um工藝,采用1.8V工作電源,128倍的過采樣率,6.4MHz的采樣頻率,設計了一個主要應用于音頻信號處理的Sigma-Delta A/D轉換器,分辨率達到16位。在調制器的設計中,本文采用了多級噪聲整形MASH(2-1)級聯調制器結構,同時,考慮了各種非理想因素對系統性能的影響,在SDtoolbox工具的幫助下使用Simulink進行調制器系統設計。并使用Cadence Spectre對模塊電路進行設計仿真,包括運放,比較器,帶隙基準電壓源,CMOS開關,非交疊時鐘產生電路等。在數字抽取濾波器的設計中,采用了分級抽取技術,使用MATLAB軟件中的SPTool和FDATool工具對各級抽取濾波器進行優化設計。并在原有的濾波器算法的基礎上,采用了CIC濾波器和半帶濾波器,設計出了運算量和存儲量都相對少的三級抽取濾波器系統,大大降低了功耗和面積。 論文的仿真結果表明,所設計的Sigma-Delta A/D轉換器信噪比達到102.3dB,滿足系統需要的16位精度要求。 關鍵詞:Sigma-Ddta; 信噪比; 多級噪聲整形; 數字抽取濾波器

    標簽: SigmaDelta 音頻 模數轉換器

    上傳時間: 2013-06-27

    上傳用戶:songyuncen

  • 基于DSP的自適應噪聲抵消器設計.rar

    本文的目的在于設計一個自適應噪音抵消系統,使其能消除含噪語音信號中的背景噪音,達到提高語音信號質量的目的.主要工作分為兩大部分.本文在第一部分介紹了自適應數字濾波器的基本理論思想,具體闡述了自適應噪聲抵消系統基本原理,并對自適應噪聲抵消系統的指標、抵消性能進行了計算分析.自適應濾波器的算法是整個系統的核心,在第一部分中,對兩種最基本的自適應算法,進行了詳細的介紹和分析,并針對兩種算法的優缺點進行了詳細的比較.這一部分中最關鍵的是對設計的噪聲抵消系統進行計算機仿真,驗證系統設計的合理性和算法的正確性.通過對自適應噪聲抵消器的MATLAB仿真及對仿真圖形的分析,驗證了系統設計和自適應算法的可行性.第二部分主要完成自適應噪聲抵消系統的硬件設計和軟件編程.在第一部分計算機仿真分析的基礎上,利用高速信號處理芯片DSP(TMS320LF2407)設計了一個噪聲干擾抵消系統,在高速信號處理芯片(TMS320LF2407)上開發實現了自適應LMS算法.

    標簽: DSP

    上傳時間: 2013-06-28

    上傳用戶:zklh8989

  • 基于FPGA的Turbo碼編譯碼器設計.rar

    作為性能優異的糾錯編碼,Turbo碼自誕生以來就一直受到理論界以及工程應用界的關注。TD—SCDMA是我國擁有自主知識產權的3G通信標準,該標準把Turbo碼是作為前向糾錯體制,但Turbo碼的譯碼算法比較復雜并且需要多次迭代,這造成Turbo碼譯碼延時大,譯碼速度慢,因此限制了Turbo碼的實際應用。因此有必要研究如何將現有的Turbo碼譯碼算法進行簡化,加速,使其轉化成為適合在硬件上實現的算法,將實驗室的理論研究成果轉化成為硬件產品。 論文主要的研究內容有以下兩點: 其一,提出信道自適應迭代譯碼方案。在事先設定最大迭代次數的情況下,自適應Turbo碼譯碼算法能夠根據信道的變化自動調整迭代次數。 仿真結果表明:該自適應迭代譯碼方案能夠根據信道的變化自動調整迭代次數,在保證譯碼性能基本上沒有損失的情況下,有效減少譯碼時間,明顯提高譯碼速度。 其二,根據得到的信道自適應迭代譯碼方案,借助Xilinx公司Spartan3 FPGA硬件平臺,使用Verilog硬件描述語言,將用C/C++語言寫成的信道自適應迭代譯碼算法轉化成為硬件設計實現,得到硬件電路,并對得到的譯碼器硬件電路進行測試。 測試結果表明:隨著信道的變化,硬件電路的譯碼速度也隨之自動變化,信噪比越高譯碼速度越快,并且硬件譯碼器性能(誤比特率)與實驗仿真基本一致。

    標簽: Turbo FPGA 編譯碼器

    上傳時間: 2013-05-31

    上傳用戶:huyiming139

  • LDPC碼編碼器FPGA實現研究

    LDPC(低密度奇偶校驗碼)編碼是提高通信質量和數據傳輸速率的關鍵技術。LDPC碼應用于實際通信系統是本課題的研究重點。實際通信要求在LDPC碼長盡量短、碼率盡量高及硬件可實現的前提下,結合連續相位MSK調制,滿足歸一化信噪比SNR=2dB時,系統誤碼率低于10-4。根據課題背景,本文主要研究基于FPGA的LDPC編碼器設計與實現。 LDPC碼的編碼復雜度往往與其幀長的平方成正比,編碼復雜度大,成為編碼硬件實現的一個障礙;論文針對實際系統的預期指標,通過對多種矩陣構造算法的預選方案及影響LDPC碼性能參數仿真分析,基于1/2碼率,1024和2048兩種幀長,設計了三種編碼器的備選方案,分別為直接下三角編碼器,串行準循環編碼器和二階準循環編碼器。 對于每種編碼器,分別設計了其整體結構,并對每種編碼器的功能模塊進行深入研究,設計完成后利用第3方軟件MODELSIM對編碼器進行了時序仿真;根據時序仿真結果和綜合報告對三種編碼方案進行比較,最終選擇串行準循環編碼器作為硬件實現的編碼方案。 最后,在FPGA中硬件實現了串行準循環編碼器并對其進行測試,利用MATLAB仿真程序和串口通信工具最終驗證了這種編碼器的正確性和硬件可實現性。

    標簽: LDPC FPGA 編碼器 實現研究

    上傳時間: 2013-08-02

    上傳用戶:林魚2016

  • 基于FPGA的靜止圖像編碼器

    遙感圖像在人類生活和軍事領域的應用日益廣泛,適合各種要求的遙感圖像編碼技術具有重要的現實意義。基于小波變換的內嵌編碼技術已成為當前靜止圖像編碼領域的主流,其中就包括基于分層樹集合分割排序(Set Partitioning inHierarchical Trees,SPIHT)的內嵌編碼算法。這種算法具有碼流可隨機獲取以及良好的恢復圖像質量等特性,因此成為實際應用中首選算法。隨著對圖像編碼技術需求的不斷增長,尤其是在軍事應用領域如衛星偵察等方面,這種編碼算法亟待轉換為可應用的硬件編碼器。 在靜止圖像編碼領域,高性能的圖像編碼器設計一直是相關研究人員不懈追求的目標。本文針對靜止圖像編碼器的設計作了深入研究,并致力于高性能的圖像編碼算法實現結構的研究,提出了具有創新性的降低計算量、存儲量,提高壓縮性能的算法實現結構,并成功應用于圖像編碼硬件系統中。這個方案還支持壓縮比在線可調,即在不改變硬件框架的條件下可按用戶要求實現16倍到2倍的壓縮,以適應不同的應用需求。本文所做的工作包括了兩個部分。 1.一種基于行的實時提升小波變換實現結構:該結構同時處理行變換和列變換,并且在圖像邊界采用對稱擴展輸出邊界數據,使得圖像小波變換時間與傳統的小波變換相比提高了將近2.6倍,提高了硬件系統的實時性。該結構還合理地利用和調度內部緩沖器,不需要外部緩沖器,大大降低了硬件系統對存儲器的要求。 2.一種采用左遍歷的比特平面并行SPIHT編碼結構:在該編碼結構中,空間定位生成樹采用深度優先遍歷方式,比特平面同時處理極大地提高了編碼速度。

    標簽: FPGA 圖像 編碼器

    上傳時間: 2013-06-17

    上傳用戶:abc123456.

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