基于FPGA的DDS和周期合成技術(shù)在EIS中的應(yīng)用,caj格式
標(biāo)簽： FPGA DDS EIS caj
上傳時(shí)間： 2013-08-26
上傳用戶：lhll918
Matlab_simulink在FPGA設(shè)計(jì)中的應(yīng)用
標(biāo)簽： Matlab_simulink FPGA 中的應(yīng)用
上傳時(shí)間： 2013-08-27
上傳用戶：古谷仁美
詳細(xì)描述了在FPGA/CPLD設(shè)計(jì)過程中應(yīng)注意的地方,和如何提高設(shè)計(jì)效率,對(duì)FPGA設(shè)計(jì)者有很好的幫助
標(biāo)簽： FPGA CPLD 過程 如何提高
上傳時(shí)間： 2013-08-29
上傳用戶：wfeel
一個(gè)好程序關(guān)于CPLD的直線插補(bǔ)在數(shù)字積分中的應(yīng)用
標(biāo)簽： CPLD 程序 直線 數(shù)字
上傳時(shí)間： 2013-08-31
上傳用戶：lixqiang
Median Filter 在FPGA中的實(shí)現(xiàn)
標(biāo)簽： Median Filter FPGA 中的實(shí)現(xiàn)
上傳用戶：bensonlly
CPLD、FPGA在EL顯示模塊及接口電路中的應(yīng)用,cpld實(shí)現(xiàn)數(shù)字電路取代，fpga取代液晶顯示專用控制芯片。
標(biāo)簽： CPLD FPGA 顯示模塊 接口電路
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CPLD在USB20接口中的應(yīng)用，usb大家都用過吧，不用多說了吧。
標(biāo)簽： CPLD USB 20 接口
CPLD/FPGA設(shè)計(jì)中的時(shí)鐘應(yīng)用講解 及其實(shí)例
標(biāo)簽： CPLD FPGA 時(shí)鐘
上傳時(shí)間： 2013-09-01
上傳用戶：3到15
在無線傳送領(lǐng)域,基于FPGA 的DDS 實(shí)現(xiàn)的幾種方式
標(biāo)簽： FPGA DDS 無線傳送 方式
上傳用戶：ttpay
詳細(xì)論述FPGA在軟件無線電技術(shù)實(shí)現(xiàn)系統(tǒng)中的應(yīng)用
標(biāo)簽： FPGA 軟件無線電 技術(shù)實(shí)現(xiàn) 中的應(yīng)用
上傳時(shí)間： 2013-09-02
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