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報(bào)警技術(shù)

網(wǎng)絡(luò)奇技贏巧大搜捕.pdf

網(wǎng)絡(luò)及電腦相關(guān)專輯 114冊(cè) 4.317G網(wǎng)絡(luò)奇技贏巧大搜捕.pdf

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上傳時(shí)間： 2014-05-05

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雷達(dá)仿真 matlab代碼 mtd 慢門(mén)限快門(mén)限虛警處理

該代碼包括線性調(diào)頻信號(hào)產(chǎn)生，正交解調(diào)，動(dòng)目標(biāo)檢測(cè)，恒虛警處理

標(biāo)簽： matlab mtd 雷達(dá) 仿真代碼慢門(mén)限快門(mén)

上傳時(shí)間： 2017-03-22

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羅技無(wú)線鼠標(biāo)配對(duì)連接軟件

用來(lái)給羅技無(wú)線鼠標(biāo)進(jìn)行配對(duì)的軟件，適用于nano450

標(biāo)簽： 羅技無(wú)線鼠標(biāo) 配對(duì) 連接軟件

上傳時(shí)間： 2018-04-21

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《技規(guī)》題庫(kù).doc

《技規(guī)》題庫(kù)

標(biāo)簽： doc 題庫(kù)

上傳時(shí)間： 2019-01-26

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GD32F130xx 快速開(kāi)發(fā)指南 -基于技新 GD32F130G8U6 核心板

GD32F103的移植說(shuō)明和開(kāi)發(fā)指南，幫助新手快速了解GD32F103芯片，縮短上手時(shí)間。本教程結(jié)合官方的用戶手冊(cè)以及固件庫(kù)例程，通過(guò)實(shí)際例程講解以及實(shí)驗(yàn)現(xiàn)象來(lái)幫助讀者理解和使用 GD32F130xx 這個(gè) 系列的芯片。軟件平臺(tái) 使用的是 MDK-ARM 和官方外設(shè) 驅(qū) 動(dòng) 庫(kù) GD32F1x0_Firmware_Library_v3.1.0（庫(kù)函數(shù)開(kāi)發(fā)），硬件使用技新 GD32F130G8U6 核心板 V1.0 和 GD-LINK 下載&調(diào)試器。教程從開(kāi)發(fā)平臺(tái)介紹、開(kāi)發(fā)環(huán)境搭建、建立工程等基礎(chǔ)內(nèi)容，到 GD13F130xx 外設(shè)應(yīng)用，包括： GPIO應(yīng)用、EXTI應(yīng)用、CLK應(yīng)用、USART 應(yīng)用、TIMER 應(yīng)用、I2C應(yīng)用、SPI應(yīng)用、ADC應(yīng)用、FWDGT 應(yīng)用和 WWDGT 應(yīng)用等十大部分內(nèi)容。外設(shè)應(yīng)用部分的內(nèi)容都配有源碼，并配合硬件平臺(tái)進(jìn)行實(shí)驗(yàn)講解。教程面對(duì)的對(duì)象是具有一定的 MCU 編程基礎(chǔ)以及 C 語(yǔ)言基礎(chǔ)的，主旨是幫助開(kāi)發(fā)者快速入門(mén)和快速開(kāi)發(fā)使用 GD32F130xx 系列產(chǎn)品。

標(biāo)簽： gd32f103

上傳時(shí)間： 2022-06-18

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基于FPGA的恒虛警(CFAR)算法

基于FPGA的恒虛警(CFAR)算法

標(biāo)簽： fpga cfar算法

上傳時(shí)間： 2022-07-08

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雷達(dá)信號(hào)處理系統(tǒng)的設(shè)計(jì)與FPGA實(shí)現(xiàn).rar

雷達(dá)信號(hào)處理是雷達(dá)系統(tǒng)的重要組成部分。在數(shù)字信號(hào)處理技術(shù)飛速發(fā)展的今天，雷達(dá)信號(hào)處理中也普遍使用數(shù)字信號(hào)處理技術(shù)。而現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)在數(shù)字信號(hào)處理中的廣泛應(yīng)用，使得FPGA在雷達(dá)信號(hào)處理中也占據(jù)了重要地位。針對(duì)雷達(dá)信號(hào)處理的設(shè)計(jì)與實(shí)現(xiàn)，本文在以下兩個(gè)方面展開(kāi)研究：一方面以線性調(diào)頻信號(hào)(LFM)為例，分別對(duì)幾種基本的雷達(dá)信號(hào)處理，如正交相干檢波、脈沖壓縮、動(dòng)目標(biāo)顯示(MTI)/動(dòng)目標(biāo)檢測(cè)(MTD)和恒虛警(CFAR)詳細(xì)地闡述了其原理，在此基礎(chǔ)上給出了其經(jīng)常采用的實(shí)現(xiàn)方法，并在MATLAB環(huán)境中對(duì)各個(gè)環(huán)節(jié)進(jìn)行了參數(shù)化仿真，詳盡地給出了各環(huán)節(jié)的仿真波形圖。針對(duì)仿真結(jié)果，直觀形象地說(shuō)明了不同實(shí)現(xiàn)方法的優(yōu)劣。另一方面結(jié)合MATLAB仿真結(jié)果，給出利用FPGA實(shí)現(xiàn)雷達(dá)信號(hào)處理的方案。在Xilinx ISE6.3i軟件集成環(huán)境下，通過(guò)對(duì)Xilinx提供的IP核的調(diào)用，并與VHDL語(yǔ)言相結(jié)合，完成雷達(dá)信號(hào)處理的FPGA實(shí)現(xiàn)。

標(biāo)簽： FPGA 雷達(dá)信號(hào) 處理系統(tǒng)

上傳時(shí)間： 2013-06-08

上傳用戶：qweqweqwe
基于FPGA的雷達(dá)信號(hào)處理系統(tǒng)設(shè)計(jì).rar

雷達(dá)信號(hào)處理是雷達(dá)系統(tǒng)的重要組成部分。在數(shù)字信號(hào)處理技術(shù)飛速發(fā)展的今天，雷達(dá)信號(hào)處理中也普遍使用數(shù)字信號(hào)處理技術(shù)。而現(xiàn)場(chǎng)可編程門(mén)陣列（FPGA）在數(shù)字信號(hào)處理中的廣泛應(yīng)用，使得FPGA在雷達(dá)信號(hào)處理中也占據(jù)了重要地位。針對(duì)脈壓雷達(dá)信號(hào)處理的FPGA實(shí)現(xiàn)，本文在以下幾個(gè)方面展開(kāi)研究：首先對(duì)幾種主要的脈沖壓縮信號(hào)進(jìn)行了詳細(xì)的分析，得出了各種信號(hào)的特點(diǎn)及其處理方式；并比較了各種方式的優(yōu)缺點(diǎn)。其次對(duì)幾種基本的雷達(dá)信號(hào)處理如脈沖壓縮、動(dòng)目標(biāo)檢測(cè)（MTD）、恒虛警（CFAR）等詳細(xì)地闡述了其原理；列舉了各種信號(hào)處理經(jīng)常采用的實(shí)現(xiàn)方法，對(duì)各種方法進(jìn)行了比較研究；并針對(duì)線性調(diào)頻信號(hào)在MATLAB環(huán)境中對(duì)雷達(dá)回波信號(hào)處理進(jìn)行仿真。接下來(lái)，在Xilinx ISE6.3i軟件集成環(huán)境下，通過(guò)對(duì)Xilinx提供的免費(fèi)IP核的調(diào)用，并與VHDL語(yǔ)言相結(jié)合，進(jìn)行雷達(dá)信號(hào)處理的FPGA實(shí)現(xiàn)。

標(biāo)簽： FPGA 雷達(dá)信號(hào)處理系統(tǒng)設(shè)計(jì)

上傳時(shí)間： 2013-06-24

上傳用戶：lingzhichao
基于ARM的地鐵用安全型智能IO的設(shè)計(jì)與實(shí)現(xiàn)

地鐵信號(hào)設(shè)備中輸入輸出設(shè)備是信號(hào)邏輯和現(xiàn)場(chǎng)設(shè)備之間的接口，有著四高（高安全，高可靠，高可維護(hù)，高可用）要求，目前信號(hào)系統(tǒng)廠家的傳統(tǒng)做法是整個(gè)信號(hào)系統(tǒng)產(chǎn)品由一家公司來(lái)完成，可是隨著技算機(jī)技術(shù)的快速發(fā)展，邏輯部份目前已可以采用通用COTS產(chǎn)品，而輸入輸出部分還是需要各個(gè)信號(hào)廠家自己設(shè)計(jì)和生產(chǎn)，因此設(shè)計(jì)出一款通用型的輸入輸出控制器已成地鐵行業(yè)的發(fā)展方向。為了滿足以上要求，本文從實(shí)際應(yīng)用角度出發(fā)，使信號(hào)系統(tǒng)的產(chǎn)品更加的開(kāi)放透明，設(shè)計(jì)出基于ARM的地鐵用安全型的智能I/O，從而使信號(hào)系統(tǒng)設(shè)計(jì)可以方便地和現(xiàn)場(chǎng)信號(hào)設(shè)備接口。在硬件上采用冗余設(shè)計(jì)，以ARM為主處理器，整個(gè)系統(tǒng)無(wú)單點(diǎn)硬件故障，采集部分采用動(dòng)態(tài)異或輸入設(shè)計(jì)，驅(qū)動(dòng)部分采用安全驅(qū)動(dòng)設(shè)計(jì)。基于ARM的地鐵用安全智能I/O嚴(yán)格遵循歐洲鐵路信號(hào)產(chǎn)品的標(biāo)準(zhǔn)，使系統(tǒng)的安全性，可靠性，可用性和可維護(hù)性有了充分的保障。本文主要介紹了地鐵用安全型智能I/O控制器的設(shè)計(jì)和實(shí)現(xiàn)，包括設(shè)計(jì)思想，具體實(shí)施，硬件和軟件的設(shè)計(jì)等。

標(biāo)簽： ARM 地鐵智能IO

上傳時(shí)間： 2013-06-12

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基于ARM的雷達(dá)信號(hào)處理系統(tǒng)的研究

隨著信息技術(shù)的飛速發(fā)展，人們對(duì)數(shù)據(jù)采集、信號(hào)處理的要求越來(lái)越高：不僅要求高速、高精度和高實(shí)時(shí)，還要求數(shù)據(jù)采集，處理設(shè)備便攜化、網(wǎng)絡(luò)化和智能化，并具有友好的人機(jī)界面。傳統(tǒng)的8/16位單片機(jī)因資源極度受限，難以滿足上述要求；而傳統(tǒng)的信號(hào)處理過(guò)程都是依賴于PC完成，則存在著安裝麻煩、價(jià)格昂貴且電磁兼容性差等缺點(diǎn)。嵌入式系統(tǒng)是一個(gè)快速發(fā)展的領(lǐng)域，嵌入式系統(tǒng)的研究?jī)?nèi)容涉及到計(jì)算機(jī)學(xué)科的各個(gè)方面。將嵌入式系統(tǒng)引入雷達(dá)信號(hào)處理系統(tǒng)，能極大的提高系統(tǒng)的實(shí)時(shí)性和靈活性。本文的研究正是基于ARM的雷達(dá)信號(hào)處理系統(tǒng)。本文在對(duì)線性調(diào)頻連續(xù)波雷達(dá)測(cè)速測(cè)距研究的基礎(chǔ)上，討論了一種軟硬件配置靈活、結(jié)構(gòu)精簡(jiǎn)的雷達(dá)信號(hào)處理系統(tǒng)，其硬件平臺(tái)以ARM處理器，可編程邏輯器件FPGA，和DSP為核心，擴(kuò)展了UART、LCD、網(wǎng)口、IDE、觸摸屏、PS/2和USB等外圍接口，可實(shí)現(xiàn)對(duì)線性調(diào)頻連續(xù)波雷達(dá)回波信號(hào)進(jìn)行數(shù)據(jù)采集、脈沖壓縮、恒虛警檢測(cè)、航跡相關(guān)，航跡顯示等處理，相關(guān)數(shù)據(jù)的存儲(chǔ)。在軟件設(shè)計(jì)方面，完成Bootloader，Linux2.4操作系統(tǒng)在系統(tǒng)上的移植，在此基礎(chǔ)上對(duì)實(shí)現(xiàn)了對(duì)網(wǎng)口、IDE、LCD等模塊的驅(qū)動(dòng)程序編寫(xiě)，并在MiniGUI上進(jìn)行基于顯示終端需求的圖形用戶界面開(kāi)發(fā)。

標(biāo)簽： ARM 雷達(dá)信號(hào) 處理系統(tǒng)

上傳時(shí)間： 2013-04-24

上傳用戶：Shoen