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外部中斷

  • matlab在27種問題中的應用.rar

    這本書列舉了matlab在27個實例中的使用說明和各種技巧。

    標簽: matlab 中的應用

    上傳時間: 2013-04-24

    上傳用戶:gongxinshiwo@163.com

  • 功率電源中IGBT失效機理及其檢測方法的研究.rar

    由于絕緣柵雙極晶體管IGBT具有工作頻率高、處理功率大和驅動簡單等諸多優點,在電力電子設備、尤其是中大型功率的電力電子設備中的應用越來越廣泛。但是,IGBT失效引發的設備故障往往會對生產帶來巨大影響和損失,因此,對IGBT的失效研究具有十分重要的應用意義。 本文在深入分析IGBT器件工作原理和工作特性的基礎上,采用雙極傳輸理論聯立求解電子和空穴的傳輸方程,得到了穩態時電子和空穴電流的表達式,對造成IGBT失效的各種因素進行了詳細分析。應用MATLAB軟件,對硅參數的熱導率、載流子濃度、載流子壽命、電子遷移率、空穴遷移率和雙極擴散系數等進行了仿真,深入研究了IGBT的失效因素,得到了IGBT失效的主要原因是發生擎住效應以及泄漏電流導致IGBT延緩失效的有用結論。并且,進行了IGBT動態模型的設計和仿真,對IGBT在短路情況下的失效機理進行了深入研究。 考慮到實際設備中的IGBT在使用中經常會發生反復過流這一問題,通過搭建試驗電路,著重對反復過流對IGBT可能帶來的影響進行了試驗研究,探討了IGBT因反復過流導致的累積失效的變化規律。本文研究結果對于正確判斷IGBT失效以及失效程度、進而正確判斷和預測設備的可能故障,具有一定的應用參考價值。

    標簽: IGBT 功率電源 失效機理

    上傳時間: 2013-08-04

    上傳用戶:lrx1992

  • matlab中實現雷達信號處理.rar

    matlab中實現雷達信號處理,雷達仿真中會用到的

    標簽: matlab 雷達信號處理

    上傳時間: 2013-04-24

    上傳用戶:330402686

  • 單片機論文資料,精華中的精華,保證你下的不后悔,做畢設必備的資料.rar

    單片機論文資料,精華中的精華,保證你下的不后悔,做畢設必備的資料..,歡迎下載

    標簽: 單片機 論文資料

    上傳時間: 2013-04-24

    上傳用戶:edisonfather

  • 基于FPGA的3D頭盔顯示設備研究.rar

    圖像顯示器是人類接受外部信息的重要手段之一。而立體顯示則能再現場景的三維信息,提供場景更為全面、詳實的信息,在醫學、軍事、娛樂具有廣泛的應用前景。而現有的3D立體顯示設備價格都比較貴,基于此,本人研究了基于SDRAM存儲器和FPGA處理器的3D頭盔顯示設備并且設計出硬件和軟件系統。該系統圖像效果好,并且價格成本便宜,從而具有更大的實用性。本文完成的主要工作有三點: 1.設計了基于FPGA處理器和SDRAM存儲器的3D頭盔顯示器。該方案有別于現有的基于MCU、DSP和其它處理芯片的方案。本方案能通過線性插值算法把1024×768的分辨率變成800×600的分辨率,并能實現120HZ圖像刷新率,采用SDRAM作為高速存儲器,并且采用乒乓操作,有別于其它的開關左右眼視頻實現立體圖像。在本方案中每時每刻都是左右眼視頻同時輸出,使得使用者感覺不到視頻圖像有任何閃爍,減輕眼睛疲勞。本方案還實現了圖像對比對度調節,液晶前照光調節(調節輸出脈沖的占空比),立體圖像源自動識別,還有人性化的操作界面(OSD)功能。 2.完成了該系統的硬件平臺設計和軟件設計。從便攜性角度考慮,盡量減小PCB板面積,給出了它們詳細的硬件設計電路圖。完成了FPGA系統的設計,包括系統整體分析,各個模塊的實現原理和具體實現的方法。完成了單片機對AD9883的配置設計。 3.完成了本方案的各項測試和調試工作,主要包括:數據采集部分測試、數據存儲部分測試、FPGA器件工作狀態測試、以電腦顯示器作為顯示器的聯機調試和以HX7015A作為顯示器的聯機調試,并且最終調試通過,各項功能都滿足預期設計的要求。實驗和分析結果論證了系統設計的合理性和使用價值。 本文的研究與實現工作通過實驗和分析得到了驗證。結果表明,本文提出的由FPGA和SDRAM組成的3D頭盔顯示系統完全可以實現高質量的立體視覺效果,從而可以將該廉價的3D頭盔顯示系統用于我國現代化建設中所需要的領域。

    標簽: FPGA 顯示設備

    上傳時間: 2013-07-16

    上傳用戶:xiaoxiang

  • 基于FPGA的DDC在頻譜儀中的設計.rar

    軟件無線電思想的出現帶來了接收機實現方式的革新。隨著近年來軟件無線電理論和應用趨于成熟與完善,軟件無線電技術已經被越來越廣泛地應用于無線通信系統和電子測量測試儀器中。數字下變頻技術作為軟件無線電的核心技術之一,在頻譜分析儀中也得到了越來越普遍的應用。 本人參與的手持式頻譜分析儀項目采用的是中頻數字化實現方式,可滿足輕巧,可重配置和低功耗的需求。數字化中頻的關鍵部件數字下變頻器DDC采用的是Intersil公司的ISL5216,這個器件和高性能FPGA共同組成手持頻譜儀的數字信號處理前端。這個數字前端就手持頻譜分析儀來說存在一定的局限性,ISL5216的信號處理帶寬單通道為1 MHz,4個通道級聯為3MHz,未能滿足譜儀分析帶寬日益增加的需求;系統集成度不高,ISL5216的功能要是集成到FPGA,可進一步提高系統集成度,降低物料成本和系統功耗。基于以上兩個方面的考慮,現正以手持頻譜分析儀項目為依托,基于Xilinx Spartan3A-DSP系列FPGA實現高速高處理帶寬的DDC。 本論文首先描述了數字下變頻基本理論和結構,對完成各級數字信號處理所涉及的數字正交變換、CORDIC算法、CIC、HB、多相濾波等關鍵算法做了適當介紹;然后介紹了當前主流FPGA的數字信號處理特性和其內部的DSP資源。接著詳細描述了數控振蕩器NCO、復數數字混頻器MIXER、5級CIC濾波器、5級HB濾波器和255階可編程FIR的設計和實現,并對各個模塊的不同實現方式作了對比和仿真測試數據作了分析。最后介紹了所設計DDC在手持頻譜分析儀中的主要應用。

    標簽: FPGA DDC 頻譜儀

    上傳時間: 2013-04-24

    上傳用戶:a155166

  • LTE系統中基帶DAGC的應用研究及FPGA實現.rar

    當今,移動通信正處于向第四代通信系統發展的階段,OFDM技術作為第四代數字移動通信(4G)系統的關鍵技術之一,被包括LTE在內的眾多準4G協議所采用。IDFT/DFT作為OFDM系統中的關鍵功能模塊,其精度對基帶解調性能產生著重大的影響,尤其對LTE上行所采用的SC_FDMA更是如此。為了使定點化IDFT/DFT達到較好的性能,本文采用數字自動增益控制(DAGC)技術,以解決過大輸入信號動態范圍所造成的IDFT/DFT輸出信噪比(SNR)惡化問題。 首先,本文簡單介紹了較為成熟的AAGC(模擬AGC)技術,并重點關注近年來為了改善其性能而興起的數字化AGC技術,它們主要用于壓縮ADC輸入動態范圍以防止其飽和。針對基帶處理中具有累加特性的定點化IDFT/DFT技術,進一步分析了AAGC技術和基帶DAGC在實施對象,實現方法等上的異同點,指出了基帶DAGC的必要性。 其次,根據LTE協議,搭建了從調制到解調的基帶PUSCH處理鏈路,并針對基于DFT的信道估計方法的缺點,使用簡單的兩點替換實現了優化,通過高斯信道下的MATLAB仿真,證明其可以達到理想效果。仿真結果還表明,在不考慮同步問題的高斯信道下,本文所搭建的基帶處理鏈路,采用64QAM進行調制,也能達到在SNR高于17dB時,硬判譯碼結果為極低誤碼率(BER)的效果。 再次,在所搭建鏈路的基礎上,通過理論分析和MATLAB仿真,證明了包括時域和頻域DAGC在內的基帶DAGC具有穩定接收鏈路解調性能的作用。同時,通過對幾種DAGC算法的比較后,得到的一套適用于實現的基帶DAGC算法,可以使IDFT/DFT的輸出SNR處于最佳范圍,從而滿足LTE系統基帶解調的要求。針對時域和頻域DAGC的差異,分別選定移位和加法,以及查表的方式進行基帶DAGC算法的實現。 最后,本文對選定的基帶DAGC算法進行了FPGA設計,仿真、綜合和上板結果說明,時域和頻域DAGC實現方法占用資源較少,容易進行集成,能夠達到的最高工作頻率較高,完全滿足基帶處理的速率要求,可以流水處理每一個IQ數據,使之滿足基帶解調性能。

    標簽: DAGC FPGA LTE

    上傳時間: 2013-05-17

    上傳用戶:laozhanshi111

  • 基于FPGA動態重構的故障容錯技術.rar

    可重構計算技術兼具通用處理器(General-Purpose Processor,GPP)和專用集成電路(Application Specific Integr—ated Circuits,ASIC)的特點,既可以提供硬件高速的特性,又具有軟件可以重新配置的特性。而動態部分可重構技術是可重構計算技術的最新進展之一。該技術的要點就是在系統正常工作的情況下,修改部分模塊的功能,而系統其它模塊能夠照常運行,這樣既節約硬件資源,又增強了系統靈活性。 可重構SoC既可以在處理器上進行編程又可以改變FPGA內部的硬件結構,這使得SoC系統既具有處理器善于控制和運算的特點,又具FPGA靈活的重構特點;由于處理器和FPGA硬件是在同一塊硅片上,使得它們之間的通信寬帶大大提高,這種平臺很適合于容錯算法的實現。 本文基于863計劃項目;動態重構計算機的可信實現關鍵技術,重點研究應用于惡劣環境中FPGA自我容錯的體系結構,提出了一套完整的SoC系統的容錯設計方案,并研究其實現技術,設計實現了實現該技術的硬件平臺和軟件算法,并驗證成功。 論文取得了如下的創新性研究成果: 1、設計了實現動態重構技術的硬件平臺,包括高性能的FPGA(內含入式處理器PowcrPC)、PROM、SRAM、FLASH、串口通信等硬件模塊。 2、說明了動態重構技術的設計規范和設計流程,實現動態重構技術。 3、提出了一種基于動態重構實現容錯的方法,不需要外部處理器干預,由嵌入式處理器負責管理整個過程。 4、設計并實現了嵌入式處理器運行時需要的軟件,主要有兩個功能,首先是從CF卡中讀入重構所需的配置文件,并將配置文件寫進FPGA內部的配置存儲器中,改變FPGA內部的功能。其次,是實現容錯技術的算法。

    標簽: FPGA 動態 容錯技術

    上傳時間: 2013-04-24

    上傳用戶:edrtbme

  • 地面數字電視廣播系統中SRRC濾波器及FFT處理器的設計與FPGA實現.rar

    隨著人們對數字電視和數字視頻信息的需求越來越大,數字電視廣播在中國迅速的發展起來。近幾年,數字電視傳輸系統技術逐漸成熟,數字電視地面廣播(DTTB)傳輸標準也于2006年8月30號正式出臺。此標準技術是由我國多家單位聯合研究的,具有自主知識產權的數字地面電視傳輸標準。DTTB系統標準的研究與仿真,具有巨大的實用價值和廣闊的市場前景。 @@ 本文首先研究了地面數字電視廣播標準中平方根升余弦(SRRC)濾波器(滾降系數為0.05)的結構設計,介紹了一種適合在FPGA中實現的高階高速FIR濾波器的并行流水線結構。在本設計中,以CSD數優化濾波器系數,并運用簡化加法器圖(Reduced Adder Graph,RAG)算法進行改進,最后采用并行處理的轉置型流水線結構實現。 @@ 接著研究數字電視地面傳輸標準采用的傳輸技術-OFDM的基本概念和技術特點,并研究了清華大學提出的DMB-T方案中TDS-OFDM信號幀的組成結構以及相關原理。 @@ 最后,本文針對OFDM調制所需要的3780點FFT處理器進行研究。為了保證OFDM信號的采樣率和時域導頻的采樣率相同,以達到較好的同步性能,采用了3780個正交子載波的設計方案。在實現過程中,分析比較了多種算法的計算復雜性,設計出在硬件實現復雜度上進行優化的3780點FFT處理器的數據流流水線算法。之后,通過定點仿真比較各模塊輸出的動態范圍和概率分布,設計出定點字長的優化方案,并分析計算了這一處理器的輸出信噪比與內部各模塊字長的關系,進一步降低了硬件實現復雜性。 @@關鍵字:數字電視地面廣播傳輸(DTTB);平方根升余弦濾波器(SRRC);正交頻分復用調制(OFDM);快速傅立葉變換(FFT); 3780

    標簽: SRRC FPGA FFT

    上傳時間: 2013-04-24

    上傳用戶:mdrd3080

  • 數字電視傳輸系統中LDPC碼編碼器的研究與FPGA實現.rar

    自香農先生于1948年開創信息論以來,經過將近60年的發展,信道編碼技術已經成為通信領域的一個重要分支,各種編碼技術層出不窮。目前廣泛研究的低密度奇偶校驗(LDCP)碼是由R.G.Gallager先生提出的一種具有逼近香農限性能的優秀糾錯碼,并已在數字電視、無線通信、磁盤存儲等領域得到大量應用。 目前數字電視已經成為最熱門的話題之一,用手機看北京奧運,已經成為每一個中國人的夢想。最近兩年我國頒布了兩部與數字電視有關的通信標準,分別是數字電視地面傳輸標準(DMB-TH)和移動多媒體(CMMB)即俗稱的手機電視標準。數字電視正與每個人走得越來越近,我國預期在2015年全面實現數字電視并停止模擬電視的播出。作為數字電視標準的核心技術之一的前向糾錯碼技術已經成為眾多科研單位的研究熱點,相應的編解碼芯片更成為重中之重。在DMB-TH標準中用到了LDPC碼和BCH碼的級聯編碼方式,在CMMB標準中用到了LDPC碼和RS碼的級聯編碼方式,在DVB-S2標準中用到了LDPC碼和BCH碼的級聯編碼方式。 本論文以目前最重要的三個與數字電視相關的標準:數字電視地面傳輸標準(DMB-TH)、手機電視標準(CMMB)以及數字衛星電視廣播標準(DVB-S2)為切入點,深入研究它們的編碼方式,設計了這三個標準中的LDPC碼編碼器,并在FPGA上實現了前兩個標準的編碼芯片,實現了DMB-TH標準中0.4、0.6以及0.8三種碼率的復用。在研究CMMB標準中編碼器設計時,提出一種改進的LU分解算法,該分解方式適合任意的H矩陣,具有一定的廣泛性。測試結果表明,芯片邏輯功能完全正確,速度和資源消耗均達到了標準的要求,具有一定的商用價值。

    標簽: LDPC FPGA 數字電視

    上傳時間: 2013-07-07

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