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多相結(jié)構(gòu)

  • OFDM發(fā)射機(jī)系統(tǒng)的FPGA設(shè)計(jì)

    無線局域網(wǎng)是計(jì)算機(jī)網(wǎng)絡(luò)技術(shù)和無線通信技術(shù)相結(jié)合的產(chǎn)物,是利用無線媒介傳輸信息的計(jì)算機(jī)網(wǎng)絡(luò)。在無線通信信道中,由于多徑時延不可避免地存在符號間干擾,正交頻分復(fù)用(OFDM)作為一種可以有效對抗符號間干擾(ISI)和提高頻譜利用率的高速傳輸技術(shù),引起了廣泛關(guān)注。在無線局域網(wǎng)(WLAN)系統(tǒng)中,OFDM調(diào)制技術(shù)已經(jīng)被采用作為其物理層標(biāo)準(zhǔn),并且公認(rèn)為是下一代無線通信系統(tǒng)中的核心技術(shù)。基于IEEE802.11a的無線局域網(wǎng)標(biāo)準(zhǔn)的物理層采用了OFDM技術(shù),能有效的對抗多徑信道衰落,達(dá)到54Mbps的速度,而未來而的IEEE802.11n將達(dá)到100Mbps的高速。因此,研發(fā)以O(shè)FDM為核心的原型機(jī)研究非常有必要。 本文在深入理解OFDM技術(shù)的同時,結(jié)合相應(yīng)的EDA工具對系統(tǒng)進(jìn)行建模并基于IEEE802.11a物理層標(biāo)準(zhǔn)給出了一種OFDM基帶發(fā)射機(jī)系統(tǒng)的FPGA實(shí)現(xiàn)方案。整個設(shè)計(jì)采用目前主流的自頂向下的設(shè)計(jì)方法,由總體設(shè)計(jì)至詳細(xì)設(shè)計(jì)逐步細(xì)化。在系統(tǒng)功能模塊的FPGA實(shí)現(xiàn)過程中,針對Xilinx一款160萬門的Spartan-3E XCS1600E芯片,依照:IEEE802.11a幀格式,對發(fā)射機(jī)系統(tǒng)各個模塊進(jìn)行了詳細(xì)設(shè)計(jì)和仿真: (1)訓(xùn)練序列生成模塊,包括長,短訓(xùn)練序列; (2)信令模塊,包括卷積編碼,交織,BPSK調(diào)制映射; (3)數(shù)據(jù)模塊,包括加擾,卷積編碼,刪余,交織,BPSK/QPSK/16QAM/64QAM調(diào)制映射; (4)OFDM處理部分,包括導(dǎo)頻插入,加循環(huán)前綴,IFFT處理; (5)對整個發(fā)射處理部分聯(lián)調(diào),并給出仿真結(jié)果另外,還完成了接收機(jī)部分模塊的FPGA設(shè)計(jì),并給出了相應(yīng)的頂層結(jié)構(gòu)與仿真波形。最后提出了改進(jìn)和進(jìn)一步開發(fā)的方向。

    標(biāo)簽: OFDM FPGA 發(fā)射機(jī)

    上傳時間: 2013-04-24

    上傳用戶:李彥東

  • 基于FPGA的UHF多協(xié)議RFID基帶信號處理

    基于FPGA的UHF多協(xié)議RFID基帶信號處理

    標(biāo)簽: FPGA RFID UHF 多協(xié)議

    上傳時間: 2013-07-18

    上傳用戶:2404

  • 基于FPGA的全數(shù)字鎖相環(huán)的設(shè)計(jì)

    隨著現(xiàn)代集成電路技術(shù)的發(fā)展,鎖相環(huán)已經(jīng)成為集成電路設(shè)計(jì)中非常重要的一個部分,所以對鎖相環(huán)的研究具有積極的現(xiàn)實(shí)意義。然而傳統(tǒng)的鎖相環(huán)大多是數(shù)模混合電路,在工藝上與系統(tǒng)芯片中的數(shù)字電路存在兼容問題。因此設(shè)計(jì)一...

    標(biāo)簽: FPGA 全數(shù)字 鎖相環(huán)

    上傳時間: 2013-06-09

    上傳用戶:mosliu

  • 基于ARM感應(yīng)電機(jī)數(shù)字控制器的設(shè)計(jì)

    感應(yīng)電機(jī)具有可靠性好、結(jié)構(gòu)簡單、耐腐蝕、效率好、結(jié)構(gòu)緊湊、價格低廉和體積小等優(yōu)點(diǎn),成為工業(yè)伺服控制的主要傳動裝置然而,感應(yīng)電機(jī)又是一個多變量、強(qiáng)耦合的非線性系統(tǒng),磁鏈和轉(zhuǎn)矩的非線性耦合及參數(shù)時變,使得感應(yīng)電機(jī)的控制十分復(fù)雜,特別是在實(shí)際電機(jī)控制系統(tǒng)中,還需要考慮硬件和周圍環(huán)境等多種因素的干擾,致使實(shí)現(xiàn)高性能的感應(yīng)電機(jī)控制系統(tǒng)更加困難 本文研究感應(yīng)電機(jī)的高性能控制策略,綜述了感應(yīng)電機(jī)高性能控制策略的發(fā)展歷程和感應(yīng)電機(jī)模糊控制的發(fā)展現(xiàn)狀,分析了實(shí)際電機(jī)控制系統(tǒng)控制器選型中各個嵌入式微處理器的基本性能和優(yōu)缺點(diǎn)在給出三相坐標(biāo)系和二相坐標(biāo)系中的感應(yīng)電機(jī)數(shù)學(xué)模型之后,從理論上闡述了模糊控制和矢量控制的基本原理,針對傳統(tǒng)的PI控制器參數(shù)整定繁瑣,系統(tǒng)魯棒性差的缺點(diǎn),論文將模糊控制技術(shù)應(yīng)用于感應(yīng)電機(jī)的變頻調(diào)速,采用CRI推理法,設(shè)計(jì)了一種參數(shù)自整定模糊PI矢量控制器,利用Matlab對基于模糊PI控制的感應(yīng)電機(jī)控制系統(tǒng)進(jìn)行了仿真,并對采用兩種控制器實(shí)現(xiàn)的感應(yīng)電機(jī)調(diào)速控制系統(tǒng)進(jìn)行了比較、分析仿真結(jié)果表明模糊控制的控制性能優(yōu)于常規(guī)的PI調(diào)節(jié)器 論文對基于ARM的感應(yīng)電機(jī)數(shù)字控制技術(shù)進(jìn)行了系統(tǒng)研究,闡述了采用LPC2214ARM微處理器構(gòu)成數(shù)字感應(yīng)電機(jī)變頻調(diào)速系統(tǒng)的方法,給出了一種高性能感應(yīng)電機(jī)的數(shù)字實(shí)現(xiàn)方案,詳細(xì)介紹了系統(tǒng)硬件結(jié)構(gòu)的組成及軟件模塊的功能,并給出了主要算法的參考代碼,為實(shí)際電機(jī)控制器的選型和開發(fā)提供了一個新的思路

    標(biāo)簽: ARM 感應(yīng)電機(jī) 數(shù)字控制器

    上傳時間: 2013-08-03

    上傳用戶:sy_jiadeyi

  • DLT645-2007多功能電能表通信協(xié)議

    電力行業(yè)標(biāo)準(zhǔn)DL/T 645-2007:多功能電能表通信協(xié)議。

    標(biāo)簽: 2007 DLT 645 多功能電能表

    上傳時間: 2013-04-24

    上傳用戶:wangdean1101

  • 基于Verilog HDL設(shè)計(jì)的多功能數(shù)字鐘

    本文利用Verilog HDL 語言自頂向下的設(shè)計(jì)方法設(shè)計(jì)多功能數(shù)字鐘,突出了其作為硬件描述語言的良好的可讀性、可移植性和易理解等優(yōu)點(diǎn),并通過Altera QuartusⅡ 4.1 和ModelSim

    標(biāo)簽: Verilog HDL 多功能 數(shù)字

    上傳時間: 2013-07-21

    上傳用戶:ve3344

  • ChenMobius通信系統(tǒng)的FPGA硬件實(shí)現(xiàn)

    自上個世紀(jì)九十年代以來,我國著名學(xué)者、現(xiàn)中國科學(xué)院院士、清華大學(xué)陳難先教授等人使用無窮級數(shù)的Mobius反演公式解決了一系列重要的物理學(xué)中的逆問題,開創(chuàng)了應(yīng)用、推廣數(shù)論中的Mobius變換解決物理學(xué)中各種逆問題的巧妙方法,其工作在1990年當(dāng)時就得到了世界著名的《NATURE》雜志的高度評價。 華僑大學(xué)蘇武潯教授等則把Mobius變換的方法應(yīng)用于幾種常用波形(包括周期矩形脈沖,奇偶對稱方波和三角波等)的傅立葉級數(shù)的逆變換運(yùn)算,得到正、余弦函數(shù)及一般周期信號的各種常用波形的信號展開;并求得了與各種常用波形信號函數(shù)族相正交的函數(shù)族,以用于各展開系數(shù)的計(jì)算與信息的解調(diào);而后把它們應(yīng)用到通信系統(tǒng)中,提出了一種新的通信系統(tǒng),即新型Chen-Mobius通信系統(tǒng)。 本文主要完成了兩個方面的工作,Chen-Mobius多路通信系統(tǒng)的FPGA硬件設(shè)計(jì)實(shí)現(xiàn)和基于Chen-Mobius變換的語音加密雙工通信系統(tǒng)的實(shí)現(xiàn)。首先,利用嵌入MATLAB\SIMULINK中的DSPBuilder軟件對Chen-Mobius多路(四路和八路)通信系統(tǒng)進(jìn)行仿真分析,對該系統(tǒng)在不同信噪比情況下的錯誤概率進(jìn)行了計(jì)算,并繪出了信噪比-錯誤概率曲線;其次,利用DSPBuilder中的Signalcompiler將Chen-Mobius多路通信系統(tǒng)的主體模塊(函數(shù)及積分器的產(chǎn)生等)轉(zhuǎn)化成HDL硬件語言,后在QuartusⅡ軟件平臺上,結(jié)合利用VHDL編程的硬件程序模塊(分頻、延時、控制模塊等)構(gòu)架完整的Chen-Mobius通信系統(tǒng),并對此系統(tǒng)設(shè)計(jì)綜合、引腳分配、仿真驗(yàn)證、時序分析等;最后,在Altera公司的Stratix 芯片上,實(shí)現(xiàn)硬件的編程和下載,從而完成了Chen-Mobius多路通信系統(tǒng)的FPGA硬件實(shí)現(xiàn)。 另外,利用Chen-Mobius單路通信系統(tǒng)的調(diào)制、解調(diào)系統(tǒng)分別對語音信號進(jìn)行加密與解密,在兩塊DE2的FPGA開發(fā)板上成功實(shí)現(xiàn)了基于Chen-Mobius變換的語音加密雙工通信。完成本設(shè)計(jì)意義重大,它為今后Chen-Mobius通信系統(tǒng)應(yīng)用于通信領(lǐng)域的各個方面,邁開堅(jiān)實(shí)的一步。

    標(biāo)簽: ChenMobius FPGA 通信系統(tǒng) 硬件實(shí)現(xiàn)

    上傳時間: 2013-07-24

    上傳用戶:xaijhqx

  • FPGA布線算法的研究

    現(xiàn)場可編程門陣列(FPGA)是一種可實(shí)現(xiàn)多層次邏輯器件。基于SRAM的FPGA結(jié)構(gòu)由邏輯單元陣列來實(shí)現(xiàn)所需要的邏輯函數(shù)。FPGA中,互連線資源是預(yù)先定制的,這些資源是由各種長度的可分割金屬線,緩沖器和.MOS管實(shí)現(xiàn)的,所以相對于ASIC中互連線所占用的面積更大。為了節(jié)省芯片面積,一般都采用單個MOS晶體管來連接邏輯資源。MOS晶體管的導(dǎo)通電阻可以達(dá)到千歐量級,可分割金屬線段的電阻相對于MOS管來說是可以忽略的,然而它和地之間的電容達(dá)到了0.1pf[1]。為了評估FPGA的性能,用HSPICE仿真模型雖可以獲得非常精確的結(jié)果,但是基于此模型需要花費(fèi)太多的時間。這在基于時序驅(qū)動的工藝映射和布局布線以及靜態(tài)時序分析中都是不可行的。于是,非常迫切地需要一種快速而精確的模型。 FPGA中連接盒、開關(guān)盒都是由MOS管組成的。FPGA中的時延很大部分取決于互連,而MOS傳輸晶體管在互連中又占了很大的比重。所以對于MOS管的建模對FPGA時延估算有很大的影響意義。對于MOS管,Muhammad[15]采用導(dǎo)通電阻來代替MOS管,然后用。Elmore[3]時延和Rubinstein[4]時延模型估算互連時延。Elmore時延用電路的一階矩來近似信號到達(dá)最大值50%時的時延,而Rubinstein也是通過計(jì)算電路的一階矩估算時延的上下邊界來估算電路的時延,然而他們都是用來計(jì)算RC互連時延。傳輸管是非線性器件,所以沒有一個固定的電阻,這就造成了Elmore時延和Rubinstein時延模型的過于近似的估算,對整體評估FPGA的性能帶來負(fù)面因素。 本論文提出快速而精確的現(xiàn)場可編程門陣列FPGA中的互連資源MOS傳輸管時延模型。首先從階躍信號推導(dǎo)出適合50%時延的等效電阻模型,然后在斜坡輸入的時候,給出斜坡輸入時的時延模型,并且給出等效電容的計(jì)算方法。結(jié)果驗(yàn)證了我們精確的時延模型在時間上的開銷少的性能。 在島型FPGA中,單個傳輸管能夠被用來作為互連線和互連線之間的連接,或者互連線和管腳之間的連接,如VPR把互連線和管腳作為布線資源,管腳只能單獨(dú)作為輸入或者輸出管腳,以致于它們不是一個線網(wǎng)的起點(diǎn)就是線網(wǎng)的終點(diǎn)。而這恰恰忽略了管腳實(shí)際在物理上可以作為互連線來使用的情況(VPR認(rèn)為dogleg現(xiàn)象本身對性能提高不多)。本論文通過對dogleg現(xiàn)象進(jìn)行了探索,并驗(yàn)證了在使用SUBSET開關(guān)盒的情況下,dogleg能提高FPGA的布通率。

    標(biāo)簽: FPGA 布線 法的研究

    上傳時間: 2013-07-24

    上傳用戶:yezhihao

  • 多抽樣率數(shù)字信號處理及其FPGA實(shí)現(xiàn)

    多抽樣率信號處理是現(xiàn)代信號處理理論的一個重要分支,在最近十幾年取得了巨大的發(fā)展,并在很多方面得到了成功的應(yīng)用。本文分別從時域和頻域的角度深入分析了抽樣率變換的規(guī)律,并進(jìn)一步研究了多抽樣率系統(tǒng)的高效實(shí)現(xiàn)理論...

    標(biāo)簽: FPGA 抽樣 數(shù)字信號處理

    上傳時間: 2013-07-05

    上傳用戶:JIUSHICHEN

  • 單片機(jī)多功能調(diào)試助手V1.5.8

    單片機(jī)多功能調(diào)試助手一款集串口/USB/網(wǎng)絡(luò)調(diào)試、進(jìn)制轉(zhuǎn)換、字模與數(shù)碼管字型碼制作、常用校驗(yàn)值計(jì)算、UNICODE碼轉(zhuǎn)換、位圖輸出C文件等眾多功能于一身的綜合型調(diào)試軟件,最值得慶幸的是該軟件會一直保持更新,并支持在線升級功能,這樣大家手頭上的單片機(jī)多功能調(diào)試助手總是最新的! 單片機(jī)多功能調(diào)試助手與其他調(diào)試軟件有什么優(yōu)勢: 1) 一直保持為單文件狀態(tài),不會因?yàn)樾枰4媾渲眯畔⒍鴦?chuàng)建其他其他文件,所以該軟件非常容易攜帶。 2) 一直體貼著開發(fā)者,所有重要的配置在關(guān)閉該軟件時將會得到保存,重啟軟件后會重新導(dǎo)入以前的配置信息,免去重復(fù)選擇或填入數(shù)據(jù)的操作。 3) 集成了串口/USB/網(wǎng)絡(luò)調(diào)試功能,并在串口/USB/網(wǎng)絡(luò)調(diào)試的過程中,該軟件提供了監(jiān)視和多項(xiàng)發(fā)送功能。通過使用監(jiān)視端口的功能就可以清晰地分辨出發(fā)送與接收的數(shù)據(jù)的順序;通過使用多項(xiàng)發(fā)送功能就可以省去重復(fù)刪除或填寫待發(fā)送數(shù)據(jù)的步驟。 4) 在線升級功能是該軟件的最得意之處,理所當(dāng)然地也是開發(fā)者最倍受關(guān)注的功能。

    標(biāo)簽: 單片機(jī) 多功能 調(diào)試助手

    上傳時間: 2013-08-01

    上傳用戶:gaojiao1999

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