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多路開關(guān)

DDR2SDRAM存儲器接口設(shè)計

內(nèi)部存儲器負(fù)責(zé)計算機(jī)系統(tǒng)內(nèi)部數(shù)據(jù)的中轉(zhuǎn)、存儲與讀取，作為計算機(jī)系統(tǒng)中必不可少的三大件之一，它對計算機(jī)系統(tǒng)性能至關(guān)重要。內(nèi)存可以說是CPU處理數(shù)據(jù)的“大倉庫”，所有經(jīng)過CPU處理的指令和數(shù)據(jù)都要經(jīng)過內(nèi)存?zhèn)鬟f到電腦其他配件上，因此內(nèi)存性能的好壞，直接影響到系統(tǒng)的穩(wěn)定性和運(yùn)行性能。在當(dāng)今的電子系統(tǒng)設(shè)計中，內(nèi)存被使用得越來越多，并且對內(nèi)存的要求越來越高。既要求內(nèi)存讀寫速度盡可能的快、容量盡可能的大，同時由于競爭的加劇以及利潤率的下降，人們希望在保持、甚至提高系統(tǒng)性能的同時也能降低內(nèi)存產(chǎn)品的成本。面對這種趨勢，設(shè)計和實(shí)現(xiàn)大容量高速讀寫的內(nèi)存顯得尤為重要。因此，近年來內(nèi)存產(chǎn)品正經(jīng)歷著從小容量到大容量、從低速到高速的不斷變化，從技術(shù)上也就有了從DRAM到SDRAM，再到DDR SDRAM及DDR2 SDRAM等的不斷演進(jìn)。和普通SDRAM的接口設(shè)計相比，DDR2 SDRAM存儲器在獲得大容量和高速率的同時，對存儲器的接口設(shè)計也提出了更高的要求，其接口設(shè)計復(fù)雜度也大幅增加。一方面，由于I/O塊中的資源是有限的，數(shù)據(jù)多路分解和時鐘轉(zhuǎn)換邏輯必須在FPGA核心邏輯中實(shí)現(xiàn)，設(shè)計者可能不得不對接口邏輯進(jìn)行手工布線以確保臨界時序。而另一方面，不得不處理好與DDR2接口有關(guān)的時序問題（包括溫度和電壓補(bǔ)償）。要正確的實(shí)現(xiàn)DDR2接口需要非常細(xì)致的工作，并在提供設(shè)計靈活性的同時確保系統(tǒng)性能和可靠性。本文對通過Xilinx的Spartan3 FPGA實(shí)現(xiàn)DDR2內(nèi)存接口的設(shè)計與實(shí)現(xiàn)進(jìn)行了詳細(xì)闡述。通過Xilinx FPGA提供了I/O模塊和邏輯資源，從而使接口設(shè)計變得更簡單、更可靠。本設(shè)計中對I/O模塊及其他邏輯在RTL代碼中進(jìn)行了配置、嚴(yán)整、執(zhí)行，并正確連接到FPGA上，經(jīng)過仔細(xì)仿真，然后在硬件中驗證，以確保存儲器接口系統(tǒng)的可靠性。

標(biāo)簽： DDR2SDRAM 存儲器接口設(shè)計

上傳時間： 2013-06-08

上傳用戶：fairy0212
船用導(dǎo)航雷達(dá)數(shù)字信號處理設(shè)計

當(dāng)今的船用導(dǎo)航雷達(dá)具有數(shù)字化、多功能、高性能、多接口、網(wǎng)絡(luò)化。同時要求具有高可靠性、高集成度、低成本，信號處理單元的小型化，產(chǎn)品更新周期短。要同時滿足上述需求，高集成度的器件應(yīng)用是必須的。同時開發(fā)周期要短，需求軟件的可移植性要強(qiáng)，并且是模塊化設(shè)計，現(xiàn)場可編程門陣列器件(FPGA)已經(jīng)成為設(shè)計首選。現(xiàn)場可編程門陣列是基于通過可編程互聯(lián)連接的可配置邏輯塊(CLB)矩陣的可編程半導(dǎo)體器件。與為特殊設(shè)計而定制的專用集成電路(ASIC)相對，F(xiàn)PGA可以針對所需的應(yīng)用或功能要求進(jìn)行編程。雖然具有一次性可編程(OTP)FPGA，但是主要是基于SRAM的，其可隨著設(shè)計的演化進(jìn)行重編程。CLB是FPGA內(nèi)的基本邏輯單元。實(shí)際數(shù)量和特性會依器件的不同而不同，但是每個CLB都包含一個由4或6個輸入、一些選型電路(多路復(fù)用器等)和觸發(fā)器組成的可配置開關(guān)矩陣。開關(guān)矩陣是高度靈活的，可以進(jìn)行配置以便處理組合邏輯、移位寄存器或RAM。當(dāng)今的FPGA已經(jīng)遠(yuǎn)遠(yuǎn)超出了先前版本的基本性能，并且整合了常用功能(如RAM、時鐘管理和：DSP)的硬(ASIC型)塊。由于具有可編程特性，所以FPGA是眾多市場的理想之選。它高集成度，以及用于設(shè)計的強(qiáng)大軟件平臺、IP核、在線升級可滿足需求。本文介紹了基于FPGA實(shí)現(xiàn)船用導(dǎo)航雷達(dá)數(shù)字信號處理的設(shè)計，這是一個具體的、已經(jīng)完成并進(jìn)行小批量生產(chǎn)的產(chǎn)品，對指導(dǎo)實(shí)踐具有一定意義。

標(biāo)簽： 導(dǎo)航雷達(dá) 數(shù)字信號處理

上傳時間： 2013-04-24

上傳用戶：稀世之寶039
ChenMobius通信系統(tǒng)的FPGA硬件實(shí)現(xiàn)

自上個世紀(jì)九十年代以來，我國著名學(xué)者、現(xiàn)中國科學(xué)院院士、清華大學(xué)陳難先教授等人使用無窮級數(shù)的Mobius反演公式解決了一系列重要的物理學(xué)中的逆問題，開創(chuàng)了應(yīng)用、推廣數(shù)論中的Mobius變換解決物理學(xué)中各種逆問題的巧妙方法，其工作在1990年當(dāng)時就得到了世界著名的《NATURE》雜志的高度評價。華僑大學(xué)蘇武潯教授等則把Mobius變換的方法應(yīng)用于幾種常用波形(包括周期矩形脈沖，奇偶對稱方波和三角波等)的傅立葉級數(shù)的逆變換運(yùn)算，得到正、余弦函數(shù)及一般周期信號的各種常用波形的信號展開；并求得了與各種常用波形信號函數(shù)族相正交的函數(shù)族，以用于各展開系數(shù)的計算與信息的解調(diào)；而后把它們應(yīng)用到通信系統(tǒng)中，提出了一種新的通信系統(tǒng)，即新型Chen-Mobius通信系統(tǒng)。本文主要完成了兩個方面的工作,Chen-Mobius多路通信系統(tǒng)的FPGA硬件設(shè)計實(shí)現(xiàn)和基于Chen-Mobius變換的語音加密雙工通信系統(tǒng)的實(shí)現(xiàn)。首先，利用嵌入MATLAB\SIMULINK中的DSPBuilder軟件對Chen-Mobius多路(四路和八路)通信系統(tǒng)進(jìn)行仿真分析，對該系統(tǒng)在不同信噪比情況下的錯誤概率進(jìn)行了計算，并繪出了信噪比-錯誤概率曲線；其次，利用DSPBuilder中的Signalcompiler將Chen-Mobius多路通信系統(tǒng)的主體模塊(函數(shù)及積分器的產(chǎn)生等)轉(zhuǎn)化成HDL硬件語言，后在QuartusⅡ軟件平臺上，結(jié)合利用VHDL編程的硬件程序模塊(分頻、延時、控制模塊等)構(gòu)架完整的Chen-Mobius通信系統(tǒng)，并對此系統(tǒng)設(shè)計綜合、引腳分配、仿真驗證、時序分析等；最后，在Altera公司的Stratix 芯片上，實(shí)現(xiàn)硬件的編程和下載，從而完成了Chen-Mobius多路通信系統(tǒng)的FPGA硬件實(shí)現(xiàn)。另外，利用Chen-Mobius單路通信系統(tǒng)的調(diào)制、解調(diào)系統(tǒng)分別對語音信號進(jìn)行加密與解密，在兩塊DE2的FPGA開發(fā)板上成功實(shí)現(xiàn)了基于Chen-Mobius變換的語音加密雙工通信。完成本設(shè)計意義重大，它為今后Chen-Mobius通信系統(tǒng)應(yīng)用于通信領(lǐng)域的各個方面，邁開堅實(shí)的一步。

標(biāo)簽： ChenMobius FPGA 通信系統(tǒng) 硬件實(shí)現(xiàn)

上傳時間： 2013-07-24

上傳用戶：xaijhqx
應(yīng)用FPGA的高速數(shù)據(jù)采集

隨著計算機(jī)技術(shù)的突飛猛進(jìn)以及移動通訊技術(shù)在日常生活中的不斷深入，數(shù)據(jù)采集不斷地向多路、高速、智能化的方向發(fā)展。本文針對此需求，實(shí)現(xiàn)了一種應(yīng)用FPGA的多路、高速的數(shù)據(jù)采集系統(tǒng)，從而為測量儀器提供良好的采集數(shù)據(jù)。　　本文設(shè)計了一種基于AD+FPGA+DSP的多路數(shù)據(jù)采集處理系統(tǒng)，針對此系統(tǒng)設(shè)計了基于AD9446的模數(shù)轉(zhuǎn)換采集板，再將模數(shù)轉(zhuǎn)換采集板的數(shù)據(jù)傳送至基于FPGA的采集控制模塊進(jìn)行數(shù)據(jù)的壓縮以及緩沖存儲，最后由DSP調(diào)入數(shù)據(jù)進(jìn)行數(shù)據(jù)的處理。本文的設(shè)計主要分為兩部分，一部分為模數(shù)轉(zhuǎn)換采集板的設(shè)計與調(diào)試，另一部分為采集控制模塊的設(shè)計與仿真。　　經(jīng)設(shè)計與調(diào)試，模數(shù)轉(zhuǎn)換模塊可為系統(tǒng)提供穩(wěn)定可靠的數(shù)據(jù)，能穩(wěn)定工作在百兆的頻率下；采集控制模塊能實(shí)時地完成數(shù)據(jù)壓縮與數(shù)據(jù)緩沖，并能通過時鐘管理模塊來控制前端AD的采樣，該模塊也能穩(wěn)定工作在百兆的頻率下。該系統(tǒng)為多路、高速的數(shù)據(jù)采集系統(tǒng)，并能穩(wěn)定工作，從而能滿足電子測量儀器的要求。

標(biāo)簽： FPGA 高速數(shù)據(jù) 采集

上傳時間： 2013-05-24

上傳用戶：chuckbassboy
基于FPGA的多路光柵數(shù)據(jù)采集系統(tǒng)

隨著現(xiàn)代測控技術(shù)的發(fā)展，在精密測量領(lǐng)域，光柵傳感器在位移和角度測量中的使用越來越廣泛。由于受到光柵刻線工藝的限制，為了提高光柵傳感器的測量精度，往往需要使用電子方法對光柵信號進(jìn)行細(xì)分辨向和計數(shù)。而在實(shí)際測...

標(biāo)簽： FPGA 多路光柵數(shù)據(jù)采集系統(tǒng)

上傳時間： 2013-05-30

上傳用戶：夜月十二橋
VHDL源代碼下載

【經(jīng)典設(shè)計】VHDL源代碼下載～～其中經(jīng)典的設(shè)計有：【自動售貨機(jī)】、【電子鐘】、【紅綠燈交通信號系統(tǒng)】、【步進(jìn)電機(jī)定位控制系統(tǒng)】、【直流電機(jī)速度控制系統(tǒng)】、【計算器】、【點(diǎn)陣列LED顯示控制系統(tǒng)】基本數(shù)字邏輯設(shè)計有：【鎖存器】、【多路選擇器】、【三態(tài)門】、【雙向輸入|輸出端口】、【內(nèi)部（緩沖）信號】、【編碼轉(zhuǎn)換】、【加法器】、【編碼器/譯碼器】、【4位乘法器】、【只讀存儲器】、【RSFF觸發(fā)器】、【DFF觸發(fā)器】、【JKFF觸發(fā)器】、【計數(shù)器】、【分頻器】、【寄存器】、【狀態(tài)機(jī)】

標(biāo)簽： VHDL 源代碼

上傳時間： 2013-05-27

上傳用戶：shijiang
開關(guān)電源基本原理介紹

開關(guān)電源基本原理與設(shè)計介紹，臺達(dá)的資料，很好的

標(biāo)簽： 開關(guān) 電源基本

上傳時間： 2013-04-24

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proteus寫的實(shí)驗程序例子1

為優(yōu)秀的單片機(jī)仿真軟件proteus寫的實(shí)驗程序例子\r\n不但可以仿真mcu,外圍器件也可以仿真\r\n多路開關(guān)的實(shí)驗\r\n

標(biāo)簽： proteus 實(shí)驗程序

上傳時間： 2013-08-08

上傳用戶：bpgfl
調(diào)頻調(diào)制度監(jiān)視儀/監(jiān)視器/分析儀

該款立體聲調(diào)制度監(jiān)視儀/分析儀可以保證FM發(fā)射記優(yōu)質(zhì)工作和 FM 電臺保持在最大的調(diào)制電平或?qū)Πl(fā)射機(jī)的性能進(jìn)行檢測。根據(jù)全美和國際標(biāo)準(zhǔn)，該款監(jiān)視儀特設(shè)頻率合成的RF預(yù)選器，可按50KHZ檔預(yù)選頻率。精確的基帶解調(diào)，PLL 立體聲信道解碼，線性相位濾波器，為監(jiān)視調(diào)制度電平和性能的檢測提供了全面的方便的測試。多路音頻輸入可供檢測和外接失真儀。該款儀器外接天線時可與低電平 RF輸入端連接，也可經(jīng)傳輸線耦合到高電平 RF輸入端。

標(biāo)簽： 調(diào)頻調(diào)制監(jiān)視儀分析儀

上傳時間： 2013-11-15

上傳用戶：skhlm
波形及序列信號發(fā)生器設(shè)計

設(shè)計由555、移位寄存器、D/A轉(zhuǎn)換器、PLD等器件構(gòu)成的多路序列信號輸出和階梯波輸出的發(fā)生器電路，重點(diǎn)學(xué)習(xí)555、D/A轉(zhuǎn)換器及可編程邏輯器件的原理及應(yīng)用方法。用Proteus軟件仿真；實(shí)驗測試技術(shù)指標(biāo)及功能、繪制信號波形。

標(biāo)簽： 波形序列信號發(fā)生器

上傳時間： 2013-11-03

上傳用戶：crazyer

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