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多速率

  • 基于FPGA的多速率調制解調器的實現.rar

    隨著人們對于高速無線數據業務的急切需求以及新的無線通信技術的發展，頻譜資源匱乏問題日益嚴重。無線頻譜的緊缺已經成為限制無線通信與服務應用持續發展的瓶頸。認知無線電技術(Cognitive Radio)改變了傳統的固定頻譜分配方式，它以頻譜利用的高效性為目標，允許非授權用戶擇機利用授權用戶的頻譜空洞傳輸數據，以此來解決無線頻譜資源短缺的問題。它是具有自主尋找和使用空閑頻譜資源能力的智能無線電技術。本文的目標是在基于FPGA+DSP的系統硬件平臺上，以軟件編程的方式實現認知無線電數據傳輸的功能。 軟件無線電是實現認知無線電的理想平臺。本文首先闡述了軟件無線電的基本工作原理及關鍵技術途徑，對多速率信號處理中的內插和抽取、帶通采樣、數字下變頻、濾波等技術進行了分析與探討，為設計多速率調制解調系統提供了理論基礎。然后針對軟件無線電的要求給出了基于FPFA+DSP的系統設計硬件框圖，并對其中的部分硬件(FPGA、AD9857、AD9235)做了簡要的描述并給出其初始化過程。在理解基本概念和原理的基礎上，詳細論述了在系統硬件設計平臺上實現的π/4-DQPSK、8PSK、16QAM調制解調技術。本文給出了調制解調系統實現方案中的各個功能模塊(差分編、解碼，加同步頭、內插和成形濾波，下變頻，系統同步等)具體的設計方案和通過硬件編程實現了板級的仿真和最后的硬件實現，并對其中得到的數據進行分析，進一步驗證方案的可行性。最后介紹了通信板同頻譜感知板協同工作原理，依據頻譜感知板獲取的各個信道狀況自適應的選擇π/4-DQPSK、8PSK、16QAM調制解調方式并在FPGA上實現了其中部分功能。

    標簽： FPGA 多速率 調制解調器

    上傳時間： 2013-05-30

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  • 自適應多速率AMR技術剖析

    自適應多速率AMR技術剖析 自適應多速率AMR技術剖析

    標簽： AMR 自適應多速率

    上傳時間： 2013-10-22

    上傳用戶：司令部正軍級

  • 基于matlab的多速率信號處理程序

    基于matlab的多速率信號處理程序，希望對大家有幫助。

    標簽： matlab 多速率 信號處理 程序

    上傳時間： 2013-12-18

    上傳用戶：dengzb84

  • amr（自動多速率）窄帶語音編碼源程序

    amr（自動多速率）窄帶語音編碼源程序，適用于linux環境

    標簽： amr 自動 多速率 窄帶

    上傳時間： 2015-11-27

    上傳用戶：sssl

  • amr（自動多速率）寬帶語音編碼源程序

    amr（自動多速率）寬帶語音編碼源程序，適用于linux環境

    標簽： amr 自動 多速率 寬帶

    上傳時間： 2015-11-27

    上傳用戶：zmy123

  • 詳細介紹多速率數字信號處理的理論

    詳細介紹多速率數字信號處理的理論，對專業人士的理論提高有極大幫助。

    標簽： 詳細介紹 多速率 數字信號處理

    上傳時間： 2013-12-22

    上傳用戶：wcl168881111111

  • blackfin 533 DSP上優化的多速率數字濾波程序源碼。

    blackfin 533 DSP上優化的多速率數字濾波程序源碼。

    標簽： blackfin 533 DSP 多速率

    上傳時間： 2016-11-16

    上傳用戶：181992417

  • 研究了多速率mesh網絡中節點的吞吐量.:提出了多速率無線Mesh網絡中節點吞吐量分析模型,用以分析在公平性保證條件下基于IEEE 802·11協 議構建的無線Mesh網絡節點吞吐量.該模型計算出不

    研究了多速率mesh網絡中節點的吞吐量.:提出了多速率無線Mesh網絡中節點吞吐量分析模型,用以分析在公平性保證條件下基于IEEE 802·11協 議構建的無線Mesh網絡節點吞吐量.該模型計算出不同速率無線鏈路發送數據包的時間,尋找網絡中單位時間 內完成數據包發送時間最大的瓶頸沖突域,根據瓶頸沖突域內負載流量速率得到節點吞吐量最大值.仿真結果表 明,該方法計算出的節點最大吞吐量與網絡仿真結果一致,可以準確分析多速率無線Mesh網絡節點吞吐量.

    標簽： Mesh mesh IEEE 吞吐量

    上傳時間： 2014-07-09

    上傳用戶：refent

  • 基于FPGA的嵌入式系統SerialATA大容量數據存儲控制器的研究.rar

    隨著信息技術的飛速發展，數據吞吐量急劇增長，要求有更高的傳輸速度，來滿足大量數據的傳輸，而原有的并行數據傳輸總線結構上存在自身無法克服的缺陷，在高頻環境下容易串擾，而增大誤碼率。SATA串行總線技術應運而生。作為一種新型的總線接口，它提供了高達3.0Gbps的數據傳輸速率，使用8B/10B編碼格式，采用LVDS NRZ串行數據傳輸方式，有良好的抗干擾性能，有更強的達到32位的循環冗余校驗，并且提供了良好的物理接口特性，支持熱拔插，代表著計算機總線接口技術的發展方向。FPGA作為一種低功耗的半導體器件，在高頻工作環境中有優良的性能，將處理器與低功耗FPGA結合起來使用是數據存儲應用的趨勢，這樣能夠使得接口方案更加靈活。而在眾多FPGA器件中，Xilinx公司的Virtex-4平臺內部集成了PowerPC高性能處理器，并且其中提供了Rocket IO MGT這種嵌入式的多速率串行收發器，能夠以6.25-622Mb/s的速度傳送數據，并且支持包括SATA協議在內的多種串行通信協議。 本文從物理層、鏈路層、傳輸層分析了SATA1.0技術的接口協議，在此基礎提出滿足協議需求和適合FPGA設計的設計方案，并給出總體設計框圖，依照FPGA的設計方法，采用Xilinx公司的Virtex-4設計了一個符合SATA1.0接口協議的嵌入式存儲裝置，實現數據的存儲，仿真運行結果正常。

    標簽： SerialATA FPGA 嵌入式系統

    上傳時間： 2013-04-24

    上傳用戶：sz_hjbf

  • 基于FPGA的8PSK調制解調技術研究.rar

    軟件無線電是近年提出的新的通信體系，由于其具有靈活性和可重配置性并且符合通信的發展趨勢，已成為通信系統設計的研究熱點。因此對基于軟件無線電的調制解調技術進行深入細致的研究非常有意義。 本文首先從闡述軟件無線電的理論基礎入手，對多速率信號處理中的內插和抽取、帶通采樣、數字變頻等技術進行了分析與探討，為設計和實現8PSK調制解調器提供了非常重要的理論依據。然后，研究了8PSK調制解調技術，詳細論述了它們的基本概念和原理，提出了系統實現方案，在DSP+FPGA平臺上實現了8PSK信號的正確調制解調。文中著重研究了突發通信的同步和頻偏糾正算法，針對同步算法選取了一種基于能量檢測法的快速位同步算法，采用相關器實現，同時實現位同步和幀同步。并且對于突發通信的多普勒頻偏糾正，設計了一個基于自動頻率控制(AFC)環的頻偏檢測器，通過修改數控振蕩器(NCO)的頻率控制字方法來校正本地載波頻率，整個算法結構簡單，運算量小，頻偏校正速度快，具有較好的實用性。其次，對相干解調的初始相位進行糾正時，提出了一種簡單易行的CORDIC方法，同時對FPGA編程當中的一些關鍵問題進行了介紹。最后，設計了自適應調制解調器，根據信噪比和誤碼率來自適應的改變調制方式，以達到最佳的傳輸性能。

    標簽： FPGA 8PSK 調制解調

    上傳時間： 2013-04-24

    上傳用戶：mingaili888

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