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如何設(shè)計

  • 電子連接器設(shè)計基礎(chǔ) 35頁 1.3M.ppt

    實用電子技術(shù)專輯 385冊 3.609G電子連接器設(shè)計基礎(chǔ) 35頁 1.3M.ppt

    標(biāo)簽:

    上傳時間: 2014-05-05

    上傳用戶:時代將軍

  • 開關(guān)電源基本原理與設(shè)計介紹 62頁 2.3M ppt.ppt

    開關(guān)電源相關(guān)專輯 119冊 749M開關(guān)電源基本原理與設(shè)計介紹 62頁 2.3M ppt.ppt

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    上傳時間: 2014-05-05

    上傳用戶:時代將軍

  • MP3 PCB布局設(shè)計指南.pdf

    MP3 PCB布局設(shè)計指南.pdf 只供學(xué)習(xí)之用

    標(biāo)簽: MP3 PCB pdf 布局

    上傳時間: 2018-04-17

    上傳用戶:yulin3192

  • MP3 PCB布局設(shè)計指南

    印刷電路板(PCB )設(shè)計佈局指南,主要應(yīng)用註釋

    標(biāo)簽: mp3 pcb

    上傳時間: 2021-11-30

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  • 58.8V7A.設(shè)計筆記

    58.8V7A.設(shè)計筆記 UCC38051D(SOIC-8) PFC 功率拓?fù)湓O(shè)計

    標(biāo)簽: 58 8v7a

    上傳時間: 2021-12-04

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  • 開關(guān)電源的PCB設(shè)計規(guī)范.PDF

    開關(guān)電源的PCB設(shè)計規(guī)范.PDF

    標(biāo)簽: pcb 開關(guān)電源

    上傳時間: 2021-12-12

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  • 了解軟體設(shè)計RF儀器的優(yōu)點

    本技術(shù)文章將介紹如何運用 NI LabVIEW FPGA 來設(shè)計並客製化個人的 RF 儀器,同時探索軟體設(shè)計儀器可為測試系統(tǒng)所提供的優(yōu)勢。

    標(biāo)簽: 軟體 RF儀器

    上傳時間: 2013-11-24

    上傳用戶:toyoad

  • 說明 除了自身之外

    說明 除了自身之外,無法被其它整數(shù)整除的數(shù)稱之為質(zhì)數(shù),要求質(zhì)數(shù)很簡單,但如何快速的求出質(zhì)數(shù)則一直是程式設(shè)計人員與數(shù)學(xué)家努力的課題,在這邊介紹一個著名的 Eratosthenes求質(zhì)數(shù)方法 解。 以背包問題為例,我們使用兩個陣列value與item,value表示目前的最佳解所得之總價,item表示最後一個放至背包的水果,假設(shè)有負(fù)重量 1~8的背包8個,並對每個背包求其最佳解。

    標(biāo)簽:

    上傳時間: 2013-12-22

    上傳用戶:二驅(qū)蚊器

  • 學(xué)會一個程式語言

    學(xué)會一個程式語言,是一回事兒;學(xué)會如何以此語言設(shè)計並實作出有效的程式,又是一回事兒。C++ 尤其如此,因為它很不尋常地涵蓋了罕見的威力和豐富的表現(xiàn)力,不但建立在一個全功能的傳統(tǒng)語言(C)之上,更提供極為廣泛的物件導(dǎo)向(object-oriented)性質(zhì),以及對templates 和exceptions(異常狀態(tài))的支援。

    標(biāo)簽: 程式

    上傳時間: 2013-12-09

    上傳用戶:ANRAN

  • cadence-allegro16.6高級教程

    主要內(nèi)容介紹 Allegro 如何載入 Netlist,進而認(rèn)識新式轉(zhuǎn)法和舊式轉(zhuǎn)法有何不同及優(yōu)缺點的分析,透過本章學(xué)習(xí)可以對 Allegro 和 Capture 之間的互動關(guān)係,同時也能體驗出 Allegro 和 Capture 同步變更屬性等強大功能。Netlist 是連接線路圖和 Allegro Layout 圖檔的橋樑。在這裏所介紹的 Netlist 資料的轉(zhuǎn)入動作只是針對由 Capture(線路圖部分)產(chǎn)生的 Netlist 轉(zhuǎn)入 Allegro(Layout部分)1. 在 OrCAD Capture 中設(shè)計好線路圖。2. 然後由 OrCAD Capture 產(chǎn)生 Netlist(annotate 是在進行線路圖根據(jù)第五步產(chǎn)生的資料進行編改)。 3. 把產(chǎn)生的 Netlist 轉(zhuǎn)入 Allegro(layout 工作系統(tǒng))。 4. 在 Allegro 中進行 PCB 的 layout。 5. 把在 Allegro 中產(chǎn)生的 back annotate(Logic)轉(zhuǎn)出(在實際 layout 時可能對原有的 Netlist 有改動過),並轉(zhuǎn)入 OrCAD Capture 裏進行回編。

    標(biāo)簽: cadence allegro

    上傳時間: 2022-04-28

    上傳用戶:kingwide

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