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存儲(chǔ)器編程

  • 用VHDL語言描述的用鎖存器

    用VHDL語言描述的用鎖存器,加法計數器,ROM存儲器構成的RTL圖

    標簽: VHDL 語言 鎖存器

    上傳時間: 2013-12-12

    上傳用戶:vodssv

  • 周立功Magic2410實驗箱光盤源碼 第5章Linux應用程序編寫 5.1 HelloWorld程序實驗 5.2 Linux定時器實驗 5.3多進程實驗 5.4多線程實驗 5.5文件和目

    周立功Magic2410實驗箱光盤源碼 第5章Linux應用程序編寫 5.1 HelloWorld程序實驗 5.2 Linux定時器實驗 5.3多進程實驗 5.4多線程實驗 5.5文件和目錄操作實驗 5.6 UDP實驗 5.7 TCP實驗 5.8 Webserver實驗

    標簽: Linux HelloWorld Magic 實驗

    上傳時間: 2014-01-25

    上傳用戶:fnhhs

  • C編譯器CodeVersion實作驅動LCD 128*64 MICRO_Controller :ATmega16L

    C編譯器CodeVersion實作驅動LCD 128*64 MICRO_Controller :ATmega16L

    標簽: MICRO_Controller CodeVersion ATmega 128

    上傳時間: 2013-12-26

    上傳用戶:xieguodong1234

  • 一個基于51單片機的鎖存器代碼.附帶電路圖

    一個基于51單片機的鎖存器代碼.附帶電路圖

    標簽: 51單片機 鎖存器 代碼 電路圖

    上傳時間: 2014-01-14

    上傳用戶:壞壞的華仔

  • 多線程簡單下載器 j2se實現 多線程簡單下載器 j2se實現

    多線程簡單下載器 j2se實現 多線程簡單下載器 j2se實現

    標簽: j2se 多線程 下載器

    上傳時間: 2014-01-06

    上傳用戶:熊少鋒

  • 計數器,分頻器,鎖存器,驅動器分冊 338頁 5.7M.pdf

    器件數據手冊專輯 120冊 2.15G計數器,分頻器,鎖存器,驅動器分冊 338頁 5.7M.pdf

    標簽:

    上傳時間: 2014-05-05

    上傳用戶:時代將軍

  • STM32F4 定時器中斷實驗例程

    STM32F4 定時器中斷實驗例程,有需要的可以參考!

    標簽: stm32f4 定時器 中斷

    上傳時間: 2022-04-16

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  • 一種16位音頻SigmaDelta模數轉換器的研究與設計.rar

    Sigma-Delta A/D轉換器利用過采樣,噪聲整形和數字濾波技術,有效衰減了輸出信號帶內的量化噪聲,提高了信噪比。與傳統的Nyquist轉換器相比,它降低了對模擬電路性能指標和元件精度的要求,簡化了模擬電路的設計,降低了生產成本。 本論文在對Sigma-Delta A/D轉換器原理研究的基礎上,基于TSMC0.18um工藝,采用1.8V工作電源,128倍的過采樣率,6.4MHz的采樣頻率,設計了一個主要應用于音頻信號處理的Sigma-Delta A/D轉換器,分辨率達到16位。在調制器的設計中,本文采用了多級噪聲整形MASH(2-1)級聯調制器結構,同時,考慮了各種非理想因素對系統性能的影響,在SDtoolbox工具的幫助下使用Simulink進行調制器系統設計。并使用Cadence Spectre對模塊電路進行設計仿真,包括運放,比較器,帶隙基準電壓源,CMOS開關,非交疊時鐘產生電路等。在數字抽取濾波器的設計中,采用了分級抽取技術,使用MATLAB軟件中的SPTool和FDATool工具對各級抽取濾波器進行優化設計。并在原有的濾波器算法的基礎上,采用了CIC濾波器和半帶濾波器,設計出了運算量和存儲量都相對少的三級抽取濾波器系統,大大降低了功耗和面積。 論文的仿真結果表明,所設計的Sigma-Delta A/D轉換器信噪比達到102.3dB,滿足系統需要的16位精度要求。 關鍵詞:Sigma-Ddta; 信噪比; 多級噪聲整形; 數字抽取濾波器

    標簽: SigmaDelta 音頻 模數轉換器

    上傳時間: 2013-06-27

    上傳用戶:songyuncen

  • MP3音頻解碼器的FPGA原型芯片設計與實現.rar

    MP3音樂是目前最為流行的音樂格式,因其音質、復雜度與壓縮比的完美折中,占據著廣闊的市場,不僅在互聯網上廣為流傳,而且在便攜式設備領域深受人們喜愛。本文以MPEG-1的MP3音頻解碼器為研究對象,在實時性、面積等約束條件下,研究MP3解碼電路的設計方法,實現FPGA原型芯片,研究MP3原型芯片的驗證方法。 論文的主要貢獻如下: (1)使用算法融合方法合并MP3解碼過程的相關步驟,以減少緩沖區存儲單元的容量和訪存次數。如把重排序步驟融合到反量化模塊,可以減少一半的讀寫RAM操作;把IMDCT模塊內部的三個算法步驟融合在一起進行設計,可以省去存儲中間計算結果的緩存區單元。 (2)反量化、立體聲處理等模塊中,采用流水線設計技術,設置寄存器把較長的組合邏輯路徑隔開,提高了電路的性能和可靠性;使用連續訪問公共緩存技術,合理規劃各計算子模塊的工作時序,將數據計算的時間隱藏在訪存過程中;充分利用頻率線的零值區特性,有效地減少數據計算量,加快了數據處理的速度。 (3)設計了MP3硬件解碼器的FPGA原型芯片。采用Verilog HDL硬件描述語言設計RTL級電路,完成功能仿真,以Altera公司Stratix II系列的EP2S180 FPGA開發板為平臺,實現MP3解碼器的FPGA原型芯片。MP3硬件解碼器在Stratix II EP2S180器件內的資源利用率約為5%,其中組合邏輯查找表ALUT為7189個,寄存器共有4024個,系統頻率可達69.6MHz,充分滿足了MP3解碼過程的實時性要求。實驗結果表明,MP3音頻解碼FPGA原型芯片可正常播放聲音,解碼音質良好。

    標簽: FPGA MP3 音頻解碼器

    上傳時間: 2013-07-01

    上傳用戶:xymbian

  • 并行輸出10位模數轉換器TLC1551的原理與應用

    TLC1551是美國TI公司生產的10位并行輸出模數轉換器,該器件轉換速度快,傳輸數據方便,應用電路簡單.文中介紹了TLC1551的管腳功能、電氣特性、工作原理和時序、應用電路及模數轉換的單片機基本程

    標簽: 1551 TLC 并行 輸出

    上傳時間: 2013-07-26

    上傳用戶:amwfhv

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