使用FPGA設(shè)計(jì)WiMax接收機(jī)之OFDM同步硬體電路(內(nèi)附VHDL code)
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安全設(shè)計(jì)技術(shù)資料
?? 資源總數(shù)：2955
?? 源代碼：4306
?? 安全設(shè)計(jì)全部資料 (2955個(gè))
一個(gè)簡單的游戲設(shè)計(jì)...好好玩的
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這是一個(gè)修改Oreilly Java 網(wǎng)路程式設(shè)計(jì)範(fàn)例的程式 主要是將裡面的一個(gè)小程式加上視窗管理者介面方便使用 使用環(huán)境： 需有JRE的環(huán)境 path需有指到JAVA_HOME下bin/
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最新程序最好的在線程序設(shè)計(jì) 建議同學(xué)們好好看看。最好的
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由遠(yuǎn)峰公司所設(shè)計(jì)的燒入flash軟體,歡迎使用2410/2440可用
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UML 2 for Dummies ( UML 理想設(shè)計(jì)方案 )
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TFT設(shè)計(jì)原理應(yīng)用設(shè)計(jì)
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圖形話介面顯示設(shè)計(jì), 主要透過Embedded Visual C
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使用硬體描述語言HDL 設(shè)計(jì)硬體電路
使用硬體描述語言HDL 設(shè)計(jì)硬體電路，臺(tái)灣人寫的PPT講義，非常不錯(cuò)。VHDL硬件設(shè)計(jì)入門學(xué)習(xí)。VHDL基本語法架構(gòu)，VHDL的零件庫(Library)及包裝(Package)等內(nèi)容。...
clock_spliter 採用彈性設(shè)計(jì) , 可調(diào)整週期寬度.
clock_spliter 採用彈性設(shè)計(jì) , 可調(diào)整週期寬度....