使用硬體描述語(yǔ)言HDL 設(shè)計(jì)硬體電路，臺(tái)灣人寫的PPT講義，非常不錯(cuò)。VHDL硬件設(shè)計(jì)入門學(xué)習(xí)。VHDL基本語(yǔ)法架構(gòu)，VHDL的零件庫(kù)(Library)及包裝(Package)等內(nèi)容。
標(biāo)簽： HDL
上傳時(shí)間： 2014-01-22
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clock_spliter 採(cǎi)用彈性設(shè)計(jì) , 可調(diào)整週期寬度.
標(biāo)簽： clock_spliter
上傳時(shí)間： 2013-12-27
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FPGA可促進(jìn)嵌入式系統(tǒng)設(shè)計(jì)改善即時(shí)應(yīng)用性能，臺(tái)灣人寫的，關(guān)于FPGA應(yīng)用的技術(shù)文章
標(biāo)簽： FPGA 嵌入式 系統(tǒng) 性能
上傳時(shí)間： 2014-01-17
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《Windows 95 系統(tǒng)程式設(shè)計(jì) 大奧秘》PDF書含例子 .rar是候捷翻譯的一本好書
標(biāo)簽： Windows 95
上傳時(shí)間： 2014-11-14
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介紹Quartus II 6.0使用指南。哈爾濱工程大學(xué)信息與通信工程學(xué)院
標(biāo)簽： Quartus 6.0 II 使用指南
上傳時(shí)間： 2013-12-28
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_Wiley_Synthesis_of_Arithmetic_Circuits_-_FPGA_ASIC_and_Embedded_Systems_(2006)_-_DDU一些硬體設(shè)計(jì)教學(xué)文件
標(biāo)簽： Wiley_Synthesis_of_Arithmetic_Cir FPGA_ASIC_and_Embedded_Systems cuits 2006
上傳時(shí)間： 2016-06-13
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javascript範(fàn)例show 表單設(shè)計(jì).動(dòng)態(tài)表現(xiàn)
標(biāo)簽： javascript show
上傳時(shí)間： 2016-07-02
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MatLab工具箱應(yīng)用指南：控制工程篇_10912150,希望對(duì)大家有幫助。
標(biāo)簽： 10912150 MatLab 工具箱 家
上傳時(shí)間： 2016-07-07
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軟件工程開(kāi)發(fā)文檔指南，指導(dǎo)程序開(kāi)發(fā)人員系統(tǒng)分析設(shè)計(jì)時(shí)進(jìn)行寫文檔
標(biāo)簽： 軟件工程 文檔
上傳時(shí)間： 2016-07-15
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delphi登陸窗體的制作,就我知道的,可以有兩種方法,一種是在工程文件中實(shí)現(xiàn)登陸窗體的動(dòng)態(tài)調(diào)用,另一種就是在主窗體的OnCreate事件中動(dòng)態(tài)創(chuàng)建登陸窗體,兩種方法都需要將主窗體設(shè)置為Auto-create form,將登陸窗體設(shè)
標(biāo)簽： OnCreate Auto-cr delphi 工程
上傳時(shí)間： 2016-08-04
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