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巴特沃茲

  • 實現了巴特沃斯濾波。用C語言寫的。實現了巴特沃斯濾波。用C語言寫的。

    實現了巴特沃斯濾波。用C語言寫的。實現了巴特沃斯濾波。用C語言寫的。

    標簽: 巴特沃斯 C語言 濾波

    上傳時間: 2017-09-26

    上傳用戶:sy_jiadeyi

  • 巴特沃斯低通濾波器的設計

    設計一個模擬低通巴特沃斯濾波器,我們用MATLAB語言來實現功能  

    標簽: 巴特沃斯 低通濾波器

    上傳時間: 2016-05-18

    上傳用戶:sssforever

  • 有源濾波器精確設計手冊第102頁4階MFB巴特沃斯帶通濾波器例子的計算

    有源濾波器精確設計手冊第107頁2階MFB巴特沃斯帶通濾波器例子的計算

    標簽: 有源濾波器

    上傳時間: 2022-06-01

    上傳用戶:

  • 有源濾波器精確設計手冊第107頁2階MFB巴特沃斯帶通濾波器例子的計算

    有源濾波器精確設計手冊第107頁2階MFB巴特沃斯帶通濾波器例子的計算

    標簽: 有源濾波器

    上傳時間: 2022-06-02

    上傳用戶:

  • 有源濾波器精確設計手冊第21頁MFB巴特沃斯低通濾波器例子的計算

    有源濾波器精確設計手冊第21頁MFB巴特沃斯低通濾波器例子的計算

    標簽: 濾波器 MFB 低通

    上傳時間: 2022-06-03

    上傳用戶:wangshoupeng199

  • 巴特渥斯濾波器設計(butterworth),根據設計參數需要,設計出符合要求的濾波器,并提供示意圖

    巴特渥斯濾波器設計(butterworth),根據設計參數需要,設計出符合要求的濾波器,并提供示意圖

    標簽: butterworth 波器設計 設計參數 濾波器

    上傳時間: 2013-12-29

    上傳用戶:古谷仁美

  • DSP中巴特沃思濾波器的設計使用Verilog編寫.

    DSP中巴特沃思濾波器的設計使用Verilog編寫.

    標簽: Verilog DSP 濾波器 編寫

    上傳時間: 2015-05-06

    上傳用戶:三人用菜

  • 本源碼是用于現代譜估計的一種方法:巴特利特主分量估計算法

    本源碼是用于現代譜估計的一種方法:巴特利特主分量估計算法,對3個頻率進行分辨。

    標簽: 源碼 估計算法 譜估計

    上傳時間: 2016-08-10

    上傳用戶:busterman

  • 電渦流式電纜偏心檢測技術的研究.rar

    電纜偏心嚴重影響電纜的質量,因此在電纜生產時必須要進行偏心檢測。該文針對目前我國電纜偏心檢測技術落后的現狀,提出采用電渦流檢測方法來研制可以對電纜進行在線實時偏心檢測的自動化系統,并對此項檢測技術進行了詳細研究。 該文先從偏心傳感器、數據采集器和上位機系統三大部分對電渦流式電纜偏心檢測系統進行了整體設計。完成了偏心傳感器探頭的設計并解決了偏心傳感器振蕩電路的電源供應問題和信號從旋轉部件到靜止部件的傳輸問題。以TLC2543A/D轉換器和AT89C52單片機為核心器件設計了數據采集器,完成模擬信號到數字信號的轉換,并通過RS-232串行通訊把采樣數據傳輸給PC機。利用VisualBasic語言開發了軟件系統,對接收的數據進行了處理并對結果進行了輸出顯示。 為了提高檢測系統的精度,系統中采用了模擬濾波器和數字濾波器。根據檢測系統中信號的特點,分別確定了模擬濾波器和數字濾波器的性能指標,設計了抗混疊的3階巴特沃思模擬濾波器和5階橢圓型ⅡR低通數字濾波器,并采用適當的方法進行了實現。在靜態的電纜偏心檢測實驗系統中對濾波器的性能進行了驗證。 偏心傳感器是檢測系統中的關鍵部件,它的性能至關重要。該文通過構造的靜態實驗系統對偏心傳感器的性能進行了研究,分析了被測電纜線芯直徑、檢測線圈的匝數和檢測探頭的尺寸對偏心傳感器性能的影響。

    標簽: 電渦流 檢測技術 電纜

    上傳時間: 2013-06-19

    上傳用戶:yt1993410

  • 基于FPGA的DDS信號源設計.rar

    作為電子類專業學生,實驗是提高學生對所學知識的印象以及發現問題和解決問題的能力,增加學生動手能力的必須環節。本設計的目的就是開發一套滿足學生實驗需求的信號源,基于此目的本信號源并不需要突出的性能,但經濟上要求低成本,同時要求操作簡單,能夠輸出多種波形,并且利于學生在此平臺上認識信號源原理,同時方便在此平臺上進行拓展開發。 設計中運用虛擬儀器技術將計算機屏幕作為儀器面板,采用EPP接口,同時在FPGA上開發控制電路,為后續開發留下了空間,同時節省了成本。本設計采用地址線16位,數據線12位的靜態RAM作為信號源的波形存儲器,后端采用兩種濾波類型對需要濾波的信號進行濾波。啟動信號時軟件需要先將波形數據預存在存儲器中便于調用,最后得到的結果基本滿足教學實驗的需求。 本文結構上首先介紹了直接采用DDS芯片制作信號源的利弊,及作者采用這種設計的初衷,然后介紹了信號源的整體結構,總體模塊。以下章節首先介紹FPGA內部設計,包括總體結構和幾大部分模塊,包括:時鐘產生電路,相位累加器,數據輸入控制電路,濾波器控制電路,信號源啟動控制電路。 然后介紹了其他模塊的設計,包括存儲器選擇,幅度控制電路的設計以及濾波器電路的設計,本設計的幅度控制采用兩級DA級聯,以及后端電阻分壓網絡調節的方式進行設計,提高了幅度調節的范圍。對于濾波器的設計,依據不同的信號頻率,分成了4個部分,對于500K以下的信號采用的是二階巴特沃斯有源低通濾波,對于500K以上至5M以下信號采用的五階RC低通濾波器。 在軟件設計部分,分成兩個部分,對于底層驅動程序采用以Labwindows/CVI為平臺進行開發,利用其編譯和執行速度快,并且和LabVIEW能夠很好連接的特性。對于上層控制軟件,采用以LabVIEW為平臺進行開發,充分利用其圖化設計,易于擴展。 論文最后對所做工作進行了總結,提出了進一步改進的方向。

    標簽: FPGA DDS 信號源

    上傳時間: 2013-04-24

    上傳用戶:afeiafei309

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