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帶<b>屏蔽</b>千兆網(wǎng)口RJ45

(1) 、用下述兩條具體規(guī)則和規(guī)則形式實(shí)現(xiàn).設(shè)大寫字母表示魔王語言的詞匯小寫字母表示人的語言詞匯希臘字母表示可以用大寫字母或小寫字母代換的變量.魔王語言可含人的詞匯. (2) 、B→tAdA A

(1) 、用下述兩條具體規(guī)則和規(guī)則形式實(shí)現(xiàn).設(shè)大寫字母表示魔王語言的詞匯小寫字母表示人的語言詞匯希臘字母表示可以用大寫字母或小寫字母代換的變量.魔王語言可含人的詞匯. (2) 、B→tAdA A→sae (3) 、將魔王語言B(ehnxgz)B解釋成人的語言.每個(gè)字母對(duì)應(yīng)下列的語言.

標(biāo)簽： 字母 tAdA 語言詞匯

上傳時(shí)間： 2013-12-30

上傳用戶：ayfeixiao
1.有三根桿子A,B,C。A桿上有若干碟子 2.每次移動(dòng)一塊碟子,小的只能疊在大的上面 3.把所有碟子從A桿全部移到C桿上經(jīng)過研究發(fā)現(xiàn)

1.有三根桿子A,B,C。A桿上有若干碟子 2.每次移動(dòng)一塊碟子,小的只能疊在大的上面 3.把所有碟子從A桿全部移到C桿上經(jīng)過研究發(fā)現(xiàn)，漢諾塔的破解很簡(jiǎn)單，就是按照移動(dòng)規(guī)則向一個(gè)方向移動(dòng)金片：如3階漢諾塔的移動(dòng)：A→C,A→B,C→B,A→C,B→A,B→C,A→C 此外，漢諾塔問題也是程序設(shè)計(jì)中的經(jīng)典遞歸問題

標(biāo)簽： 移動(dòng) 發(fā)現(xiàn)

上傳時(shí)間： 2016-07-25

上傳用戶：gxrui1991
1. 下列說法正確的是（） A. Java語言不區(qū)分大小寫 B. Java程序以類為基本單位 C. JVM為Java虛擬機(jī)JVM的英文縮寫 D. 運(yùn)行Java程序需要先安裝JDK

1. 下列說法正確的是（） A. Java語言不區(qū)分大小寫 B. Java程序以類為基本單位 C. JVM為Java虛擬機(jī)JVM的英文縮寫 D. 運(yùn)行Java程序需要先安裝JDK 2. 下列說法中錯(cuò)誤的是 ( ) A. Java語言是編譯執(zhí)行的 B. Java中使用了多進(jìn)程技術(shù) C. Java的單行注視以//開頭 D. Java語言具有很高的安全性 3. 下面不屬于Java語言特點(diǎn)的一項(xiàng)是( ) A. 安全性 B. 分布式 C. 移植性 D. 編譯執(zhí)行 4. 下列語句中，正確的項(xiàng)是 ( ) A . int $e,a,b=10 B. char c,d=’a’ C. float e=0.0d D. double c=0.0f

標(biāo)簽： Java A. B. C.

上傳時(shí)間： 2017-01-04

上傳用戶：netwolf
工業(yè)領(lǐng)域串口通信速度慢是個(gè)比較突出的問題

工業(yè)領(lǐng)域串口通信速度慢是個(gè)比較突出的問題，而 F T 2 4 5 B M 能夠進(jìn)行 US B和并行 I ／ O口之間的協(xié)議轉(zhuǎn)換，在一些條件下能夠取代串口．介紹 F T 2 4 5 B M 芯片的工作原理和功能，并給出基于 F T2 4 5 B M 的 US B接口電路的應(yīng)用設(shè)計(jì)和基于 8 9 c 5 2的匯編及 c 5 1 單片機(jī)源程序．

標(biāo)簽： 工業(yè)領(lǐng)域串口通信速度比較

上傳時(shí)間： 2017-05-27

上傳用戶：kytqcool
HP ProCurve Switch 2810系列簡(jiǎn)述

產(chǎn)品概述HP ProCurve Switch 2810系列包括兩款機(jī)型：帶有 20個(gè)10/100/1000端口的24端口HP ProCurve Switch 2810-24G和帶有44個(gè)10/100/1000端口的48端口HP ProCurve Switch 2810-48G。每款交換機(jī)還配有4個(gè)雙功能定制端口，可用于RJ-45 10/100/1000或mini-GBIC光纖千兆連接。2810系列交換機(jī)可提供出色的訪問安全性、高級(jí)優(yōu)先化和流量監(jiān)控能力，因而是高性能、安全10/100/1000連接的理想選擇。此外，它還價(jià)格經(jīng)濟(jì)、簡(jiǎn)單易用，帶有1U可堆疊外形，即使應(yīng)用于更小的布線室內(nèi)，也便于靈活操作。

標(biāo)簽： ProCurve Switch 2810 HP

上傳時(shí)間： 2013-11-24

上傳用戶：tiantwo
pcie_cn (pcie基本概念及其工作原理介紹)

pcie基本概念及其工作原理介紹：PCI Express®（或稱PCIe®），是一項(xiàng)高性能、高帶寬，此標(biāo)準(zhǔn)由互連外圍設(shè)備專業(yè)組（PCI-SIG）制訂，用于替代PCI、PCI Extended (PCI-X)等基于總線的通訊體系架構(gòu)以及圖形加速端口（AGP）。轉(zhuǎn)向PCIe主要是為了實(shí)現(xiàn)顯著增強(qiáng)系統(tǒng)吞吐量、擴(kuò)容性和靈活性的目標(biāo)，同時(shí)還要降低制造成本，而這些都是基于總線的傳統(tǒng)互連標(biāo)準(zhǔn)所達(dá)不到的。PCI Express標(biāo)準(zhǔn)在設(shè)計(jì)時(shí)著眼于未來，并且能夠繼續(xù)演進(jìn)，從而為系統(tǒng)提供更大的吞吐量。第一代PCIe規(guī)定的吞吐量是每秒2.5千兆比特（Gbps），第二代規(guī) 定的吞吐量是5.0 Gbps，而最近公布PCIe 3.0標(biāo)準(zhǔn)已經(jīng)支持8.0 Gbps的吞吐量。在PCIe標(biāo)準(zhǔn)繼續(xù)充分利用最新技術(shù)來提供不斷加大的吞吐量的同時(shí)，采用分層協(xié)議也便于PCI向PCIe的演進(jìn)，并保持了與現(xiàn)有 PCI應(yīng)用的驅(qū)動(dòng)程序軟件兼容性。雖然最初的目標(biāo)是計(jì)算機(jī)擴(kuò)展卡以及圖形卡，但PCIe目前也廣泛適用于涵蓋更廣的應(yīng)用門類，包括網(wǎng)絡(luò) 組建、通信、存儲(chǔ)、工業(yè)電子設(shè)備和消費(fèi)類電子產(chǎn)品。本白皮書的目的在于幫助讀者進(jìn)一步了解PCI Express以及成功PCIe成功應(yīng)用。 PCI Express基本工作原理拓?fù)浣Y(jié)構(gòu) 本節(jié)介紹了PCIe協(xié)議的基本工作原理以及當(dāng)今系統(tǒng)中實(shí)現(xiàn)和支持PCIe協(xié)議所需要的各個(gè)組成部分。本節(jié) 的目標(biāo)在于提供PCIe的相關(guān)工作知識(shí)，并未涉及到PCIe協(xié)議的具體復(fù)雜性。 PCIe的優(yōu)勢(shì)就在于降低了復(fù)雜度所帶來的成本。PCIe屬于一種基于數(shù)據(jù)包的串行連接協(xié)議，它的復(fù)雜度估計(jì)在PCI并行總線的10倍以上。之所以有這樣的復(fù)雜度，部分是由于對(duì)以千兆級(jí)的速度進(jìn)行并行至串行的數(shù)據(jù)轉(zhuǎn)換的需要，部分是由于向基于數(shù)據(jù)包實(shí)現(xiàn)方案的轉(zhuǎn)移。 PCIe保留了PCI的基本載入-存儲(chǔ)體系架構(gòu)，包括支持以前由PCI-X標(biāo)準(zhǔn)加入的分割事務(wù)處理特性。此外，PCIe引入了一系列低階消息傳遞基元來管理鏈路（例如鏈路級(jí)流量控制），以仿真?zhèn)鹘y(tǒng)并行總線的邊帶信號(hào)，并用于提供更高水平的健壯性和功能性。此規(guī)格定義了許多既支持當(dāng)今需要又支持未來擴(kuò)展的特性，同時(shí)還保持了與PCI軟件驅(qū)動(dòng)程序的兼容性。PCI Express的先進(jìn)特性包括：自主功率管理；先進(jìn)錯(cuò)誤報(bào)告；通過端對(duì)端循環(huán)冗余校驗(yàn)（ECRC）實(shí)現(xiàn)的端對(duì)端可靠性，支持熱插拔；以及服務(wù)質(zhì)量（QoS）流量分級(jí)。

標(biāo)簽： pcie_cn pcie 基本概念工作原理

上傳時(shí)間： 2013-11-29

上傳用戶：zw380105939
本代碼為編碼開關(guān)代碼

本代碼為編碼開關(guān)代碼，編碼開關(guān)也就是數(shù)字音響中的 360度旋轉(zhuǎn)的數(shù)字音量以及顯示器上用的（單鍵飛梭開關(guān)）等類似鼠標(biāo)滾輪的手動(dòng)計(jì)數(shù)輸入設(shè)備。我使用的編碼開關(guān)為5個(gè)引腳的，其中2個(gè)引腳為按下轉(zhuǎn)輪開關(guān)（也就相當(dāng)于鼠標(biāo)中鍵）。另外3個(gè)引腳用來檢測(cè)旋轉(zhuǎn)方向以及旋轉(zhuǎn)步數(shù)的檢測(cè)端。引腳分別為a,b,c b接地a，c分別接到P2.0和P2.1口并分別接兩個(gè)10K上拉電阻，并且a，c需要分別對(duì)地接一個(gè)104的電容，否則因?yàn)榫幋a開關(guān)的觸點(diǎn)抖動(dòng)會(huì)引起輕微誤動(dòng)作。本程序不使用定時(shí)器，不占用中斷，不使用延時(shí)代碼，并對(duì)每個(gè) 細(xì)分步數(shù)進(jìn)行判斷，避免一切誤動(dòng)作，性能超級(jí)穩(wěn)定。我使用的編碼器是APLS的EC11B可以參照附件的時(shí)序圖編碼器控制流水燈最能說明問題，下面是以一段流水燈來演示。

標(biāo)簽： 代碼編碼開關(guān)

上傳時(shí)間： 2017-07-03

上傳用戶：gaojiao1999
基于核心路由器的螞蟻算法研究與應(yīng)用

隨著 Internet日益廣泛的應(yīng)用，其規(guī)模也越來越大，通信流量也迅速增長(zhǎng)，這就迫使其傳輸平臺(tái)向更高的通信帶寬方向發(fā)展，因此，建設(shè)高速度，高寬帶的骨干網(wǎng)就顯得十分必要合理高效的路由選擇方式不僅可以保障全網(wǎng)的正常運(yùn)行，還能夠提高網(wǎng)絡(luò)的接通率，而將 Internet網(wǎng)的接通率提高，既可以盡量避免交換機(jī)不堪重負(fù)甚至崩潰的情況，又能降低網(wǎng)絡(luò)的運(yùn)營(yíng)成本。提高網(wǎng)絡(luò)的接通率相當(dāng)大的程度上依賴于路由選擇策略的改變，因此，TCP/IP網(wǎng)的動(dòng)態(tài)路由選擇問題變得越來越重要。螞蟻算法能夠有效地選擇一條最優(yōu)路徑，但忽視了實(shí)際網(wǎng)絡(luò)中的另外一個(gè)問題：最優(yōu)路徑一旦形成，所有的數(shù)據(jù)都從最優(yōu)路徑傳輸，這樣一來，處于該路徑上的路由器，尤其是在骨干網(wǎng)絡(luò)中心節(jié)點(diǎn)（即多條路徑交匯處）的路由器將承受巨大的數(shù)據(jù)傳輸量，因而很容易造成“瓶頸”現(xiàn)象目前采用的一個(gè)辦法是在骨干網(wǎng)絡(luò)中心節(jié)點(diǎn)處設(shè)置交換容量達(dá)到或超過千兆比特級(jí)的，具有高密度高速端口的核心路由器來擴(kuò)展帶寬和提高數(shù)據(jù)傳送速度以達(dá)到解決骨干網(wǎng)絡(luò)中心節(jié)點(diǎn)處的數(shù)據(jù)擁塞的目的，但這樣大大提高了網(wǎng)絡(luò)成本，并且無法解決最優(yōu)路徑上非核心路由器（又名接入路由器）上的數(shù)據(jù)擁塞問題。根據(jù)上述問題，本文提出一種對(duì)螞蟻算法的改進(jìn)方法一基于核心路由器的螞蟻算法：在骨干網(wǎng)絡(luò)的各核心路由器上相互發(fā)送螞蟻尋找各核心路由器之間的最優(yōu)路徑，這樣可比傳統(tǒng)螞蟻算法通過讓“螞蟻”周游整個(gè)網(wǎng)絡(luò)后來尋找最優(yōu)路徑要快很多方面，該算法通過對(duì)最優(yōu)路徑上，在各個(gè)核心路由器之間的非核心路由器設(shè)置上下限兩個(gè)闊值。當(dāng)某個(gè)非核心路由器A上的數(shù)據(jù)流量達(dá)到上限闕值時(shí)表明該路由器即將處于擁塞，這時(shí)，它鄰近的核心路由器將A看成是一個(gè)“障礙物”，利用螞蟻算法能夠繞過障研物尋找最優(yōu)路徑的特點(diǎn)，可以在這兩個(gè)核心路由器之間重新尋找一條不包括路由器A在內(nèi)的“次優(yōu)”路徑，這樣后續(xù)的數(shù)據(jù)將從“次優(yōu)”路徑傳輸以達(dá)到對(duì)A路由器進(jìn)行分流，經(jīng)過一段時(shí)間分流后，當(dāng)數(shù)據(jù)流量下降到下限綢值時(shí)，就可以重新啟動(dòng)原最優(yōu)路徑，從而達(dá)到了既分流又采用最優(yōu)路徑傳輸?shù)哪康?/p>
標(biāo)簽： 螞蟻算法

上傳時(shí)間： 2022-03-10

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高性能雷達(dá)信號(hào)處理系統(tǒng)硬件設(shè)計(jì)

文章主要討論了一種基于Xilinx FPGA及VPX（VITA46）架構(gòu)的高性能雷達(dá)信號(hào)處理系統(tǒng)的設(shè)計(jì)方案，詳細(xì)分析了系統(tǒng)指標(biāo)與系統(tǒng)結(jié)構(gòu)并全面論述了整個(gè)系統(tǒng)各部分的設(shè)計(jì)方案和硬件實(shí)現(xiàn)。系統(tǒng)包括高速信號(hào)采集/回放板卡、高速大容量數(shù)據(jù)存儲(chǔ)板卡、高速信號(hào)處理板卡、高速信號(hào)交換板卡及高速系統(tǒng)背板等五類板卡。各類板卡通過高速VPX總線連接并被組裝在雷達(dá)信號(hào)處理機(jī)箱內(nèi)構(gòu)成一套高擴(kuò)展性、高性能的雷達(dá)信號(hào)處理系統(tǒng)。系統(tǒng)全采用Xilinx Virtex5FPGA高速現(xiàn)場(chǎng)可編程邏輯器件為主處理器及主控制器。信號(hào)采集/回放板使用基于FMC（VITA57）高速接口的子母板設(shè)計(jì)，提高了系統(tǒng)的靈活性和通用性；大容量數(shù)據(jù)存儲(chǔ)板采用由高密度固態(tài)存儲(chǔ)芯片F(xiàn)lash（閃存）組成的數(shù)據(jù)存儲(chǔ)整列，提高了數(shù)據(jù)存儲(chǔ)容量及存儲(chǔ)帶寬；信號(hào)處理板使用多片F(xiàn)PGA高效并行處理架構(gòu)，提升系統(tǒng)運(yùn)算能力及處理速率；同時(shí)系統(tǒng)采用FPGA高速串行口結(jié)合VPX總線架構(gòu)并整合千兆以太網(wǎng)技術(shù)，加大了系統(tǒng)數(shù)據(jù)吞吐能力。關(guān)鍵詞：XilinxFPGA,高性能,雷達(dá)信號(hào)處理系統(tǒng),VPX

標(biāo)簽： Xilinx FPGA 雷達(dá)信號(hào)處理系統(tǒng)

上傳時(shí)間： 2022-07-27

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基于FPGA的硬件防火墻設(shè)計(jì)和實(shí)現(xiàn).rar

本文提出了一種基于FPGA的硬件防火墻的實(shí)現(xiàn)方案，采用了FPGA來實(shí)現(xiàn)千兆線速的防火墻。傳統(tǒng)的基于X86等通用CPU的防火墻無法支撐快速增長(zhǎng)的網(wǎng)絡(luò)速度，無法實(shí)現(xiàn)線速過濾和轉(zhuǎn)發(fā)。本文在采用FPGA可編程器件+通用CPU模式下，快速處理網(wǎng)絡(luò)數(shù)據(jù)。網(wǎng)絡(luò)數(shù)據(jù)在建立連接跟蹤后，直接由FPGA實(shí)現(xiàn)的快速處理板直接轉(zhuǎn)發(fā)，實(shí)現(xiàn)了網(wǎng)絡(luò)數(shù)據(jù)的線速處理，通用CPU在操作系統(tǒng)支持下，完成網(wǎng)絡(luò)數(shù)據(jù)的連接跟蹤的創(chuàng)建、維護(hù)，對(duì)網(wǎng)絡(luò)規(guī)則表的維護(hù)等工作。FPGA硬件板和CPU各司所長(zhǎng)，實(shí)現(xiàn)快速轉(zhuǎn)發(fā)的目的。本文設(shè)計(jì)了基于FPGA的硬件板的硬件規(guī)格，提出了硬件連接跟蹤表的存儲(chǔ)模式，以及規(guī)則表的存儲(chǔ)模式和定義等；防火墻系統(tǒng)軟件采用NetBSD操作系統(tǒng)，完成了硬件板的NetBSD的驅(qū)動(dòng)；在軟件系統(tǒng)完成了新建連接的建立、下發(fā)、老化等工作；在連接跟蹤上完成了規(guī)則的建立、刪除、修改等工作。本文完成了防火墻的實(shí)現(xiàn)。實(shí)現(xiàn)了基于連接跟蹤的包過濾、地址轉(zhuǎn)換（NAT），設(shè)計(jì)了連接跟蹤的關(guān)鍵數(shù)據(jù)結(jié)構(gòu)，包過濾的關(guān)鍵數(shù)據(jù)結(jié)構(gòu)等，重用了NetBSD操作系統(tǒng)的路由。本文針對(duì)地址轉(zhuǎn)換應(yīng)用程序的穿透問題，新增了部分實(shí)現(xiàn)。在DoS攻擊是一種比較常見的攻擊網(wǎng)絡(luò)手段，本文采用了軟硬件結(jié)合的方法，不僅在軟件部分做了完善，也在硬件部分采取了相應(yīng)的措施，測(cè)試數(shù)據(jù)表明，對(duì)常見的Syn洪水攻擊效果明顯。在實(shí)踐過程中，我們發(fā)現(xiàn)了NetBSD操作系統(tǒng)內(nèi)核的軟件缺陷，做了修正，使之更完善。經(jīng)過測(cè)試分析，本方案不僅明顯的優(yōu)于X86方案，和基于NP方案、基于ASIC方案比較，具有靈活、可配置、易升級(jí)的優(yōu)點(diǎn)。

標(biāo)簽： FPGA 硬件防火墻

上傳時(shí)間： 2013-06-21

上傳用戶：zxh1986123