包括了新型70MHz帶通濾波器設計,40MHz帶通濾波器設計實例 凡是有能力對信號頻譜進行處理的裝置都可以稱為濾波器。在通信設備和各類系統中，濾波器應用極為廣泛，濾波器的優劣直接決定產品的好壞，所以對濾波器的研究和生產一直備為關注。由于計算機技術、集成工藝和材料工業的發展，濾波器的發展也上了一個新臺階，并且朝高精度、低功耗、小體積方向發展。本文主要以中心頻率為70MHz 帶通濾波器為例，介紹如何采用Bessel函數[1]進行帶通濾波器的設計，同時借助Pspice軟件[2,3]強大的電路仿真功能對濾波器的波特圖和群延遲進行仿真，以觀測其效果。2 方案選擇帶通濾波器技術指標要求：帶寬3dB 為4MHz，離中心頻率± 4MHz 處最小衰減為14dB。在整個通帶內時延不變。雖然目前最常用的濾波器設計方法是巴特沃斯、切比雪夫、橢圓函數等幾種形式，但這些方法在設計70MHz 濾波器時，要通過變換以實現其帶通，并且它們所設計的濾波器的群延遲特性在通帶內呈現凹形波形，故在實際使用（如在廣播，移動通信中的中頻濾波，二次濾波）中要進行群延遲均衡，使設計步驟繁瑣且使濾波電路復雜。采用Bessel 函數設計的帶通濾設器具有最窄過渡帶；在通帶內時延均衡，電路所用的階數最少；在實際的應用中電路容易調整；由于所有的節點諧振在相同的頻率上，調諧比較簡單；從經濟性和制造容易程度來考慮，電容耦合電路最合適，而用Bessel 函數設計的濾波器正是電容耦合電路，故采用Bessel 函數進行濾波器的設計。
上傳時間： 2013-10-27
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摘要: 本文介紹了L ED 顯示屏常規型驅動電路的設計方式及其存在的缺陷, 提出了簡單的L ED 顯示屏恒流驅動方式及電路的實現。關鍵詞:L ED 顯示屏 動態掃描 驅動電路中圖分類號: TN 873+ . 93 文獻標識碼:A 文章編號: 1005- 9490(2001) 03- 0252- 051 引 言 L ED 顯示屏是80 年代后期在全球迅速發展起來的新型信息顯示媒體, 它利用發光二極管構成的點陣模塊或像素單元, 組成大面積顯示屏幕, 以其可靠性高、使用壽命、環境適應能力強、性能價格比高、使用成本低等特點, 在信息顯示領域已經得到了非常廣泛的應用[ 1 ]。L ED 顯示屏主要包括發光二極管構成的陣列、驅動電路、控制系統及傳輸接口和相應的應用軟件等, 其中驅動電路設計的好壞, 對L ED 顯示屏的顯示效果、制作成本及系統的運行性能起著很重要的作用。所以, 設計一種既能滿足控制驅動的要求, 同時使用器件少、成本低的控制驅動電路是很有必要的。本文就常規型驅動電路的設計作些分析并提出恒流驅動電路的設計方式。2 L ED 顯示屏常規驅動電路的設計 L ED 顯示屏驅動電路的設計, 與所用控制系統相配合, 通常分為動態掃描型驅動及靜態鎖存型驅動二大類。以下就動態掃描型驅動電路的設計為例為進行分析:動態掃描型驅動方式是指顯示屏上的4 行、8 行、16 行等n 行發光二極管共用一組列驅動寄存器, 通過行驅動管的分時工作, 使得每行L ED 的點亮時間占總時間的1ön , 只要每行的刷新速率大于50 Hz, 利用人眼的視覺暫留效應, 人們就可以看到一幅完整的文字或畫面[ 2 ]。常規型驅動電路的設計一般是用串入并出的通用集成電路芯片如74HC595 或MC14094 等作為列數據鎖存, 以8050 等小功率N PN 三極管為列驅動, 而以達林頓三極管如T IP127 等作為行掃描管, 其電路如圖1 所示。
上傳時間： 2014-02-19
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文中提出了一種基于ADSP-BF533硬件平臺的數字音頻均衡器設計,其音頻處理算法包括譜分析和均衡算法。經過測試表明,該系統可達到理想的音頻均衡效果,用戶可對各種音效進行選擇和自定義音效。
上傳時間： 2014-12-28
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本設計采用TMS320F2808 DSP 芯片，制作了一臺音頻頻率數字掃頻儀，能夠測量未知網絡音頻范圍內的幅頻特性。該系統具有良好的可擴展性，關鍵系統參數軟件可調，并可通過算法設計實現相頻特性的測量，同時小巧靈活，具有實時性強，精度高的特點。用戶可以通過PC 機上友好的用戶界面方便靈活地控制整個系統的工作，查看數據及觀察測試曲線。
上傳時間： 2013-10-08
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頻率特征測試儀是用來測量電路傳輸特性和阻抗特性的儀器，簡稱掃頻儀。掃頻信號源是掃頻儀的主要功能部件，作用是產生測量用的正弦掃頻信號，其 掃頻范圍可調，輸出信號幅度等幅。本設計采用DDS（數字頻率合成技術）產生掃頻信號，以Xilinx FPGA為控制核心，通過A/D和D/A等接口電路，實現掃頻信號頻率的步進調整、幅度與相位的測量，創新的使用了計算機軟件作為儀器面板來顯示被測網絡 幅頻特性與相頻特性，并且測試結果可保存到各種存儲介質中。
上傳時間： 2013-10-19
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Arria V系列 FPGA芯片基本描述 （1）28nm FPGA，在成本、功耗和性能上達到均衡； （2）包括低功耗6G和10G串行收發器； （3）總功耗比6G Arria II FPGA低40%； （4）豐富的硬核IP模塊，提高了集成度 （5）目前市場上支持10.3125Gbps收發器技術、功耗最低的中端FPGA。
上傳時間： 2013-10-26
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設計了一種基于FPGA純硬件方式實現方向濾波的指紋圖像增強算法。設計采用寄存器傳輸級（RTL）硬件描述語言（Verilog HDL），利用時分復用和流水線處理等技術，完成了方向濾波指紋圖像增強算法在FPGA上的實現。整個系統通過了Modelsim的仿真驗證并在Terasic公司的DE2平臺上完成了硬件測試。設計共消耗了3716個邏輯單元，最高處理速度可達92.93MHz。以50MHz頻率工作時，可在0.5s以內完成一幅256×256指紋圖像的增強處理。
上傳時間： 2013-10-12
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在衛星的地面測試中，地面模擬系統發送遙控遙測信號并接收衛星的返回信號，將其下變頻到中頻進行解調，從而獲取衛星工作狀態和運行環境，模擬其在軌運行工作情況。針對目前采用有源相控陣天線技術的衛星地面測試，本文設計實現了一種DBF體制的地面模擬系統接收機，該接收機采用超外差式二次變頻設計，具有高增益、低噪聲系數、低群時延波動、良好的通道間幅相一致性和穩定性，同時集成度高，體積小，可制造性強，能夠充分的滿足采用有源相控陣技術的衛星地面測試要求。
上傳時間： 2013-11-11
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選擇映射法（SLM）和概率類算法都可以降低OFDM （Orthogonal Frequency Division Multiplexing）系統的PAPR（Peak to Average Power Ratio），傳統SLM算法自身較為復雜，但由于其優良的性能，棄之可惜。研究表明，SLM算法和限幅類算法在性能上具有一定的互補性。任何一個算法未必能達到抑制PAPR的理想效果，在深入研究了兩個算法的基礎上，將其優點聯合起來，以達到降低OFDM系統PAPR的目的。最后對聯合改進算法進行了分析與仿真，并驗證了聯合改進算法的有效性和可行性
上傳時間： 2013-11-22
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為了克服已有的雙向MIMO中繼系統模型中預編碼技術計算量大的缺點，提出了一種基于雙向MIMO系統的三時段預編碼策略，給出了該策略的模型和算法。該模型的中繼節點預均衡各信道狀態信息影響（CSI）后將合并信號分時段發送給不同通信節點，簡化了傳統中繼轉發矩陣對多信道信息的聯合設計。理論計算和仿真結果表明，該策略在性能和復雜度之間得到了良好的折衷
上傳時間： 2014-12-28
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