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弧形彎針

  • 在本文中

    在本文中，我們首先實作了 一個針對壓縮視訊（像是 H.264/AVC）之畫面解析度 改善 的方法。接著，我們分析這個方法的模擬結果。

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    上傳時間： 2013-12-28

    上傳用戶：dapangxie

  • 包含一些大眾化的數學題目

    包含一些大眾化的數學題目，比如說buffon丟針問題、dijkstra的三色旗問題、找零錢問題、背包問題、無限位數的整數運算、最短路徑問題...

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    上傳時間： 2014-01-05

    上傳用戶：athjac

  • itextsharp5.5.9

    最新版的itextsharp5.5.9 iTextSharp 是用來生成  PDF 的一個組件，在 1998 年夏天的時候，Bruno Lowagie ，iText 的創作者，參與了學校的一個項目，當時使用 HTML 來生成報告，但是，使用 HTML 打印的效果很不理想。最后，他發現，使用 PDF 可以完美解決打印問題，為了能夠在各個系統中使用，iText 組件庫誕生了。 最初的 iText 主要是支持 Java 語言。之後針對Microsoft .NET C Sharp做了一個版本，也就是我們今天要介紹的 iTextSharp。 目前，iTextSharp 的版本是 5.5.9

    標簽： itextsharp pdf doc

    上傳時間： 2016-03-28

    上傳用戶：cyfdhh

  • U型插針圖紙

    四方針，方針，U型針，門形針,n型針，扁針，插針，拱形插針，弧形彎針，弧形插針

    標簽： 四方針 方針 U型針 門形針 n型針 扁針 插針 拱形插針 弧形彎針 弧形插針

    上傳時間： 2016-08-12

    上傳用戶：sztfjm

  • 八選一模擬開關CD4051參考電路

    八選一模擬開關CD4051參考電路：以TI公司的模擬開關IC芯片CD4051為核心元件的八選一模擬開關電路設計。該設計使用了SMA接口用于選通模擬信號，板子的數字地與模擬地用0歐磁珠隔離，關鍵信號使用弧形走線，以保證信號質量。為了便于單片機易于驅動CD4051的三個數選端A0, A1, A2和一個禁止端INH，板子用LM324與三極管組成串聯穩壓功率放大電路，以解決CD4051在供電正電壓大于5V時，數字信號輸入3.3V無法被識別為高電平的問題。同時本設計還利用平撥開關實現單片機控制和人工控制的切換，在人工模式下可以通過改變跳帽位置實現八選一中任意一路選通。在單片機控制模式下跳帽作用失效，由三個數選端控制選通信道。注意事項：附件資源包括Kicad工程文件，Gerber文件和BOM。電路雙電源供電，供電電壓受CD4051限制，可參考其數據手冊。推薦-5V,0,+12V供電以發揮板上功率放大和CD4051的最大用途。

    標簽： 模擬開關 cd4051 功率放大

    上傳時間： 2021-10-19

    上傳用戶：bluedrops

  • 高速電路設計 詳細基礎理論知識

    設計高速電路必須考慮高速訊 號所引發的電磁干擾、阻抗匹配及串音等效應，所以訊號完整性 (signal  integrity)將是考量設計電路優劣的一項重要指標，電路日異複雜必須仰賴可 靠的軟體來幫忙分析這些複雜的效應，才比較可能獲得高品質且可靠的設計， 因此熟悉軟體的使用也將是重要的研究項目之一。另外了解高速訊號所引發之 各種效應(反射、振鈴、干擾、地彈及串音等)及其克服方法也是研究高速電路 設計的重點之一。目前高速示波器的功能越來越多，使用上很複雜，必須事先 進修學習，否則無法全盤了解儀器之功能，因而無法有效發揮儀器的量測功能。 其次就是高速訊號量測與介面的一些測試規範也必須熟悉，像眼圖分析，探針 效應，抖動(jitter)測量規範及高速串列介面量測規範等實務技術，必須充分 了解研究學習，進而才可設計出優良之教學教材及教具。

    標簽： 高速電路

    上傳時間： 2021-11-02

    上傳用戶：jiabin

  • cadence-allegro16.6高級教程

    主要內容介紹 Allegro 如何載入 Netlist，進而認識新式轉法和舊式轉法有何不同及優缺點的分析，透過本章學習可以對 Allegro 和 Capture 之間的互動關係，同時也能體驗出 Allegro 和 Capture 同步變更屬性等強大功能。Netlist 是連接線路圖和 Allegro Layout 圖檔的橋樑。在這裏所介紹的 Netlist 資料的轉入動作只是針對由 Capture（線路圖部分）產生的 Netlist 轉入 Allegro（Layout部分）1． 在 OrCAD Capture 中設計好線路圖。2． 然後由 OrCAD Capture 產生 Netlist（annotate 是在進行線路圖根據第五步產生的資料進行編改）。 3． 把產生的 Netlist 轉入 Allegro（layout 工作系統）。 4． 在 Allegro 中進行 PCB 的 layout。 5． 把在 Allegro 中產生的 back annotate（Logic）轉出（在實際 layout 時可能對原有的 Netlist 有改動過），並轉入 OrCAD Capture 裏進行回編。

    標簽： cadence allegro

    上傳時間： 2022-04-28

    上傳用戶：kingwide

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