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從算法設(shè)(shè)計(jì)到硬件邏輯的實(shí)現(xiàn)(xiàn)

  • 迪杰斯科拉算法:從某個(gè)源點(diǎn)到其余各頂點(diǎn)的最短路徑

    迪杰斯科拉算法:從某個(gè)源點(diǎn)到其余各頂點(diǎn)的最短路徑

    標(biāo)簽: 算法 最短路徑

    上傳時(shí)間: 2014-01-20

    上傳用戶:大融融rr

  • 從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn)書籍資料

    從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn)

    標(biāo)簽: 算法設(shè)計(jì) 硬線邏輯

    上傳時(shí)間: 2022-06-03

    上傳用戶:ttalli

  • 基于FPGA的前向糾錯(cuò)算法和電路設(shè)計(jì)

    本文研究數(shù)字音頻無線傳輸中的前向糾錯(cuò)(FEC)算法和電路的設(shè)計(jì)及實(shí)現(xiàn).在本文中介紹了一種基于Altera公司的FPGA Cyclone芯片的實(shí)現(xiàn)方案.文章首先介紹了本前向糾錯(cuò)系統(tǒng)采用的方案,然后從總體規(guī)劃的角度介紹了整個(gè)系統(tǒng)的內(nèi)部結(jié)構(gòu)、模塊劃分及所采用的設(shè)計(jì)方法和編程風(fēng)格.之后對(duì)各個(gè)模塊的設(shè)計(jì)進(jìn)行了詳細(xì)的描述,并給出了測(cè)試數(shù)據(jù)、實(shí)現(xiàn)結(jié)果及時(shí)序仿真波形圖,并對(duì)設(shè)計(jì)的硬件下載驗(yàn)證進(jìn)行了詳細(xì)描述.本文對(duì)FEC中的主要功能模塊,諸如Reed-Solomon編解碼,交織與解交織,以及與外圍的接口電路等給出了基本算法以及基于FPGA及硬件描述語言的解決方法.

    標(biāo)簽: FPGA 前向糾錯(cuò) 算法 電路設(shè)計(jì)

    上傳時(shí)間: 2013-04-24

    上傳用戶:duoshen1989

  • 硬件求解平方根源代碼加密 (硬件求解平方根的

    硬件求解平方根源代碼加密 (硬件求解平方根的,將license添加到原有的MaxplusII或QuartusII的license中就可以直接使用,但源代碼加密。altera提供 )

    標(biāo)簽: 硬件 平方根 加密 源代碼

    上傳時(shí)間: 2014-01-04

    上傳用戶:qunquan

  • 利用BFS算法解八數(shù)碼問題 在3*3的方格上放著1-8數(shù)碼

    利用BFS算法解八數(shù)碼問題 在3*3的方格上放著1-8數(shù)碼,有一空格為0變化規(guī)則為空格可以和上,下,右,左四個(gè)相鄰的數(shù)字互換, 至到和目標(biāo)狀態(tài)相等, 每一種狀態(tài)用一個(gè)結(jié)點(diǎn)表示 而每個(gè)結(jié)點(diǎn)每次變化最多有四種結(jié)點(diǎn),將這些結(jié)點(diǎn)依次入隊(duì)列中, 例如初始結(jié)點(diǎn)S0,入隊(duì)列后出隊(duì),將S0變化最多產(chǎn)生的四種結(jié)點(diǎn)S01,S02,S03,S04依次入隊(duì)列中, 當(dāng)S01出隊(duì)后,產(chǎn)生的四種結(jié)點(diǎn)S11,S12,S13,S14(實(shí)際上不會(huì)有四種結(jié)點(diǎn))依次入隊(duì), 每次出隊(duì)時(shí)與結(jié)束結(jié)點(diǎn)相比較,如果相等則退出, 為了,防止已經(jīng)入隊(duì)的結(jié)點(diǎn)再次入隊(duì),(這樣會(huì)造成列循環(huán)),將每次入隊(duì)的結(jié)點(diǎn)設(shè)置一個(gè)標(biāo)識(shí)號(hào), 四種變化即:向上,向下,向右,向左,我們要求向上和向下互斥,向右和向左互斥

    標(biāo)簽: BFS 數(shù)碼 算法

    上傳時(shí)間: 2015-04-24

    上傳用戶:sdq_123

  • 介紹uC/OS-II 在SkyEye上的移植分析.uC/OS-II 作為一個(gè)優(yōu)秀的實(shí)時(shí)操作系統(tǒng)已經(jīng)被移植到各種體系結(jié)構(gòu)的微處理器上

    介紹uC/OS-II 在SkyEye上的移植分析.uC/OS-II 作為一個(gè)優(yōu)秀的實(shí)時(shí)操作系統(tǒng)已經(jīng)被移植到各種體系結(jié)構(gòu)的微處理器上,也是目前較為常用的公開源碼的實(shí)時(shí)內(nèi)核。從這里入手學(xué)習(xí)嵌入式系統(tǒng)開發(fā)的基本概念,以及在 SkyEye 里構(gòu)造一個(gè)可以運(yùn)行的RTOS,能夠使我們更深入地了解嵌入式開發(fā)的流程,在沒有硬件的條件下也能對(duì)ARM的體系結(jié)構(gòu)有個(gè)初步的認(rèn)識(shí)。

    標(biāo)簽: OS-II SkyEye uC 移植

    上傳時(shí)間: 2015-07-22

    上傳用戶:kelimu

  • 介紹vhdl硬件描述語言的特點(diǎn)及設(shè)計(jì)思想

    介紹vhdl硬件描述語言的特點(diǎn)及設(shè)計(jì)思想,運(yùn)用vhdl硬件描述語言實(shí)現(xiàn)計(jì)算機(jī)原理實(shí)驗(yàn)中RAM存儲(chǔ)器的設(shè)計(jì)方法,重點(diǎn)描述了對(duì)傳統(tǒng)計(jì)算機(jī)組成原理實(shí)驗(yàn)中移植到基于CPLD平臺(tái)的思想

    標(biāo)簽: vhdl 硬件描述語言 設(shè)計(jì)思想

    上傳時(shí)間: 2015-08-21

    上傳用戶:lvzhr

  • VHDL硬件描述語言的一系列例子

    VHDL硬件描述語言的一系列例子,從基本的到復(fù)雜的都有。

    標(biāo)簽: VHDL 硬件描述語言

    上傳時(shí)間: 2016-01-13

    上傳用戶:咔樂塢

  • 「常見程式演算」主要收集一些常見的程式練習(xí)題目

    「常見程式演算」主要收集一些常見的程式練習(xí)題目,您可以藉這些題目培養(yǎng)一些程式設(shè)計(jì)邏輯的感覺,對(duì)題目的分類只是個(gè)大概,方便索引而已,實(shí)作的部份是使用 C 及 Java。

    標(biāo)簽: 程式

    上傳時(shí)間: 2014-01-05

    上傳用戶:Breathe0125

  • 經(jīng)典回溯算法

    經(jīng)典回溯算法,可以移植到其他任意規(guī)格的棋盤上,實(shí)現(xiàn)N皇后的問題。

    標(biāo)簽: 回溯算法

    上傳時(shí)間: 2014-02-22

    上傳用戶:thinode

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