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循環(huán)(huán)冗余碼

  • 基于FPGA的三相逆變器并聯(lián)技術(shù)研究

    交流電源供電方式正在由集中式向分布式、全功能式發(fā)展,而實(shí)現(xiàn)分布式電源的核心就是模塊的并聯(lián)技術(shù)。多臺逆變器并聯(lián)可以實(shí)現(xiàn)大容量供電和冗余供電,可大大提高系統(tǒng)的靈活性,使電源系統(tǒng)的體積重量大為降低,同時(shí)其主開關(guān)器件的電流應(yīng)力也可大大減少,從根本上提高了可靠性、降低成本和提高功率密度。本文主要研究逆變器并聯(lián)技術(shù)。 本文首先對電壓、電流雙閉環(huán)逆變器控制系統(tǒng)進(jìn)行了研究。通過對傳遞函數(shù)的分析,得到了基于等效輸出阻抗的雙閉環(huán)控制的逆變器并聯(lián)系統(tǒng)模型。在分析逆變器模型的基礎(chǔ)上設(shè)計(jì)了各控制器參數(shù),并通過MATLAB仿真進(jìn)行了驗(yàn)證。根據(jù)上述模型,分析了逆變器并聯(lián)的環(huán)流特性,以及基于有功和無功功率的并聯(lián)控制方案。 隨著電子技術(shù)的不斷發(fā)展,F(xiàn)PGA技術(shù)正在越來越多地用于工程實(shí)踐中。本文在研究SPWM控制技術(shù)的基礎(chǔ)上,應(yīng)用FPGA芯片EP1C12Q240C8實(shí)現(xiàn)了SPWM數(shù)字控制器,用于多模塊逆變器并聯(lián)控制系統(tǒng)。文中給出了仿真結(jié)果和芯片的測試結(jié)果。 基于FPGA的三相逆變器并聯(lián)數(shù)字控制器的研究具有現(xiàn)實(shí)意義,設(shè)計(jì)具有創(chuàng)新性。仿真和芯片的初步測試結(jié)果表明:本文設(shè)計(jì)的基于FPGA的逆變器并聯(lián)數(shù)字控制器能夠滿足逆變器并聯(lián)系統(tǒng)的要求。

    標(biāo)簽: FPGA 三相逆變器 并聯(lián) 技術(shù)研究

    上傳時(shí)間: 2013-08-05

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  • 應(yīng)用可靠性5_線路設(shè)計(jì)

    一、應(yīng)用可靠性概念 1、可靠性概念 2、固有可靠性與應(yīng)用可靠性 3、易產(chǎn)生應(yīng)用可靠性問題的器件 4、使用應(yīng)力對可靠性的影響 二、電子元器件的選用 1、電子元器件的質(zhì)量等級 2、電子元器件的選擇要點(diǎn) 3、電子元器件的最大額定值 4、電子元器件的降額應(yīng)用 三、電子元器件的可靠性應(yīng)用 1、電子元器件的防浪涌應(yīng)用 2、電子元器件的防靜電應(yīng)用 3、電子元器件的防干擾應(yīng)用 4、CMOS群件的防閂鎖應(yīng)用 四、電子元器件的EMC應(yīng)用 1、干擾來源及傳播路徑 2、接地與屏蔽 3、濾波 4、電纜及終端 5、差分 6、軟件抗干擾 五、可靠性防護(hù)元件 1、TVS二極管 2、壓敏電阻 3、PTC與NTC熱敏電阻 4、專用防護(hù)元件 六、電子線路的可靠性設(shè)計(jì) 1、簡化設(shè)計(jì) 2、容差與漂移設(shè)計(jì) 3、冗余設(shè)計(jì) 4、低功耗設(shè)計(jì) 5、潛在通路分析 6、電磁兼容設(shè)計(jì) 7、均衡設(shè)計(jì) 七、印制電路版的可靠性設(shè)計(jì) 1、PCB的布局設(shè)計(jì) 2、PCB的布線設(shè)計(jì) 3、PCB的熱設(shè)計(jì) 4、PCB的裝配 八、噪聲測試作為應(yīng)用可靠性保證手段 1、噪聲與可靠性的關(guān)系 2、噪聲用于壽命評估 3、噪聲用于可靠性篩選 4、噪聲用于應(yīng)力損傷的早期預(yù)測

    標(biāo)簽: 應(yīng)用可靠性 線路設(shè)計(jì)

    上傳時(shí)間: 2013-07-28

    上傳用戶:mh_zhaohy

  • 應(yīng)用可靠性9_綜合實(shí)例

    一、應(yīng)用可靠性概念 1、可靠性概念 2、固有可靠性與應(yīng)用可靠性 3、易產(chǎn)生應(yīng)用可靠性問題的器件 4、使用應(yīng)力對可靠性的影響 二、電子元器件的選用 1、電子元器件的質(zhì)量等級 2、電子元器件的選擇要點(diǎn) 3、電子元器件的最大額定值 4、電子元器件的降額應(yīng)用 三、電子元器件的可靠性應(yīng)用 1、電子元器件的防浪涌應(yīng)用 2、電子元器件的防靜電應(yīng)用 3、電子元器件的防干擾應(yīng)用 4、CMOS群件的防閂鎖應(yīng)用 四、電子元器件的EMC應(yīng)用 1、干擾來源及傳播路徑 2、接地與屏蔽 3、濾波 4、電纜及終端 5、差分 6、軟件抗干擾 五、可靠性防護(hù)元件 1、TVS二極管 2、壓敏電阻 3、PTC與NTC熱敏電阻 4、專用防護(hù)元件 六、電子線路的可靠性設(shè)計(jì) 1、簡化設(shè)計(jì) 2、容差與漂移設(shè)計(jì) 3、冗余設(shè)計(jì) 4、低功耗設(shè)計(jì) 5、潛在通路分析 6、電磁兼容設(shè)計(jì) 7、均衡設(shè)計(jì) 七、印制電路版的可靠性設(shè)計(jì) 1、PCB的布局設(shè)計(jì) 2、PCB的布線設(shè)計(jì) 3、PCB的熱設(shè)計(jì) 4、PCB的裝配 八、噪聲測試作為應(yīng)用可靠性保證手段 1、噪聲與可靠性的關(guān)系 2、噪聲用于壽命評估 3、噪聲用于可靠性篩選 4、噪聲用于應(yīng)力損傷的早期預(yù)測

    標(biāo)簽: 應(yīng)用可靠性

    上傳時(shí)間: 2013-04-24

    上傳用戶:刺猬大王子

  • 三維圖形幾何管線的算法

    近年來,計(jì)算機(jī)圖形學(xué)應(yīng)用越來越廣泛,尤其是三維(3D)繪圖。3D繪圖使用3D模型和各種影像處理產(chǎn)生具有三維空間真實(shí)感的影像,應(yīng)用于虛擬真實(shí)情況以及多媒體的產(chǎn)品上,且多半是使用低成本的實(shí)時(shí)3D計(jì)算機(jī)繪圖技術(shù)為基礎(chǔ)。在初期3D圖形學(xué)剛起步時(shí),由于圖形簡單,因此可以利用CPU來運(yùn)算,但隨著圖形學(xué)技術(shù)的發(fā)展,所要繪制的圖形越來越復(fù)雜,這時(shí)如果單純依賴CPU來處理,不能達(dá)到實(shí)時(shí)的要求,因此需要專門的硬件來加速圖形處理,GPU(圖形處理單元)因此出現(xiàn)了。不過由于3D圖形加速硬件的復(fù)雜性和短壽命,這極大地提高了對硬件開發(fā)環(huán)境的需要。為了更好的對設(shè)計(jì)進(jìn)行更改和測試,不能僅僅用專門定制的方法來設(shè)計(jì),需要其他的方:硬件描述語言(HDL)和FPGA。 隨著計(jì)算機(jī)繪圖規(guī)模的需要,借助輔助硬件資源,來提高圖形處理單元(GPU)處理速度的需求越來越普遍。自從15年前現(xiàn)場可編程門陣列(FPGA)開始出現(xiàn)以來,其在可編程硬件領(lǐng)域所起的作用越來越大。它們在速度、體積和速度方面都有了很大的提高。這意味著FPGA在以前只能使用專用硬件的場合越來越重要。其中一個(gè)應(yīng)用領(lǐng)域就是3D圖形渲染,在這個(gè)研究領(lǐng)域里人們正在利用具有可編程性能的FPGA來幫助改進(jìn)圖形處理單元(GPU)的性能。 能夠在廉價(jià)、可動態(tài)重新配置的FPGA上實(shí)現(xiàn)復(fù)雜算法來輔助硬件設(shè)計(jì)。本文的設(shè)計(jì)就是通過在FPGA上實(shí)現(xiàn)3維圖形幾何處理管線部分功能來提高圖形處理速度。具體實(shí)現(xiàn)中使用硬件描述語言(Verilog HDL)進(jìn)行邏輯設(shè)計(jì),并發(fā)現(xiàn)問題解決問題。 本文主要特色如下: 1.針對幾何變換換子系統(tǒng),提出一種硬件實(shí)現(xiàn)方案,該方案能對基本的幾何變換如:平移、縮放、旋轉(zhuǎn)和投影進(jìn)行操作。首先構(gòu)造出總體變換矩陣,隨后進(jìn)行矩陣乘法運(yùn)算,再進(jìn)行投影變換,最后輸出變換座標(biāo)。提出一種脈動陣列結(jié)構(gòu),用于兩個(gè)矩陣的乘法運(yùn)算。找到一種快捷的方法來實(shí)現(xiàn)矩陣相乘,將能大大提高系統(tǒng)的效率。 2.對于3D圖形裁剪,文中描述了一種裁剪引擎,它能夠處理3D圖形中的裁剪、透視除法以及視口映射的功能。硬件實(shí)現(xiàn)的難度取決于裁剪算法的復(fù)雜程度。我們在Sutherland-Hodgman裁剪算法的基礎(chǔ)上提出一種新的裁剪算法,該算法通過去除冗余頂點(diǎn)以提高處理速度,同時(shí)利用編碼來判斷線段可見性的方法使得硬件實(shí)現(xiàn)變得很容易。 3.最后,我們在FPGA上實(shí)現(xiàn)了幾何變換以及三維裁剪,并與C語言的模擬結(jié)果對比發(fā)現(xiàn)結(jié)果正確,且三維裁剪能夠以3M個(gè)三角形/s的速度運(yùn)行,滿足了圖形流水中的實(shí)時(shí)性要求。

    標(biāo)簽: 三維圖形 幾何 算法

    上傳時(shí)間: 2013-04-24

    上傳用戶:yerik

  • 多功能車輛總線一類設(shè)備的FPGA實(shí)現(xiàn)

    多功能車輛總線一類設(shè)備是一個(gè)在列車通信網(wǎng)(TCN,TrainCommunication Network)中普遍使用的網(wǎng)絡(luò)接口單元。目前我國的新式列車大多采用列車通信網(wǎng)傳輸列車中大量的控制和服務(wù)信息。但使用的列車通信網(wǎng)產(chǎn)品主要為國外進(jìn)口,因此迫切需要研制具有自主知識產(chǎn)權(quán)的列車通信網(wǎng)產(chǎn)品。 論文以一類設(shè)備控制器的設(shè)計(jì)為核心,采取自頂向下的模塊設(shè)計(jì)方法。將設(shè)備控制器分為同步層和數(shù)據(jù)處理層來分別實(shí)現(xiàn)對幀的發(fā)送與接收處理和對幀數(shù)據(jù)的提取與存儲處理。 同步層包含幀的識別模塊、曼徹斯特譯碼模塊、曼徹斯特編碼與幀封裝三個(gè)模塊。幀識別模塊檢測幀的起始位并對幀類型進(jìn)行判斷。譯碼模塊根據(jù)采集的樣本值來判斷曼徹斯特編碼的值,采樣的難點(diǎn)在于非理想信號帶來的采樣誤差,論文使用結(jié)合位同步的多點(diǎn)采樣法來提高采樣質(zhì)量。幀分界符中的非數(shù)據(jù)符不需要進(jìn)行曼徹斯特編碼,編碼時(shí)在非數(shù)據(jù)符位關(guān)閉編碼電路使非數(shù)據(jù)符保持原來的編碼輸出。 數(shù)據(jù)處理層以主控單元(MCU,Main Control Unit)和通信存儲器為設(shè)計(jì)核心。MCU是控制器的核心,對接收的主幀進(jìn)行分析,判斷是從通信存儲器相應(yīng)端口取出應(yīng)答從幀并發(fā)送,還是準(zhǔn)備接收從幀并存入通信存儲器。通信存儲器存儲設(shè)備的通信數(shù)據(jù),合適的地址分配能簡化MCU的控制程序,論文固定了通信存儲器端口大小使MCU可以根據(jù)一個(gè)固定的公式進(jìn)行端口的遍歷從而簡化了MCU程序的復(fù)雜度。數(shù)據(jù)在傳輸中由于受到干擾和沖突等問題而出現(xiàn)錯(cuò)誤,論文采用循環(huán)冗余檢驗(yàn)碼結(jié)合偶檢驗(yàn)擴(kuò)展來對傳輸數(shù)據(jù)進(jìn)行差錯(cuò)控制。 最后,使用FPGA和硬件描述語言Verilog HDL開發(fā)出了MVB一類設(shè)備。目前該一類設(shè)備已運(yùn)用在SS4G電力機(jī)車的制動控制單元(BCU.Brake Control Unit)中并在鐵道科學(xué)研究院通過了TCN通信測試。一類設(shè)備的成功研制為列車通信網(wǎng)中總線管理器等高類設(shè)備的開發(fā)奠定了堅(jiān)實(shí)的基礎(chǔ)。

    標(biāo)簽: FPGA 多功能 總線 設(shè)備

    上傳時(shí)間: 2013-07-27

    上傳用戶:qazxsw

  • 基于FPGA的航電數(shù)據(jù)處理及傳輸系統(tǒng)

    本文結(jié)合目前國內(nèi)外航電數(shù)據(jù)處理系統(tǒng)的發(fā)展概況,設(shè)計(jì)了一款集數(shù)據(jù)采集、處理、控制及傳輸于一體的航電處理系統(tǒng)。文章首先深入研究了自適應(yīng)濾波器原理,分析了LMS算法性能,著重從影響算法性能的因素入手,通過分析仿真,改進(jìn)算法,提升了算法性能,給出仿真結(jié)果分析,并設(shè)計(jì)應(yīng)用于系統(tǒng)之中;其次介紹了ARINC-429航空總線和RS-422串行總線的信息標(biāo)準(zhǔn)和傳輸格式。在此基礎(chǔ)上,設(shè)計(jì)了基于FPGA的解決航電系統(tǒng)數(shù)據(jù)采集、濾波處理、控制傳輸和復(fù)雜非線性運(yùn)算的一體化實(shí)現(xiàn)方案。選用XILINX公司的FPGA,實(shí)現(xiàn)了航電數(shù)據(jù)采集、傳輸和控制,集成了ARlNC-429和RS-422兩種通信接口,實(shí)現(xiàn)了總線冗余,并實(shí)現(xiàn)了數(shù)據(jù)濾波和相應(yīng)的算法處理。最后,在實(shí)驗(yàn)室環(huán)境下,對每個(gè)模塊分別進(jìn)行了軟硬件測試。

    標(biāo)簽: FPGA 數(shù)據(jù)處理 傳輸系統(tǒng)

    上傳時(shí)間: 2013-07-01

    上傳用戶:R50974

  • 串口獵人 ( Serial Hunter ) V31

    在V29的版本上升級。發(fā)布日期2011-08-19. -------------------------------------------------------------------------------- 歡迎使用免費(fèi)軟件《串口獵人》V31 ! -------------------------------------------------------------------------------- 友情提醒1:本軟件如有新版本,將發(fā)布到我的博客《匠人的百寶箱》,歡迎光臨! 友情提醒2:點(diǎn)擊右側(cè)【清除】按鈕,可清除本幫助信息。清除后如想再次查閱,請重啟軟件。 -------------------------------------------------------------------------------- 《串口獵人》功能簡介 -------------------------------------------------------------------------------- 一、基本功能 1、支持16個(gè)COM口、自動/手動搜索串口、串口參數(shù)的設(shè)置和查看。 2、支持查看或修改串口控制線(DTR、RTS、DCD等等)的狀態(tài)。 3、支持基本的收、發(fā)、查看、保存、載入、清除等功能。 4、兩種收發(fā)格式:HEX碼/字符串,支持中文字符串。(英文=ASCII碼,中文=ANSI(GBK)碼)。 5、大容量的收碼區(qū),為了加快顯示速度會把超過10K的數(shù)據(jù)自動隱藏(可以點(diǎn)擊【全顯】鈕查看)。 6、收碼區(qū)的顯示方式可以靈活設(shè)置:原始接收數(shù)據(jù)、按幀換行、通道數(shù)據(jù)、發(fā)送數(shù)據(jù)。 7、可以為收到的數(shù)據(jù)標(biāo)注時(shí)間和來源。 8、可以自動比對發(fā)碼區(qū)和收碼區(qū)的數(shù)據(jù)是否一致(用于自發(fā)自收測試模式)。 9、收碼區(qū)的內(nèi)容,可以點(diǎn)擊【轉(zhuǎn)發(fā)】鈕轉(zhuǎn)到發(fā)碼區(qū)。 10、可以在每次發(fā)碼之前自動清除收碼區(qū)。 二、高級發(fā)碼功能 1、自動發(fā)列表功能:支持多組(最多16組)數(shù)據(jù)的輪流發(fā)送。 2、自動發(fā)文件功能:支持文件逐行發(fā)送。 3、輪發(fā)規(guī)則可以靈活設(shè)置,比如可以定時(shí)發(fā),也可以收到應(yīng)答后立即發(fā)。 4、輪發(fā)的間隔、無應(yīng)答重發(fā)次數(shù)和循環(huán)次數(shù)均可靈活設(shè)置。 5、靈活的幀格式設(shè)置。支持自動添加幀頭、幀尾、幀長、校驗(yàn)、回車換行符。 6、幀頭、幀尾、幀長、校驗(yàn),是否要參與校驗(yàn)或計(jì)入幀長,皆可靈活設(shè)置。 7、支持3種校驗(yàn)方式:SC(累加和校驗(yàn))、LRC(縱向冗余校驗(yàn))、BBC(異或和校驗(yàn))。 8、校驗(yàn)碼和幀長的長度,可以選擇單/雙字節(jié)。 三、高級收碼功能 1、支持按幀接收數(shù)據(jù)。 2、能自動進(jìn)行幀結(jié)束判定(方式非常靈活,可以按幀頭、幀尾、幀長或時(shí)間)。 3、即時(shí)顯示最新一幀內(nèi)容。 4、擁有八個(gè)獨(dú)立接收通道,可以自動從指定幀中指定位置收取有效數(shù)據(jù)。 5、每個(gè)通道的數(shù)據(jù),可以獨(dú)自顯示、保存、清除。也可以送到收碼區(qū)去顯示。 6、可以設(shè)置通道收取數(shù)據(jù)的首地址、字節(jié)長度(單字節(jié)或多字節(jié))、碼制(HEX/BCD)、符號位形式。 7、示波器功能,可把收取的數(shù)據(jù)用波形方式顯示。示波器的通道數(shù)、倍率、偏移、周期、顏色和線寬等可調(diào)。 8、碼表功能,可把收取的數(shù)據(jù)用碼表方式顯示。(可以設(shè)置碼表的最大/最小值和報(bào)警值)。 9、柱狀圖功能,可把收取的數(shù)據(jù)用柱狀圖方式顯示。(也可以設(shè)置最大/最小值和報(bào)警值)。 10、可以把實(shí)施繪制的圖形保存為圖片。 四、其它貼心設(shè)計(jì) 1、用戶的設(shè)置內(nèi)容,可以保存/載入或恢復(fù)默認(rèn)值。可以選擇啟動時(shí)載入默認(rèn)值還是上次設(shè)置值。 2、可以通過提示區(qū)和狀態(tài)指示了解軟件當(dāng)前工作狀態(tài)。 3、當(dāng)鼠標(biāo)停留在按鈕、文本框或其它控件上,會獲得必要的提示。 4、右下角的圖釘按鈕,可以把窗口釘在最前面,避免被其它窗口覆蓋。 5、附送串口電路、協(xié)議、碼表等參考資料。 6、在【版權(quán)信息】標(biāo)簽頁有匠人的聯(lián)系方式,歡迎交流。

    標(biāo)簽: Serial Hunter V31 串口獵人

    上傳時(shí)間: 2013-07-28

    上傳用戶:lili1990

  • 單片機(jī)控制系統(tǒng)中的抗干擾設(shè)計(jì)

    分析了單片機(jī)控制的氙燈系統(tǒng)中干擾的來源、控制回路中的干擾類型,介紹了此系統(tǒng)在電源、接地、I/O接口等環(huán)節(jié)上所采取的硬件措施,同時(shí)也給出了在軟件抗干擾所采用的軟件冗余、軟件陷阱、軟件看門狗等軟件抗干擾技術(shù).給出將多種軟硬件抗干擾方法綜合應(yīng)用的具體方法.實(shí)踐證明這些方法是有效的..

    標(biāo)簽: 單片機(jī) 控制系統(tǒng) 抗干擾設(shè)計(jì)

    上傳時(shí)間: 2013-07-22

    上傳用戶:koulian

  • 基于小波變換的改進(jìn)影像金字塔模型

      隨著遙感影像數(shù)據(jù)量不斷增長,為了更加高效地組織與管理海量的遙感影像,研究并提出了改進(jìn)的基于小波分解的影像金字塔構(gòu)建方法。利用多分辨率分析和圖像的小波分解與重構(gòu)算法,參考影像金字塔構(gòu)建的一般方法,將圖像小波分解的不同級系數(shù)量化、編碼后,分別存儲于金字塔的不同層中。該構(gòu)建方法可以有效地降低金字塔各層之間的數(shù)據(jù)冗余,減少總數(shù)據(jù)量和瀏覽時(shí)的數(shù)據(jù)流量,并能更好地支持嵌入式碼流和漸進(jìn)式傳輸。

    標(biāo)簽: 小波變換 金字塔模型

    上傳時(shí)間: 2013-10-20

    上傳用戶:1477849018@qq.com

  • 綜合布線系統(tǒng)施工要點(diǎn)

    橋架設(shè)計(jì)合理,保證合適的線纜彎曲半徑。上下左右繞過其他線槽時(shí),轉(zhuǎn)彎坡度要平緩,重點(diǎn)注意兩端線纜下垂受力后是否還能在不壓損線纜的前提下蓋上蓋板。放線過程中主要是注意對拉力的控制,對于帶卷軸包裝的線纜,建議兩頭至少各安排一名工人,把卷軸套在自制的拉線桿上,放線端的工人先從卷軸箱內(nèi)預(yù)拉出一部分線纜,供合作者在管線另一端抽取,預(yù)拉出的線不能過多,避免多根線在場地上纏結(jié)環(huán)繞。拉線工序結(jié)束后,兩端留出的冗余線纜要整理和保護(hù)好,盤線時(shí)要順著原來的旋轉(zhuǎn)方向,線圈直徑不要太小,有可能的話用廢線頭固定在橋架、吊頂上或紙箱內(nèi),做好標(biāo)注,提醒其他人員勿動勿踩。

    標(biāo)簽: 綜合布線系統(tǒng)

    上傳時(shí)間: 2013-10-18

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