同步技術(shù)是跳頻系統(tǒng)的核心。本文針對FPGA的跳頻系統(tǒng),設(shè)計了一種基于獨立信道法,同步字頭法和精準(zhǔn)時鐘相結(jié)合的快速同步方法,同時設(shè)計了基于雙圖案的改進(jìn)型獨立信道法,同步算法協(xié)議,協(xié)議幀格式等。該設(shè)計使用VHDL硬件語言實現(xiàn),采用Altera公司的EP3C16E144C8作為核心芯片,并在此硬件平臺上進(jìn)行了功能驗證。實際測試表明,該快速同步算法建立時間短、同步穩(wěn)定可靠。
標(biāo)簽:
FPGA
跳頻系統(tǒng)
同步算法
上傳時間:
2013-10-21
上傳用戶:JIMMYCB001