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性能影響

  • C8051F040在曳引及制動性能檢測系統中的應用

    基于改善電梯檢測現狀和電梯檢測的高可靠性的考慮,設計了一套基于CAN總線的電梯曳引及制動性能檢測系統。本文著重闡述了檢測系統的CAN節點里比較有代表性的、利用C8051F040單片機設計的一個多功能混合信號節點的硬件和軟件設計方法以及基于此節點的CAN總線系統調試方式。實際應用結果證明本檢測系統的設計方法正確,具備很好的可靠性和應用前景。

    標簽: C8051F040 制動性能 中的應用 檢測系統

    上傳時間: 2013-10-18

    上傳用戶:waizhang

  • DM647,DM648應用及性能

    達芬奇技術使視頻安全與監控應用獲得系統性能雙倍提升,系統成本大幅降低

    標簽: DM 647 648 性能

    上傳時間: 2013-10-11

    上傳用戶:菁菁聆聽

  • 改善基于微控制器的應用的瞬態免疫性能

    家電制造業的競爭日益激烈,市場調整壓力越來越大,原始設備制造商們(OEM)為了面對這一挑戰,必須在滿足電磁兼容性的條件下,不斷降低產品的成本。由于強調成本控制,為防止由電源和信號線的瞬變所產生的電器故障而實施必要的瞬態免疫保護,對于家電設計者來說變得更具挑戰性。由于傳統的電源設計和電磁干擾(EMI)控制措施為節約成本讓路,家電設計者必須開發出新的技術來滿足不斷調整的電磁兼容(EMC)需求。本應用筆記探討了瞬態電氣干擾對嵌入式微控制器(MCU)的影響,并提供了切實可行的硬件和軟件設計技術,這些技術可以為電快速瞬變(EFT)、靜電放電(ESD)以及其它電源線或信號線的短時瞬變提供低成本的保護措施。雖然這種探討是主要針對家電制造商,但是也適用于消費電子、工業以及汽車電子方面的應用。 低成本的基于MCU 的嵌入式應用特別容易受到ESD 和EFT 影響降低性能。即使是運行在較低時鐘頻率下的微控制器,通常對快速上升時間瞬變也很敏感。這種敏感性歸咎于所使用的工藝技術。如今針對低成本8/16位的MCU的半導體工藝技術所實現的晶體管柵極長度在0.65 μm~0.25 μm范圍內。此范圍內的柵極長度能產生和響應上升時間在次納秒范圍內(或超過300 MHz 的等同帶寬)的信號。因此, MCU 能夠響應進入其引腳的ESD 或EFT 信號。除上述工藝技術之外, MCU 在ESD 或EFT 事件中的性能還會受到IC 設計及其封裝、印刷電路板(PCB)的設計、MCU 上運行的軟件、系統設計以及ESD 或EFT 波形特征的影響。各因素的相對影響(強調對最大影響的貢獻)如圖1 所示。

    標簽: 微控制器 瞬態免疫 性能

    上傳時間: 2013-11-09

    上傳用戶:Jerry_Chow

  • TMS320F28335DSP在電力電子變流器中、性能優勢分析

    TMS320F28335DSP在電力電子變流器中、性能優勢分析

    標簽: F28335 28335 320F TMS

    上傳時間: 2013-11-20

    上傳用戶:arnold

  • 基于FPGA的隨機數性能檢測設計

    為了滿足對隨機數性能有一定要求的系統能夠實時檢測隨機數性能的需求,提出了一種基于FPGA的隨機數性能檢測設計方案。根據NIST的測試標準,采用基于統計的方法,在FPGA內部實現了對隨機序列的頻率測試、游程測試、最大游程測試、離散傅里葉變換測試和二元矩陣秩測試。與現在常用的隨機數性能測試軟件相比,該設計方案,能靈活嵌入到需要使用隨機數的系統中,實現對隨機性能的實時檢測。實際應用表明,該設計具有使用靈活、測試準確、實時輸出結果的特點,達到了設計要求。

    標簽: FPGA 隨機數 性能檢測

    上傳時間: 2013-11-13

    上傳用戶:lliuhhui

  • 對Altera 28nm FPGA浮點DSP設計流程和性能的獨立分析

      電子發燒友網核心提示:Altera公司昨日宣布,在業界率先在28 nm FPGA器件上成功測試了復數高性能浮點數字信號處理(DSP)設計。獨立技術分析公司Berkeley設計技術有限公司(BDTI)驗證了能夠在 Altera Stratix V和Arria V 28 nm FPGA開發套件上簡單方便的高效實現Altera浮點DSP設計流程,同時驗證了要求較高的浮點DSP應用的性能。本文是BDTI完整的FPGA浮點DSP分析報告。    Altera的浮點DSP設計流程經過規劃,能夠快速適應可參數賦值接口的設計更改,其工作環境包括來自MathWorks的MATLAB和 Simulink,以及Altera的DSP Builder高級模塊庫,支持FPGA設計人員比傳統HDL設計更迅速的實現并驗證復數浮點算法。這一設計流程非常適合設計人員在應用中采用高性能 DSP,這些應用包括,雷達、無線基站、工業自動化、儀表和醫療圖像等。

    標簽: Altera FPGA DSP 28

    上傳時間: 2014-12-28

    上傳用戶:18888888888

  • WP245 - 使用Virtex-5系列FPGA獲得更高系統性能

    Virtex™-5 器件包括基于第二代高級硅片組合模塊 (ASMBL™) 列架構的多平臺 FPGA 系列。集成了為獲得最佳性能、更高集成度和更低功耗設計的若干新型架構元件,Virtex-5 器件達到了比以往更高的系統性能水平。

    標簽: Virtex FPGA 245 WP

    上傳時間: 2013-10-29

    上傳用戶:long14578

  • GPS_北斗-2組合定位性能的研究

    今年年底北斗衛星導航系統已基本完成地球靜止軌道衛星和傾斜地球同步軌道衛星的建設工作。目前,在中國及周邊地區北斗導航系統已經可以單獨提供定位服務。本文對GPS/北斗組合系統以及GPS北斗單獨系統在上海的定位性能進行了評估,分析了在不同模式下的可視衛星數量、幾何精度因子、定位的穩定性和準確性。結果表明組合定位進一步提高了單獨系統模式下的定位性能,北斗系統目前在水平方向上的定位精度已經達到10米級。

    標簽: GPS 北斗 組合 定位

    上傳時間: 2013-10-20

    上傳用戶:rishian

  • 基于PWLAN GPF的QoS性能分析與仿真

    基于IEEE802.11協議中PCF/DCF技術,在無線局域網(WLAN)中,介紹了GPF的系統結構和數據幀格式等。分別對基于IEEE802.11b媒體接入控制(MAC)協議、基于IEEE802.11e媒體接入控制(MAC)協議以及基于業務劃分Qos的GPF仿真的時間參數和接入原則等進行了說明。在PWLAN的3種測試環境下,對802.11b、802.11e、GPF協議的整體性能進行了仿真,并對其結果進行了分析。

    標簽: PWLAN GPF QoS 性能分析

    上傳時間: 2013-11-15

    上傳用戶:chaisz

  • 對IPv6和IPv4傳輸性能的對比研究

    為了使更多的計算機網絡工作者了解和接受IPv6, 本文以兩種不同的網絡協議FTP協議和HTTP協議為例,以實驗的方式研究了它們分別在IPv6和IPv4環境下對不同大小的文件進行網絡傳輸的性能差異。通過對實驗過程中采集的傳輸速率的計算和對比研究,發現IPv6在FTP協議和HTTP協議上文件傳輸速率比IPv4快,得出了整體而言IPv6的傳輸性能優于IPv4的結論。

    標簽: IPv6 IPv4 傳輸 性能

    上傳時間: 2013-11-12

    上傳用戶:liujinzhao

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