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一篇關于使用cordic實現動態配置以提高FPGA的整體性能的高效算法具體詳解，很實用哦
標簽： cordic FPGA 動態配置 性能
上傳時間： 2013-08-13
上傳用戶：a471778
FPGA可促進嵌入式系統設計改善即時應用性能，臺灣人寫的，關于FPGA應用的技術文章
標簽： FPGA 嵌入式 系統 性能
上傳時間： 2013-08-20
上傳用戶：liuwei6419
實現一個用于CDMA2000系統的短幀交織器,計算比較了12*16,13*15,14*14三種交織形式的性能!
標簽： CDMA 2000 14 12
上傳時間： 2013-08-22
上傳用戶：zchpr@163.com
本文件是基于FPGA的QPSK調制解調性能仿真
標簽： FPGA QPSK 調制解調 性能仿真
上傳用戶：541657925
文章介紹了石英晶體振蕩器的特點及性能參數，由于人工測量繁瑣，且容易出錯等不足，提出了一種智能測量方法。該方法利用計算機控制技術，實現自動測試石英晶體振蕩器的性能參數，并打印測試結果，減少了強度，提高了檢測效率。
標簽： 石英晶體振蕩器 性能 參數測試 系統研究
上傳時間： 2013-11-22
上傳用戶：yy541071797
ADC需要FFT處理器來評估頻譜純度，DAC則不同，利用傳統的模擬頻譜分析儀就能直接 研究它所產生的模擬輸出。DAC評估的挑戰在于要產生從單音正弦波到復雜寬帶CDMA信 號的各種數字輸入。數字正弦波可以利用直接數字頻率合成技術來產生，但更復雜的數字 信號則需要利用更精密、更昂貴的字發生器來產生。 評估高速DAC時，最重要的交流性能指標包括：建立時間、毛刺脈沖面積、失真、無雜散 動態范圍(SFDR)和信噪比(SNR)。本文首先討論時域指標，然后討論頻域指標。
標簽： 013 DAC MT 性能
上傳時間： 2013-10-27
上傳用戶：Vici
通過單個加速度計增強計步器的性能
標簽： 加速度計 計步器 性能
上傳時間： 2013-10-17
上傳用戶：jcljkh
針對RC橋式低頻信號振蕩器的性能和應用，對振蕩電路的基本結構及性能指標進行探討，分別從選頻網絡、穩幅環節及頻率可調三個方面對電路性能進行改進，并結合仿真軟件進行驗證，得出性能完善，頻率可在17 Hz~265.4 kHz之間連續可調的正弦波振蕩器。
標簽： RC橋 振蕩電路 性能 仿真
上傳時間： 2013-11-23
上傳用戶：wkchong
晶體管的結構及性能
標簽： 晶體管 性能
上傳時間： 2013-10-11
上傳用戶：dudu1210004
數字接收機輸入端的信噪比對其捕獲性能具有較大的影響，文中通過理論和大量實驗反正分析了量化位數對導航信號相對捕獲峰值及信噪比的影響，并分析了在給定抗干擾指標下衛星導航抗干擾系統所需的最小及最多量化位數，為實現導航抗干擾系統時合理選擇量化位數提供了理論依據。
標簽： 量化 抗干擾 性能影響
上傳時間： 2013-10-09
上傳用戶：妄想演繹師
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