CPLD初始化程序,用于DSP5416與SAA7111A的時(shí)序控制初始化.
標(biāo)簽: 7111A CPLD 5416 7111
上傳時(shí)間: 2013-08-08
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Proteus_ISIS_techbook,用于仿真的介紹教材,比較不錯(cuò)
標(biāo)簽: Proteus_ISIS_techbook 仿真 教材
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用于USB20芯片CY7C68013和FPGA之間的通信
標(biāo)簽: C68013 68013 FPGA USB
上傳時(shí)間: 2013-08-09
上傳用戶(hù):wmwai1314
使用protel 99畫(huà)的一塊用于fpga核心板的擴(kuò)展板。適用于常見(jiàn)的FPGA開(kāi)發(fā)核心板。具體尺寸有出入可以方便的調(diào)整。
標(biāo)簽: protel fpga 核心板 擴(kuò)展板
上傳時(shí)間: 2013-08-11
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基于FPGA的快速反正切運(yùn)算實(shí)現(xiàn)方法可以用于解調(diào)的相位計(jì)算
標(biāo)簽: FPGA 反正切 運(yùn)算 實(shí)現(xiàn)方法
上傳時(shí)間: 2013-08-14
上傳用戶(hù):ommshaggar
FPGA實(shí)驗(yàn):用于檢測(cè)輸入的二進(jìn)制系列,連續(xù)輸入4個(gè)0或1,輸出1,否則輸出0。用按鍵模擬開(kāi)關(guān)輸入
標(biāo)簽: FPGA 實(shí)驗(yàn) 二進(jìn)制 用于檢測(cè)
上傳時(shí)間: 2013-08-15
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一個(gè)用于數(shù)字解調(diào)的應(yīng)用程序,主要用于數(shù)字接收機(jī)的應(yīng)用方面
標(biāo)簽: 數(shù)字解調(diào) 應(yīng)用程序
上傳時(shí)間: 2013-08-16
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FPGA可促進(jìn)嵌入式系統(tǒng)設(shè)計(jì)改善即時(shí)應(yīng)用性能,臺(tái)灣人寫(xiě)的,關(guān)于FPGA應(yīng)用的技術(shù)文章
標(biāo)簽: FPGA 嵌入式 系統(tǒng) 性能
上傳時(shí)間: 2013-08-20
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實(shí)現(xiàn)一個(gè)用于CDMA2000系統(tǒng)的短幀交織器,計(jì)算比較了12*16,13*15,14*14三種交織形式的性能!
標(biāo)簽: CDMA 2000 14 12
上傳時(shí)間: 2013-08-22
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用于FPGA向DSP傳送數(shù)據(jù)的接口,在硬件上實(shí)現(xiàn)需要FPGA的IO口與DSP的地址數(shù)據(jù)線(xiàn)互連
標(biāo)簽: FPGA DSP 傳送 數(shù)據(jù)
上傳時(shí)間: 2013-08-24
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