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抑制算法

神經(jīng)網(wǎng)絡(luò)算法的FPGA實(shí)現(xiàn)

神經(jīng)網(wǎng)絡(luò)算法的FPGA實(shí)現(xiàn)，英文版，具有很強(qiáng)的實(shí)用價(jià)值

標(biāo)簽： FPGA 神經(jīng)網(wǎng)絡(luò)算法

上傳時(shí)間： 2013-08-15

上傳用戶：cc1
運(yùn)算電路的綜合：包含多種常用數(shù)學(xué)算法的FPGA/ASIC實(shí)現(xiàn)。

運(yùn)算電路的綜合：包含多種常用數(shù)學(xué)算法的FPGA/ASIC實(shí)現(xiàn)。

標(biāo)簽： FPGA ASIC 運(yùn)算電路算法

上傳時(shí)間： 2013-08-15

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夏宇聞著作：從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn),講解比較詳細(xì)

夏宇聞著作：從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn),講解比較詳細(xì)，是一本不錯(cuò)的參考資料

標(biāo)簽： 算法設(shè)計(jì) 比較邏輯

上傳時(shí)間： 2013-08-16

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FPGA上浮點(diǎn)算法的實(shí)現(xiàn)

FPGA上浮點(diǎn)算法的實(shí)現(xiàn)，用VHDL語(yǔ)言編程

標(biāo)簽： FPGA 浮點(diǎn)算法

上傳時(shí)間： 2013-08-16

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RS譯碼的Euclid算法及其FPGA實(shí)現(xiàn)

RS譯碼的Euclid算法及其FPGA實(shí)現(xiàn)，并通過(guò)仿真器的出結(jié)果，對(duì)于設(shè)計(jì)ＲＳ譯碼很有幫助

標(biāo)簽： Euclid FPGA 譯碼算法

上傳時(shí)間： 2013-08-17

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介紹了3DES加密算法的原理并詳盡描述了該算法的FPGA設(shè)計(jì)實(shí)現(xiàn)，采用了狀態(tài)機(jī)和流水線技術(shù)

介紹了3DES加密算法的原理并詳盡描述了該算法的FPGA設(shè)計(jì)實(shí)現(xiàn)。采用了狀態(tài)機(jī)和流水線技術(shù)，使得在面積和速度上達(dá)到最佳優(yōu)化；添加了輸入和輸出接口的設(shè)計(jì)以增強(qiáng)該算法應(yīng)用的靈活性。各模塊均用硬件描述語(yǔ)言實(shí)現(xiàn)，最終下載到FPGA芯片Stratix EP1S25F780C5中。

標(biāo)簽： 3DES FPGA 加密算法算法

上傳時(shí)間： 2013-08-20

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DVD數(shù)字伺服系統(tǒng)DPD循跡伺服相位比較算法

DVD數(shù)字伺服系統(tǒng)DPD循跡伺服相位比較算法,可以根據(jù)輸出波形判斷循跡伺服情況

標(biāo)簽： DVD DPD 數(shù)字伺服系統(tǒng)

上傳時(shí)間： 2013-08-21

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用fpga實(shí)現(xiàn)dsp 的fft算法其中有幾個(gè)文檔文件和用vhdl寫的1024點(diǎn)的fft代碼

用fpga實(shí)現(xiàn)dsp 的fft算法其中有幾個(gè)文檔文件和用vhdl寫的1024點(diǎn)的fft代碼

標(biāo)簽： fft fpga 1024 vhdl

上傳時(shí)間： 2013-08-22

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在ALTERA公司的EPM570上實(shí)現(xiàn)的電機(jī)脈沖算法

在ALTERA公司的EPM570上實(shí)現(xiàn)的電機(jī)脈沖算法，編碼器反饋技術(shù)算法，已實(shí)際應(yīng)用。

標(biāo)簽： ALTERA 570 EPM 電機(jī)

上傳時(shí)間： 2013-08-22

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文檔是關(guān)于自適應(yīng)信號(hào)處理算法研究及FPGA實(shí)現(xiàn)的文章

文檔是關(guān)于自適應(yīng)信號(hào)處理算法研究及FPGA實(shí)現(xiàn)的文章，

標(biāo)簽： FPGA 文檔信號(hào)處理算法研究

上傳時(shí)間： 2013-08-27

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