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拉斯維加

  • TDSCDMA頻點(diǎn)拉遠(yuǎn)系統(tǒng)的FPGA設(shè)計(jì)與實(shí)現(xiàn)

    隨著TD—SCDMA技術(shù)的不斷發(fā)展,TD—SCDMA系統(tǒng)產(chǎn)品也逐步成熟并隨之完善。產(chǎn)品家族日益豐富,室內(nèi)型宏基站、室外型宏基站、分布式基站(BBU+RRU)、微基站等系列化基站產(chǎn)品逐步問世,可以滿足不同場(chǎng)景的建網(wǎng)需求。而分布式基站(BBU+RRU)越來越多地受到業(yè)界的關(guān)注和重視。 本文主要從TD—SCDMA頻點(diǎn)拉遠(yuǎn)系統(tǒng)(RRU)和軟件無(wú)線電技術(shù)的發(fā)展入手,重點(diǎn)研究TD—SCDMA頻點(diǎn)拉遠(yuǎn)系統(tǒng)的FPGA設(shè)計(jì)與實(shí)現(xiàn)。TD—SCDMA通信系統(tǒng)通過靈活分配不同的上下行時(shí)隙,實(shí)現(xiàn)業(yè)務(wù)的不對(duì)稱性,但是多路數(shù)字中頻所構(gòu)成的系統(tǒng)成本高和控制的復(fù)雜性,以及TDD雙工模式下,系統(tǒng)的峰均比隨時(shí)隙數(shù)增加而增加,對(duì)整個(gè)頻點(diǎn)拉遠(yuǎn)系統(tǒng)的前端放大器線性輸入提出了很高的要求。TD—SCDMA系統(tǒng)使用軟件無(wú)線電平臺(tái),一方面軟件算法可以有效保證時(shí)隙分配的準(zhǔn)確性,保證對(duì)前端控制器的開關(guān)控制,以及對(duì)上下行功率讀取計(jì)算和子幀的靈活提取,另一方面靈活的DUC/CFR算法可以有效的提高頻帶利用率和抗干擾能力,有效的控制TDD系統(tǒng)的峰均比,有效降低系統(tǒng)對(duì)前端放大器線性輸出能力的要求。 本文主要研究軟件無(wú)線電中DUC和CFR的關(guān)鍵技術(shù)以及FPGA實(shí)現(xiàn),DUC主要由3倍FIR內(nèi)插成型濾波器、2倍插值補(bǔ)償濾波器以及5級(jí)CIC濾波器級(jí)聯(lián)組成;而CFR主要采用類似基帶削峰的加窗濾波的中頻削峰算法,可以降低相鄰信道的溢出,更有效的降低CF值。將DUC/CFR以單片F(xiàn)PGA實(shí)現(xiàn),能很好提高RRU性能,減少其硬件結(jié)構(gòu),降低成本,降低功耗,增加外部環(huán)境的穩(wěn)定性。

    標(biāo)簽: TDSCDMA FPGA 頻點(diǎn)

    上傳時(shí)間: 2013-04-24

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  • 卷積編碼和維特比譯碼的FPGA實(shí)現(xiàn)

    由于其很強(qiáng)的糾錯(cuò)性能和適合硬件實(shí)現(xiàn)的編譯碼算法,卷積編碼和軟判決維特比譯碼目前已經(jīng)廣泛應(yīng)用于衛(wèi)星通信系統(tǒng)。然而隨著航天事業(yè)的發(fā)展,衛(wèi)星有效載荷種類的增多和分辨率的不斷提高,信息量越來越大。如何在低信噪比的功率受限信道條件下提高傳輸速率成為目前亟待解決的問題。本論文結(jié)合在研項(xiàng)目,在編譯碼算法、編譯碼器的設(shè)計(jì)與實(shí)現(xiàn)、編譯碼器性能提高三個(gè)方面對(duì)卷積編碼和維特比譯碼進(jìn)行了深入研究,并進(jìn)一步介紹了使用VHDL語(yǔ)言和原理圖混合輸入的方式,實(shí)現(xiàn)一種(7,3/4)增信刪余方式的高速卷積編碼器和維特比譯碼器的詳細(xì)過程;然后將設(shè)計(jì)下載到XILINX的Virtex2 FPGA內(nèi)部進(jìn)行功能和時(shí)序確認(rèn),最終在整個(gè)數(shù)據(jù)傳輸系統(tǒng)中測(cè)試其性能。本文所實(shí)現(xiàn)的維特比譯碼器速率達(dá)160Mbps,遠(yuǎn)遠(yuǎn)高于目前國(guó)內(nèi)此領(lǐng)域內(nèi)的相關(guān)產(chǎn)品速率。 首先,論文具體介紹了卷積編碼和維特比譯碼的算法,研究卷積碼的各種參數(shù)(約束長(zhǎng)度、生成多項(xiàng)式、碼率以及增信刪余等)對(duì)其譯碼性能的影響;針對(duì)項(xiàng)目需求,確定卷積編碼器的約束長(zhǎng)度、生成多項(xiàng)式格式、碼率和相應(yīng)的維特比譯碼器的回歸長(zhǎng)度。 其次,論文介紹了編解碼器的軟、硬件設(shè)計(jì)和調(diào)試一根據(jù)已知條件,使用VHDL語(yǔ)言和原理圖混合輸入的方式設(shè)計(jì)卷積編碼和維特比譯碼的源代碼和原理圖,分別采用功能和電路級(jí)仿真,確定卷積編碼和維特比譯碼分別需要占用的資源,考慮卷積編碼器和維特比譯碼器的具體設(shè)計(jì)問題,包括編譯碼的基本結(jié)構(gòu),各個(gè)模塊的功能及實(shí)現(xiàn)策略,編譯碼器的時(shí)序、邏輯綜合等;根據(jù)軟件仿真結(jié)果,分別確定卷積編碼器和維特比譯碼器的接口、所需的FPGA器件選型和進(jìn)行各自的印制板設(shè)計(jì)。利用卷積碼本身的特點(diǎn),結(jié)合FPGA內(nèi)部結(jié)構(gòu),采用并行卷積編碼和譯碼運(yùn)算,設(shè)計(jì)出高速編譯碼器;對(duì)軟、硬件分別進(jìn)行驗(yàn)證和調(diào)試,并將驗(yàn)證后的軟件下載到FPGA進(jìn)行電路級(jí)調(diào)試。 最后,論文討論了卷積編碼和維特比譯碼的性能:利用已有的測(cè)試設(shè)備在整個(gè)數(shù)據(jù)傳輸系統(tǒng)中測(cè)試其性能(與沒有采用糾錯(cuò)編碼的數(shù)傳系統(tǒng)進(jìn)行比對(duì));在信道中加入高斯白噪聲,模擬高斯信道,進(jìn)行誤碼率和信噪比測(cè)試。

    標(biāo)簽: FPGA 卷積 編碼 譯碼

    上傳時(shí)間: 2013-04-24

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  • Altium Designer 6 三維元件庫(kù)建模教程

    Altium Designer 6 三維元件庫(kù)建模教程 文檔名稱:AD系列軟件三維元件庫(kù)建模教程 文檔描述:介紹在 AltiumDesigner集成開發(fā)平臺(tái)下三維模型建立和使用方法 文檔版本:V1.0 作     者:林加添(lineay) 編寫時(shí)間:2009 年1 月 QQ:181346072 第一章:介紹 在傳統(tǒng)的電子整機(jī)設(shè)計(jì)過程中,電路設(shè)計(jì)部門和結(jié)構(gòu)設(shè)計(jì)部門(或者由外部設(shè)計(jì)工作室設(shè)計(jì))往往是被分為 兩個(gè)完全獨(dú)立的部門,因此在新產(chǎn)品開發(fā)過程中,都是結(jié)構(gòu)設(shè)計(jì)好了,然后出內(nèi)部 PCB 位置圖給 PCB 工程師, 而結(jié)構(gòu)工程師并不了解電路設(shè)計(jì)過程中一些要點(diǎn)。對(duì) PCB布局一些高度較高元器件位置很多并不符合 PCB 工程 師電路設(shè)計(jì)的要求。以至 PCB 工程師不得不將就結(jié)構(gòu)工程師所設(shè)計(jì)的元件布局。最后產(chǎn)品出來時(shí),因?yàn)?PCB 布 局不合理等各種因素,問題百出。這不僅影響產(chǎn)品開發(fā)速度。也會(huì)導(dǎo)致企業(yè)兩部門之間發(fā)生沖突。 然而目前國(guó)內(nèi)大多的電子企業(yè)都是停留于這種狀態(tài),關(guān)鍵原因目前電路部門和結(jié)構(gòu)部門沒有一個(gè)有效、快捷 的軟件協(xié)作接口來幫助兩個(gè)部分之間更好協(xié)調(diào)工作、來有效提高工作效率。而面對(duì)競(jìng)爭(zhēng)日益激烈的市場(chǎng)。時(shí)間就 是金錢,產(chǎn)品開發(fā)周期加長(zhǎng)而導(dǎo)致開發(fā)成本加劇,也延誤了產(chǎn)品上市的時(shí)間。這不僅降低了企業(yè)在市場(chǎng)的競(jìng)爭(zhēng)力 也加速了企業(yè)倒退的步伐。對(duì)于企業(yè)來說,都希望有一個(gè)有效的協(xié)調(diào)接口來加速整機(jī)的開發(fā)速度,從而提高產(chǎn)品

    標(biāo)簽: Designer Altium 元件庫(kù) 建模

    上傳時(shí)間: 2013-10-22

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  • 用單片機(jī)制作多功能莫爾斯碼電路

    用單片機(jī)制作多功能莫爾斯碼電路:用單片機(jī)制作多功能莫爾斯碼電路莫爾斯電碼通信有著悠久的歷史,盡管它已被現(xiàn)代通信方式所取代,但在業(yè)余無(wú)線電通信和特殊的專業(yè)場(chǎng)合仍具有重要的地位,這是因?yàn)榈确姶a通信的抗干擾能力是其它任何一種通信方式都無(wú)法相比的。在短波波段用幾瓦的功率即可進(jìn)行國(guó)際間的通信,收發(fā)射設(shè)備簡(jiǎn)單易制成本低廉,所以深受業(yè)余無(wú)線電愛好者的喜愛,是業(yè)余無(wú)線電高手必備的技能。要想熟練掌握莫爾斯電碼的收發(fā)技術(shù)除了持之以恒的毅力外,還需要相關(guān)的設(shè)備。設(shè)計(jì)本電路的目的就是給愛好者提供一個(gè)實(shí)用和訓(xùn)練的工具。  一、功能簡(jiǎn)介    本電路可以配合自動(dòng)鍵體和手動(dòng)鍵體,產(chǎn)生莫爾斯碼控制信號(hào),設(shè)有16種速度,從初學(xué)者到操作高手都能適用。監(jiān)聽音調(diào)也有16種,均可以通過功能鍵進(jìn)行選擇。可以按程序中設(shè)定好的呼號(hào)自動(dòng)呼叫,設(shè)有聽抄練習(xí)功能,聽抄練習(xí)有短碼和混合碼兩種模式,分別對(duì)10個(gè)數(shù)字和常用的38個(gè)混合碼模擬隨機(jī)取樣,產(chǎn)生分組報(bào)碼,供愛好者提高抄收水平之用,速度低4檔的聽抄練習(xí)是專為初學(xué)者所設(shè),內(nèi)容是時(shí)間間隔較長(zhǎng)的單字符。設(shè)有PTT開關(guān)鍵,可以決定是否控制發(fā)射機(jī)工作,不需要反復(fù)通斷控制線。無(wú)論當(dāng)前處于呼叫狀態(tài)還是聽抄狀態(tài)只要電鍵接點(diǎn)接通則自動(dòng)轉(zhuǎn)到人工發(fā)報(bào)程序。4分鐘內(nèi)不使用電路將自動(dòng)關(guān)閉電源,只有按復(fù)位鍵才能重新開始工作。先按住聽抄練習(xí)鍵復(fù)位則進(jìn)入短碼練習(xí)狀態(tài),其它功能不變。從開機(jī)到自動(dòng)關(guān)機(jī)執(zhí)行每個(gè)功能都有不同的莫爾斯碼提示音。本電路具有較強(qiáng)的抗高低頻干擾的能力和使用方便的大電流開關(guān)接口,以適應(yīng)不同的發(fā)射設(shè)備。    二、硬件電路原理硬件電路如圖1所示。設(shè)計(jì)電路的目的在于方便實(shí)用,以免在緊張的操作中失誤,所以除了聽抄練習(xí)鍵外其它鍵沒有定義復(fù)用功能。各鍵的作用在圖中已經(jīng)標(biāo)出。PTT控制在每次復(fù)位時(shí)處于關(guān)閉狀態(tài),每按動(dòng)一次PTT功能鍵則改變一次狀態(tài),這樣可以使用軟件開關(guān)控制發(fā)射。 PTT處于控制狀態(tài)時(shí)發(fā)光二極管隨控制信號(hào)閃亮。考慮到自制設(shè)備及淘汰軍用設(shè)備與高檔設(shè)備控制電流的不同,PTT開關(guān)管采用了2SC2073,可以承受500mA的電流,同時(shí)還增加了無(wú)極性PTT開關(guān)電路,無(wú)論外部被控制的端口直流極性如何加到VT3的極性始終不變,供有興趣的愛好者實(shí)驗(yàn)。應(yīng)該注意,如果被控制的負(fù)載是感性,則電感兩端必須并聯(lián)續(xù)流二極管,除自制設(shè)備外成品機(jī)在這方面一般沒有什么問題。手動(dòng)鍵只有一個(gè)接點(diǎn),接通后產(chǎn)生連續(xù)的音頻和發(fā)射控制信號(hào)。在本電路中手動(dòng)鍵的輸入端是P1.5 ,程序不斷檢測(cè)P1.5電平,當(dāng)按鍵按下時(shí)P1.5電平為0,程序轉(zhuǎn)入手動(dòng)鍵子程序。 自動(dòng)鍵的接點(diǎn)分別接到P1.3和P1.4 ,同樣當(dāng)程序檢測(cè)到有接點(diǎn)閉合時(shí)便自動(dòng)產(chǎn)生“點(diǎn)”或“劃”。音頻信號(hào)從P輸出,經(jīng)VT1放大后推動(dòng)揚(yáng)聲器發(fā)音。單片機(jī)的I/O口在輸入狀態(tài)下阻抗較高,容易受到高低頻信號(hào)干擾,所以在每個(gè)輸入端口和三極管的be端并聯(lián)電阻和高頻旁路電容,確保在較長(zhǎng)的電鍵連線和大功率發(fā)射時(shí)電路工作穩(wěn)定。圖2是印刷電路版圖,尺寸為110mmX85mm,揚(yáng)聲器用粘合劑直接粘接在電路版有銅箔的面。    三、軟件設(shè)計(jì)方法  “點(diǎn)”時(shí)間長(zhǎng)度是莫爾斯電碼中的基本時(shí)間單位。按規(guī)定“劃”的時(shí)間長(zhǎng)度不小于三個(gè)“點(diǎn)”,同字符中“點(diǎn)”與“劃”的間隔不小于一個(gè)“點(diǎn)”,字符之間不小于一個(gè)“劃”,詞與詞之間不應(yīng)小于五個(gè)“點(diǎn)”。在本程序中用條件轉(zhuǎn)移指令來產(chǎn)生“點(diǎn)”時(shí)間長(zhǎng)度。通過速度功能鍵功可以設(shè)置16種延時(shí)參數(shù)。用T0中斷產(chǎn)生監(jiān)聽音頻信號(hào),并將中斷設(shè)為優(yōu)先級(jí),保證在聽覺上純正悅耳。T1用于自動(dòng)關(guān)機(jī)計(jì)時(shí),如果不使用任何功能四分鐘后將向PCON 位寫1,單片機(jī)進(jìn)入休眠狀態(tài),此時(shí)耗電量?jī)H有幾個(gè)微安。自動(dòng)鍵的“點(diǎn)”或“劃”以及手動(dòng)鍵的連續(xù)發(fā)音都是子程序的反復(fù)調(diào)用。P1.2對(duì)地短接時(shí)自動(dòng)呼叫可設(shè)定為另一內(nèi)容。為了便于熟悉匯編語(yǔ)言的讀者對(duì)發(fā)音內(nèi)容進(jìn)行修改,這里介紹發(fā)音字符的編碼方法。莫爾斯碼的信息與計(jì)算機(jī)中二進(jìn)制恰好相同,我們可以用0表示“點(diǎn)”,用1表示“劃”。提示音、自動(dòng)呼叫、聽抄內(nèi)容等字符是預(yù)先按一定編碼方式存儲(chǔ)在程序中的常數(shù)。每個(gè)字符的莫爾斯碼一般是由1至6位“點(diǎn)”、“劃”組成,也就是發(fā)音次數(shù)最多6次。程序中每個(gè)字符占用1個(gè)字節(jié),字符時(shí)間間隔不占用字節(jié),但更長(zhǎng)的延時(shí)或發(fā)音結(jié)束信息占用一個(gè)字節(jié)。我們用字節(jié)的低三位表示字節(jié)的性質(zhì),對(duì)于5次及5次以下發(fā)音的字符我們用存儲(chǔ)器的高5位存儲(chǔ)發(fā)音信息,發(fā)音順序由高位至低位,用低3位存儲(chǔ)發(fā)音次數(shù),發(fā)音時(shí)將數(shù)據(jù)送入累加器A,先得到發(fā)音次數(shù),然后使A左環(huán)移,對(duì)E0進(jìn)行位尋址,判斷是發(fā)“點(diǎn)”還是“劃”,環(huán)移次數(shù)由發(fā)音次數(shù)決定。對(duì)于6次發(fā)音的字符不能完全按照上述編碼規(guī)則,否則會(huì)出現(xiàn)信息重疊,如果是6次發(fā)音且最后一次是“劃”我們把發(fā)音次數(shù)定義為111B,因?yàn)檫@時(shí)第6次位尋址得到的是1。如果第6次發(fā)音是“點(diǎn)”,那么這個(gè)字符的低三位定義為000B。字符間隔時(shí)間由程序自動(dòng)產(chǎn)生,更長(zhǎng)的時(shí)間隔或結(jié)束標(biāo)志由字節(jié)低三位110B來定義,高半字節(jié)表示字符間隔的倍數(shù),例如26H表示再加兩倍時(shí)間間隔。如果字節(jié)為06H則表示讀字符程序結(jié)束,返回主程序。更詳細(xì)的內(nèi)容不再贅述,讀者可閱讀源程序。四、使用注意事項(xiàng)手動(dòng)鍵的操作難度相對(duì)大一些,時(shí)間節(jié)拍全由人掌握,其特點(diǎn)是發(fā)出的電碼帶有“人情味”。自動(dòng)鍵的“點(diǎn)”、“劃”靠電路產(chǎn)生,發(fā)音標(biāo)準(zhǔn),容易操作,而且可以達(dá)到相當(dāng)快的速度,長(zhǎng)時(shí)間工作也不易疲勞。在干擾較大、信號(hào)微弱的條件下自動(dòng)鍵碼的辨別程度好于手動(dòng)鍵碼。初學(xué)者初次使用手動(dòng)鍵練習(xí)發(fā)報(bào)要有老師指導(dǎo),且不可我行我素,一旦養(yǎng)成不正確的手法則很難糾正。在電臺(tái)上時(shí)常聽到一些讓對(duì)方難以抄收的電碼,這可能會(huì)使對(duì)方反感而拒絕回答。使用自動(dòng)鍵也應(yīng)在一定的聽抄基礎(chǔ)上再去練習(xí)。在暫時(shí)找不老師的情況下可多練習(xí)聽力,這對(duì)于今后能夠發(fā)出標(biāo)準(zhǔn)正確的電碼非常有益。

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    上傳時(shí)間: 2013-10-31

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  • Altium Designer 6 三維元件庫(kù)建模教程

    Altium Designer 6 三維元件庫(kù)建模教程 文檔名稱:AD系列軟件三維元件庫(kù)建模教程 文檔描述:介紹在 AltiumDesigner集成開發(fā)平臺(tái)下三維模型建立和使用方法 文檔版本:V1.0 作     者:林加添(lineay) 編寫時(shí)間:2009 年1 月 QQ:181346072 第一章:介紹 在傳統(tǒng)的電子整機(jī)設(shè)計(jì)過程中,電路設(shè)計(jì)部門和結(jié)構(gòu)設(shè)計(jì)部門(或者由外部設(shè)計(jì)工作室設(shè)計(jì))往往是被分為 兩個(gè)完全獨(dú)立的部門,因此在新產(chǎn)品開發(fā)過程中,都是結(jié)構(gòu)設(shè)計(jì)好了,然后出內(nèi)部 PCB 位置圖給 PCB 工程師, 而結(jié)構(gòu)工程師并不了解電路設(shè)計(jì)過程中一些要點(diǎn)。對(duì) PCB布局一些高度較高元器件位置很多并不符合 PCB 工程 師電路設(shè)計(jì)的要求。以至 PCB 工程師不得不將就結(jié)構(gòu)工程師所設(shè)計(jì)的元件布局。最后產(chǎn)品出來時(shí),因?yàn)?PCB 布 局不合理等各種因素,問題百出。這不僅影響產(chǎn)品開發(fā)速度。也會(huì)導(dǎo)致企業(yè)兩部門之間發(fā)生沖突。 然而目前國(guó)內(nèi)大多的電子企業(yè)都是停留于這種狀態(tài),關(guān)鍵原因目前電路部門和結(jié)構(gòu)部門沒有一個(gè)有效、快捷 的軟件協(xié)作接口來幫助兩個(gè)部分之間更好協(xié)調(diào)工作、來有效提高工作效率。而面對(duì)競(jìng)爭(zhēng)日益激烈的市場(chǎng)。時(shí)間就 是金錢,產(chǎn)品開發(fā)周期加長(zhǎng)而導(dǎo)致開發(fā)成本加劇,也延誤了產(chǎn)品上市的時(shí)間。這不僅降低了企業(yè)在市場(chǎng)的競(jìng)爭(zhēng)力 也加速了企業(yè)倒退的步伐。對(duì)于企業(yè)來說,都希望有一個(gè)有效的協(xié)調(diào)接口來加速整機(jī)的開發(fā)速度,從而提高產(chǎn)品

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    上傳時(shí)間: 2013-11-16

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  • 基本算法思想 OPT:該算法的基本思想是用二維數(shù)組page2[40][2] 的第一列存儲(chǔ)裝入內(nèi)存的頁(yè)面

    基本算法思想 OPT:該算法的基本思想是用二維數(shù)組page2[40][2] 的第一列存儲(chǔ)裝入內(nèi)存的頁(yè)面,而第二列用作標(biāo)記位計(jì)數(shù)器。每當(dāng)發(fā)生缺頁(yè)時(shí),就從內(nèi)存中調(diào)出一頁(yè),首先將內(nèi)存中的頁(yè)面一一與要調(diào)入內(nèi)存中的頁(yè)面之后的頁(yè)面比較,如果兩個(gè)頁(yè)面不相等,則內(nèi)存中相應(yīng)的頁(yè)面的標(biāo)記位計(jì)數(shù)器加一,直至到有相等的頁(yè)面,則該頁(yè)面的比較停止,再重復(fù)以上操作,直至內(nèi)存中的頁(yè)面全部比較完。然后找出內(nèi)存中頁(yè)面的標(biāo)記位最大的頁(yè)面,而該頁(yè)就是要置換出來的頁(yè)。 FIFO: 該算法的基本思想是用隊(duì)列queue存儲(chǔ)內(nèi)存中的頁(yè)面,隊(duì)列的特點(diǎn)是先進(jìn)先出,與該算法是一致的,所以每當(dāng)發(fā)生缺頁(yè)時(shí),就從隊(duì)頭刪除一頁(yè),即隊(duì)頭指針加一,而從隊(duì)尾加入缺頁(yè),隊(duì)尾指針加一。 LRU: 該算法的基本思想是用二維數(shù)組page2[40][2] 的第一列存儲(chǔ)裝入內(nèi)存的頁(yè)面,而第二列用作標(biāo)記位計(jì)數(shù)器。每當(dāng)使用頁(yè)面時(shí),該頁(yè)面的標(biāo)記位計(jì)數(shù)器加一。發(fā)生缺頁(yè)時(shí),就從內(nèi)存中頁(yè)面標(biāo)記最小的一頁(yè),調(diào)出該頁(yè),并且該頁(yè)后面的頁(yè)面在數(shù)組中的位置前移,而缺頁(yè)就放在數(shù)組后面。

    標(biāo)簽: page2 OPT 算法 40

    上傳時(shí)間: 2013-12-26

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  • OWEN和HINTON編制的二維結(jié)構(gòu)非線性有限員原代碼

    OWEN和HINTON編制的二維結(jié)構(gòu)非線性有限員原代碼,這兩個(gè)人可是英國(guó)斯往西大學(xué)的大牛,程序非常具有參考價(jià)值,希望搞非線性有限員飛吸的同學(xué)即使下載,肯定很有幫助的了

    標(biāo)簽: HINTON OWEN 編制 二維

    上傳時(shí)間: 2014-01-08

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  • 實(shí)現(xiàn)4位加減乘除的alu

    實(shí)現(xiàn)4位加減乘除的alu,采用超前進(jìn)位加法和布斯乘法,代碼較為簡(jiǎn)單。

    標(biāo)簽: alu

    上傳時(shí)間: 2013-12-22

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  • 摘 要:基于材料的各向同性理論,根據(jù)應(yīng)力—應(yīng)變?cè)隽筷P(guān)系,建立了一個(gè)混凝土的三維本構(gòu)關(guān)系模型。采用 了目前較為成熟的Ottosen的破壞準(zhǔn)則,利用了Sargin的單軸應(yīng)力—應(yīng)變關(guān)系,并在三維增量非線

    摘 要:基于材料的各向同性理論,根據(jù)應(yīng)力—應(yīng)變?cè)隽筷P(guān)系,建立了一個(gè)混凝土的三維本構(gòu)關(guān)系模型。采用 了目前較為成熟的Ottosen的破壞準(zhǔn)則,利用了Sargin的單軸應(yīng)力—應(yīng)變關(guān)系,并在三維增量非線性關(guān)系中引入等 效單軸切線模量。所用的模型中的參數(shù)是根據(jù)前人的經(jīng)驗(yàn)和實(shí)驗(yàn)來取定的。通過對(duì)混凝土的各向受拉、受壓和拉 壓結(jié)合的分析表明,所建立的模型較為簡(jiǎn)單、實(shí)用。

    標(biāo)簽: Ottosen Sargin 應(yīng)力 增量

    上傳時(shí)間: 2014-12-09

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  • 可移植的積分算法

    可移植的積分算法 ,提供了數(shù)種方法(變步長(zhǎng)梯形求積分;變步長(zhǎng)辛卜生求積分;自適應(yīng)梯形求積分;龍貝格求積分;計(jì)算一維積分的連分式法;高振蕩函數(shù)求積分;勒讓德-高斯求積分;拉蓋爾-高斯求積分;埃爾米特-高斯求積分) ,比較實(shí)用

    標(biāo)簽: 移植 積分算法

    上傳時(shí)間: 2013-12-17

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