本文介紹了AD公司的RF/IF相位和幅度測量芯片AD8302,并以此芯片為核心,組合功分器、延遲線和FPGA芯片設計了瞬時測頻接收機,改進了傳統的設計方案。依照設計制作了測頻系統,并對系統整體性能進行了測試,測試結果表明本系統可以準確測量1.4~2.0 GHz范圍內的信號,測頻精度為10 MHz。
標簽: 數字測頻 接收機
上傳時間: 2013-10-26
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文章在分析電路噪聲、等效噪聲輸入帶寬和自動增益控制原理的基礎上, 介紹了一種低頻接收機自動增益控制電路的設計。
標簽: 低頻接收機 自動增益 控制電路 分
上傳時間: 2014-12-23
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基于DSP_FPGA的GPS接收機平臺設計
標簽: DSP_FPGA GPS 接收機 平臺設計
上傳時間: 2014-12-28
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基于FPGA芯片Stratix II EP2S60F672C4設計了一個適用于寬帶數字接收機的帶寬可變的數字下變頻器(VB-DDC)。該VB-DDC結合傳統數字下變頻結構與多相濾波結構的優點,實現了對輸入中頻信號的高效高速處理,同時可以在較大范圍內對信號處理帶寬靈活配置。硬件調試結果驗證了本設計的有效性。
標簽: FPGA 寬帶數字 接收機 帶寬
上傳時間: 2013-11-03
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在衛星的地面測試中,地面模擬系統發送遙控遙測信號并接收衛星的返回信號,將其下變頻到中頻進行解調,從而獲取衛星工作狀態和運行環境,模擬其在軌運行工作情況。針對目前采用有源相控陣天線技術的衛星地面測試,本文設計實現了一種DBF體制的地面模擬系統接收機,該接收機采用超外差式二次變頻設計,具有高增益、低噪聲系數、低群時延波動、良好的通道間幅相一致性和穩定性,同時集成度高,體積小,可制造性強,能夠充分的滿足采用有源相控陣技術的衛星地面測試要求。
標簽: DBF 模擬系統 收機設計
上傳時間: 2013-11-11
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一篇關于Rake接收的很好的論文,多載波擴頻通信的Rake接收機理論研究及FPGA實現。
標簽: Rake FPGA 多載波 擴頻通信
上傳時間: 2013-11-09
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衛星導航接收機接收到的衛星信號十分微弱,同時面臨著復雜電磁環境的干擾,因而抗干擾問題成為研究的熱點。目前有很多種抗干擾技術及算法僅局限于理論研究和數字仿真,無法在實際干擾環境下測試抗干擾接收機的抗干擾性能。本文在研究波束形成天線抗干擾算法的基礎上,基于微波暗室環境下建立抗干擾接收機的半物理仿真環境,實現衛星信號多天線輸出、復雜干擾環境的模擬,對四波束、八波束天線抗干擾接收機進行了仿真測試,結果表明波束形成天線抗干擾接收機在輸入干信比相同的情況下,波束數目越多抗干擾接收機性能越好。
標簽: 波束形成 天線抗干擾 接收機 測試
上傳時間: 2013-10-20
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隨著GPS、GALILEO、GLONASS以及我國北斗導航定位系統的不斷發展,基于多星座下的GNSS接收機自主完好性監測算法也已被國內外學者廣泛研究。本文首先介紹了接收機自主完好性監測(RAIM)算法的原理,然后分別對單星座、多星座組合下的RAIM算法進行了研究和仿真,圖形化和數據化的仿真結果充分證明了多星座組合下的完好性監測性能優于單星座下完好性監測性能。
標簽: GNSS 接收機 監測 算法研究
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隨著信號速率的不斷提升,只對高速信號的發送端物理層測試已經不能夠完全反應系統的特性,因此接收機測試也已成為了高速信號的必測項目,尤其是對于信號速率高于5Gbps以上,規范均會規定要求產品必須通過接收機一致性測試。接收端測試的基本原理是測試儀器(通常使用誤碼分析儀或者信號源和能分析誤碼的專用協議分析儀來完成)發出特定的碼型給被測接收端,接收端在環回(Loopback)模式下再將數據接收、恢復后通過其Tx端發送回測試儀器,由測試儀器完成其發出去的數據和接收到的數據的對比,從而分析出誤碼的數量。
標簽: PCIE 3.0 力科 接收機
上傳時間: 2013-10-22
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在數字接收機中,為了在抽樣判決時刻準確判決發送過來的碼元,需要提供一個確定抽樣判決時刻的定時脈沖序列。這個定時脈沖序列的重復頻率必須與發送的數碼脈沖序列一致(即接收、發送雙方必須同步,具有相同的主頻率),同時在最佳判決時刻對接收碼元進行抽樣判決。這樣的定時脈沖序列稱為碼元同步。
標簽: ADS 接收機 碼元同步算法
上傳時間: 2013-10-16
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