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擴(kuò)展設(shè)計(jì)

  • CAN波特率計算

    CAN波特率計算軟件 為了方便計算出 NXP 系列CAN 控制器(不包括NXP ARM 內嵌的CAN 控制器)的波特率

    標簽: CAN 波特率

    上傳時間: 2016-11-24

    上傳用戶:test1111

  • 超級兔子魔法設定 v5.88

    超級兔子魔法設定 v5.88 繁體中文版 含序號

    標簽: v5 88

    上傳時間: 2017-05-05

    上傳用戶:kiili2

  • J.K. Rowling Harry Potter Prequel

    J.K. Rowling - HP 0 - Harry Potter Prequel.pdf

    標簽: J.K. Rowling Prequel Potter Harry

    上傳時間: 2020-01-03

    上傳用戶:nothingtiger

  • 展訊刷機工具驅動教程&

    展訊平臺刷機工具Researchdownload,本版本工具可以用來刷寫線刷固件的,當然也不排除其它基于CPU的手機能使用。本軟件適合展訊芯片手機刷機使用,一般刷機包格式為:*.pac,使用前請安裝壓縮包內的驅動文件(DPInst.exe),64位系統請手動到驅動文件夾下安裝x64。

    標簽: 展訊 刷機工具 驅動 教程

    上傳時間: 2020-11-30

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  • j-link V466

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    標簽: j-link V466

    上傳時間: 2021-03-23

    上傳用戶:koko440

  • 高速電路設計 詳細基礎理論知識

    設計高速電路必須考慮高速訊 號所引發的電磁干擾、阻抗匹配及串音等效應,所以訊號完整性 (signal  integrity)將是考量設計電路優劣的一項重要指標,電路日異複雜必須仰賴可 靠的軟體來幫忙分析這些複雜的效應,才比較可能獲得高品質且可靠的設計, 因此熟悉軟體的使用也將是重要的研究項目之一。另外了解高速訊號所引發之 各種效應(反射、振鈴、干擾、地彈及串音等)及其克服方法也是研究高速電路 設計的重點之一。目前高速示波器的功能越來越多,使用上很複雜,必須事先 進修學習,否則無法全盤了解儀器之功能,因而無法有效發揮儀器的量測功能。 其次就是高速訊號量測與介面的一些測試規範也必須熟悉,像眼圖分析,探針 效應,抖動(jitter)測量規範及高速串列介面量測規範等實務技術,必須充分 了解研究學習,進而才可設計出優良之教學教材及教具。

    標簽: 高速電路

    上傳時間: 2021-11-02

    上傳用戶:jiabin

  • 華為開關電源電感器設計.pdf

    華為開關電源電感器設計 正激式開關電源變壓器設計步驟

    標簽: 華為 開關電源

    上傳時間: 2021-12-03

    上傳用戶:fliang

  • SAE-J-協議培訓教程-中文

    SAE-J-協議培訓教程-中文,有需要的可以參考!

    標簽: SAE-J-協議

    上傳時間: 2022-02-04

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  • J-LINK下載器

    首先下載軟件,解壓軟件,安裝在程序中找到SEGGER,選里面的J-FLASH,進入界面,剛開始的那個界面可以忽略,不用建project也可以;單擊菜單欄的“Options---Project settings”打開設置,進行jlink配置;正在General選項,選擇“USB”,一般都是默認配置,確認一下即可;然后在CPU選項,選擇芯片型號,先選擇“Device”才能選擇芯片型號,芯片型號,要根據你使用的芯片進行選擇;在Target interface選項 里面選擇SWD模式;首先Target里面選“Connection”連接目標芯片,然后 Target--Auto進行程序燒寫;首先Target里面選擇“Connection”連接目標芯片,然后 Target--Auto進行程序燒寫.SEGGER J-Links are the most widely used line of debug probes available today. They've proven their value for more than 10 years in embedded development. This popularity stems from the unparalleled performance, extensive feature set, large number of supported CPUs, and compatibility with all popular development environments.

    標簽: JLINK

    上傳時間: 2022-03-22

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  • cadence-allegro16.6高級教程

    主要內容介紹 Allegro 如何載入 Netlist,進而認識新式轉法和舊式轉法有何不同及優缺點的分析,透過本章學習可以對 Allegro 和 Capture 之間的互動關係,同時也能體驗出 Allegro 和 Capture 同步變更屬性等強大功能。Netlist 是連接線路圖和 Allegro Layout 圖檔的橋樑。在這裏所介紹的 Netlist 資料的轉入動作只是針對由 Capture(線路圖部分)產生的 Netlist 轉入 Allegro(Layout部分)1. 在 OrCAD Capture 中設計好線路圖。2. 然後由 OrCAD Capture 產生 Netlist(annotate 是在進行線路圖根據第五步產生的資料進行編改)。 3. 把產生的 Netlist 轉入 Allegro(layout 工作系統)。 4. 在 Allegro 中進行 PCB 的 layout。 5. 把在 Allegro 中產生的 back annotate(Logic)轉出(在實際 layout 時可能對原有的 Netlist 有改動過),並轉入 OrCAD Capture 裏進行回編。

    標簽: cadence allegro

    上傳時間: 2022-04-28

    上傳用戶:kingwide

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