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數(shù)字信號處理器

數(shù)字信號處理器(英文:DigitalSignalProcessor)是由大規(guī)模或超大規(guī)模集成電路芯片組成的用來完成數(shù)字信號處理任務(wù)的處理器。
  • 數(shù)字信號處理及其matlab實現(xiàn).pdf

    數(shù)字信號處理、離散時間信號與系統(tǒng)、DFT、FFT等,MATLAB仿真

    標(biāo)簽: matlab 數(shù)字信號處理

    上傳時間: 2013-07-29

    上傳用戶:685

  • BISS0001 紅外傳感信號處理器

    BISS0001是我公司自主設(shè)計地紅外傳感信號處理器專用集成電路,它配以熱釋電紅外傳感器和少量外元器件可以構(gòu)成被動式紅外開關(guān)。它能自動快速開啟各類白熾燈、熒光燈、蜂鳴器、自動門、電風(fēng)扇、烘干機和自動洗

    標(biāo)簽: BISS 0001 紅外傳感 信號處理器

    上傳時間: 2013-07-14

    上傳用戶:一諾88

  • 基于FPGA和DSP技術(shù)的二次雷達(dá)應(yīng)答處理器

    該論文介紹二次雷達(dá)的基本概念、發(fā)展歷史、工作流程和運作機理以及單脈沖二次雷達(dá)的系統(tǒng)原理,并且對傳統(tǒng)的單脈沖二次雷達(dá)應(yīng)答信號處理器的硬件結(jié)構(gòu)進(jìn)行改進(jìn),提出一種全新的應(yīng)答處理器硬件結(jié)構(gòu),即FPGA+DSP的混合結(jié)構(gòu).這種硬件結(jié)構(gòu)的特點是結(jié)構(gòu)靈活,有較強的通用性.該論文圍繞FPGA+DSP這種數(shù)字信號處理的硬件結(jié)構(gòu),闡述了它在單脈沖二次雷達(dá)應(yīng)答數(shù)字信號處理器中的應(yīng)用,使用VHDL語言設(shè)計FPGA程序,并且給出主要模塊的仿真結(jié)果.FPGA主要完成距離計數(shù)、方位計數(shù)、脈沖分解、產(chǎn)生應(yīng)答數(shù)據(jù)送給DSP、與PC104交換報表等功能.長時間的成功試驗表明,基于FPGA和DSP技術(shù)的二次雷達(dá)應(yīng)答信號處理器在3毫秒內(nèi)可以同時處理四個重疊應(yīng)答,計算所接收的每一個脈沖的到達(dá)方向,得到真實脈沖并且給出脈沖置信度.系統(tǒng)達(dá)到了預(yù)期的目的.該課題的另外一個重要意義是對傳統(tǒng)的二次監(jiān)視雷達(dá)應(yīng)答信號處理器進(jìn)行了改進(jìn),使單脈沖二次雷達(dá)系統(tǒng)的應(yīng)答處理能力在可靠性、穩(wěn)定性和系統(tǒng)精度三個方面有質(zhì)的飛躍.

    標(biāo)簽: FPGA DSP 二次雷達(dá) 處理器

    上傳時間: 2013-04-24

    上傳用戶:gokk

  • 干涉型光纖水聽器信號解調(diào)方法研究

    光纖水聽器自問世以來,在巨大的軍事價值和民用價值推動下得到了迅速發(fā)展,已逐漸從實驗室研究階段走向工程應(yīng)用。同時隨著光纖水聽器的不斷發(fā)展,對水聲信號的檢測技術(shù)以及數(shù)字處理能力也提出了新的要求。論文在此背景下開展了一系列研究工作,并提出了利用FPGA(Field ProgrammableGate Array,現(xiàn)場可編程門陣列)實現(xiàn)光纖3×3耦合器解調(diào)算法的新思路。 目前干涉型光纖水聽器的解調(diào)一般采用PGC(Phase Generated Carrier,相位生成載波技術(shù))技術(shù)和基于3×3光纖耦合器干涉的解調(diào)技術(shù)。PGC技術(shù)在解調(diào)過程中引入了載波信號,它對采樣率,激光器等的要求都較高,因此我們把目光投向3×3耦合器解調(diào)技術(shù),文中對其解調(diào)原理進(jìn)行了闡述,對采樣率的確定進(jìn)行了討論,并對3×3耦合器三路輸出不對稱的情況進(jìn)行了分析,最后在本文的結(jié)論部分提出了基于3×3耦合器解調(diào)的改良方案。 目前,光纖信號數(shù)字化解調(diào)的硬件實現(xiàn)采用DSP(Digital Signal Process,可編程數(shù)字信號處理器)信號處理機,與之相比,F(xiàn)PGA解調(diào)具有速度快、資源占用少、易于擴展等優(yōu)勢。本文對FPGA與DSP、ASIC(application-specificintegrated circuit,專用集成電路)實現(xiàn)方案進(jìn)行了對比,分析了適合利用FPGA實現(xiàn)的算法所應(yīng)具備的特征;介紹了3×3耦合器解調(diào)算法中各個模塊的設(shè)計情況;分析了系統(tǒng)的工作情況,硬件的構(gòu)造及芯片的選擇,最后驗證了利用FPGA可以實現(xiàn)3×3耦合器解調(diào)算法。

    標(biāo)簽: 干涉型 光纖水聽器 信號解調(diào) 方法研究

    上傳時間: 2013-07-03

    上傳用戶:love1314

  • 數(shù)字信號處理與噪音抑制

    數(shù)字信號處理與噪音抑制Advanced Digital Signal Processing and Noise Reduction,這個是第二版。

    標(biāo)簽: 數(shù)字信號處理

    上傳時間: 2013-04-24

    上傳用戶:Avoid98

  • 基于FPGA的數(shù)字信號發(fā)生器

    數(shù)字信號發(fā)生器是數(shù)字信號處理中不可缺少的調(diào)試設(shè)備。在某工程項目中,為了提供特殊信號,比如雷達(dá)信號,就需要設(shè)計專用的數(shù)字信號發(fā)生器,用以達(dá)到發(fā)送雷達(dá)信號的要求。在本文中提出了使用PCI接口的專用數(shù)字信號發(fā)生器方案。 該方案的目標(biāo)是能夠采錄雷達(dá)信號,把信號發(fā)送到主機作為信號文件存儲起來,然后對這個信號文件進(jìn)行航跡分離,得到需要的航跡信號文件。同時,信號發(fā)生器具有發(fā)送信號的功能,可以把不同形式的信號文件發(fā)送到檢測端口,用于設(shè)備調(diào)試。 在本文中系統(tǒng)設(shè)計主要分為硬件和軟件兩個方面來介紹: 硬件部分采用了FPGA邏輯設(shè)計加上外圍電路來實現(xiàn)的。在硬件設(shè)計中,最主要的是FPGA邏輯設(shè)計,包括9路主從SPI接口信號的邏輯控制,片外SDRAM的邏輯控制,PCI9054的邏輯控制,以及這些邏輯模塊間信號的同步、發(fā)送和接收。在這個過程中信號的方向是雙向的,所選用的芯片都具有雙向數(shù)據(jù)的功能。 在本文中軟件部分包括驅(qū)動軟件和應(yīng)用軟件。驅(qū)動軟件采用PLXSDK驅(qū)動開發(fā),通過控制PCI總線完成數(shù)據(jù)的采錄和發(fā)送。應(yīng)用軟件中包括數(shù)據(jù)提取和數(shù)據(jù)發(fā)送,采用卡爾曼濾波器等方法。 通過實驗證明該方案完全滿足數(shù)據(jù)傳輸?shù)囊螅_(dá)到SPI傳輸?shù)乃俣纫螅軌蛲瓿珊桔E提取,以及數(shù)據(jù)傳輸。

    標(biāo)簽: FPGA 數(shù)字信號發(fā)生器

    上傳時間: 2013-07-03

    上傳用戶:xzt

  • 船用導(dǎo)航雷達(dá)數(shù)字信號處理設(shè)計

    當(dāng)今的船用導(dǎo)航雷達(dá)具有數(shù)字化、多功能、高性能、多接口、網(wǎng)絡(luò)化。同時要求具有高可靠性、高集成度、低成本,信號處理單元的小型化,產(chǎn)品更新周期短。要同時滿足上述需求,高集成度的器件應(yīng)用是必須的。同時開發(fā)周期要短,需求軟件的可移植性要強,并且是模塊化設(shè)計,現(xiàn)場可編程門陣列器件(FPGA)已經(jīng)成為設(shè)計首選。 現(xiàn)場可編程門陣列是基于通過可編程互聯(lián)連接的可配置邏輯塊(CLB)矩陣的可編程半導(dǎo)體器件。與為特殊設(shè)計而定制的專用集成電路(ASIC)相對,F(xiàn)PGA可以針對所需的應(yīng)用或功能要求進(jìn)行編程。雖然具有一次性可編程(OTP)FPGA,但是主要是基于SRAM的,其可隨著設(shè)計的演化進(jìn)行重編程。CLB是FPGA內(nèi)的基本邏輯單元。實際數(shù)量和特性會依器件的不同而不同,但是每個CLB都包含一個由4或6個輸入、一些選型電路(多路復(fù)用器等)和觸發(fā)器組成的可配置開關(guān)矩陣。開關(guān)矩陣是高度靈活的,可以進(jìn)行配置以便處理組合邏輯、移位寄存器或RAM。當(dāng)今的FPGA已經(jīng)遠(yuǎn)遠(yuǎn)超出了先前版本的基本性能,并且整合了常用功能(如RAM、時鐘管理和:DSP)的硬(ASIC型)塊。由于具有可編程特性,所以FPGA是眾多市場的理想之選。它高集成度,以及用于設(shè)計的強大軟件平臺、IP核、在線升級可滿足需求。 本文介紹了基于FPGA實現(xiàn)船用導(dǎo)航雷達(dá)數(shù)字信號處理的設(shè)計,這是一個具體的、已經(jīng)完成并進(jìn)行小批量生產(chǎn)的產(chǎn)品,對指導(dǎo)實踐具有一定意義。

    標(biāo)簽: 導(dǎo)航雷達(dá) 數(shù)字信號處理

    上傳時間: 2013-04-24

    上傳用戶:稀世之寶039

  • 數(shù)字信號處理

    ·數(shù)字信號處理

    標(biāo)簽: 數(shù)字信號處理

    上傳時間: 2013-07-30

    上傳用戶:康郎

  • 數(shù)字信號處理與噪音抑制(英文版)

    ·數(shù)字信號處理與噪音抑制(英文版)

    標(biāo)簽: 數(shù)字信號處理 英文

    上傳時間: 2013-04-24

    上傳用戶:tanw97

  • 應(yīng)用MATlAB語言處理數(shù)字信號與數(shù)字圖像

    ·應(yīng)用MATlAB語言處理數(shù)字信號與數(shù)字圖像

    標(biāo)簽: MATlAB 語言 數(shù)字 信號與

    上傳時間: 2013-05-25

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