包含了四位計數(shù)器等基本數(shù)字模塊的的verilog HDL程序代碼,該功能實現(xiàn),可以直接利用DC進行綜合,得到硬件電路,亦能夠轉(zhuǎn)換成VHDL語言進行綜合
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該文檔為16位Sigma-delta ADC中數(shù)字模塊的設(shè)計總結(jié)文檔,是一份很不錯的參考資料,具有較高參考價值,感興趣的可以下載看看………………...
PSoC(可編程片上系統(tǒng))是Cypress半導(dǎo)體公司生產(chǎn)的包含有8位微處理器核和數(shù)字與模擬混合的信號陣列芯片,其應(yīng)用領(lǐng)域與8位的MCU相同。與8位的MCU的區(qū)別在于PSoC的數(shù)字周邊資源(如定時器、PWM、UART等等)和模擬周邊資源(放大器、比較器、濾波器等等)以數(shù)字模塊和模擬模塊的方式給出。不...
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