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數(shù)據(jù)采集系統(tǒng)

  • MES數(shù)據(jù)采集系統(tǒng)

    發(fā)那科、西門(mén)子等數(shù)控系統(tǒng)數(shù)控機(jī)床數(shù)據(jù)采集分析

    標(biāo)簽: MES

    上傳時(shí)間: 2016-01-11

    上傳用戶:asdzxcqwe

  • 基于LabVIEW2012 FPGA模式的數(shù)據(jù)采集和存儲(chǔ)系統(tǒng)

    基于LabVIEW2012FPGA模式的數(shù)據(jù)采集和存儲(chǔ)系統(tǒng)摘 要:為了提高數(shù)據(jù)采集系統(tǒng)精度,減少開(kāi)發(fā)成本,提高開(kāi)發(fā)效率,基于LabVIEW虛擬儀器開(kāi)發(fā)工具研究并設(shè)計(jì)了一 種數(shù)據(jù)采集系統(tǒng)。該系統(tǒng)采用FPGA編程模式和網(wǎng)絡(luò)流技術(shù)實(shí)現(xiàn)大批量數(shù)據(jù)實(shí)時(shí)傳輸,并對(duì)數(shù)據(jù)進(jìn)行分析處理和存儲(chǔ)。系 統(tǒng)硬件采用美國(guó)NI實(shí)時(shí)控制器CRIO?9025,實(shí)現(xiàn)16路數(shù)據(jù)可靠采集與存儲(chǔ)。實(shí)驗(yàn)仿真及實(shí)際運(yùn)行結(jié)果表明該數(shù)據(jù)采集系 統(tǒng)能夠精確地對(duì)數(shù)據(jù)進(jìn)行實(shí)時(shí)采集以及分析處理,達(dá)到了項(xiàng)目要求。 關(guān)鍵詞:FPGA;FIFO;網(wǎng)絡(luò)流;數(shù)據(jù)采集系統(tǒng);SQL數(shù)據(jù)庫(kù) 中圖分類號(hào):TN98?34 文獻(xiàn)標(biāo)識(shí)碼:A 文章編號(hào):1004?373X(2014)14?0142?04 Data acquisition and storage system based on LabVIEW 2012FPGA pattern WANG Shu?dong1,2 ,WEI Kong?zhen1 ,LI Xiao?pei1 (1. College of Electrical and Information Engineering,Lanzhou University of Technology,Lanzhou 730050,China; 2. Gansu Key Laboratory for Advanced Industrial Process Control,Lanzhou 730050,China)

    標(biāo)簽: labview fpga 數(shù)據(jù)采集

    上傳時(shí)間: 2022-02-18

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  • 基于TMS320C6713和USB2.0的多路實(shí)時(shí)信號(hào)采集系統(tǒng)的研究.rar

    隨著現(xiàn)代科學(xué)技術(shù)的迅速發(fā)展和人們對(duì)數(shù)據(jù)采集技術(shù)要求的日益提 高,近年來(lái)數(shù)據(jù)采集技術(shù)得到了長(zhǎng)足的發(fā)展,主要表現(xiàn)為精度越來(lái)越高, 傳輸?shù)乃俣仍絹?lái)越快。但是各種基于ISA、PCI 等總線的數(shù)據(jù)采集系統(tǒng)存 在著安裝麻煩、受計(jì)算機(jī)插槽數(shù)量、地址、中斷資源的限制、可擴(kuò)展性 差等缺陷,嚴(yán)重的制約了它們的應(yīng)用范圍。USB 總線的出現(xiàn)很好的解決了 上述問(wèn)題,它是1995 年INTEL、NEC、MICROSOFT、IBM 等公司為解決傳 統(tǒng)總線的不足而推出的一種新型串行通信標(biāo)準(zhǔn)。為了適應(yīng)高速傳輸?shù)男?要,2004 年4月,這些公司在原來(lái)1.1 協(xié)議的基礎(chǔ)上制定了USB2.0 傳輸 協(xié)議,使傳輸速度達(dá)到了480Mb/s。該總線具有安裝方便、高帶寬、易擴(kuò) 展等優(yōu)點(diǎn),已經(jīng)逐漸成為現(xiàn)代數(shù)據(jù)采集傳輸?shù)陌l(fā)展趨勢(shì)。 以高速數(shù)字信號(hào)處理器(DSPs)為基礎(chǔ)的實(shí)時(shí)數(shù)字信號(hào)處理技術(shù)近 年來(lái)發(fā)展迅速,并獲得了廣泛的應(yīng)用。TMS320C6713 是德州儀器公司 ( Texas Instrument ) 推出的浮點(diǎn)DSPs , 其峰值處理能力達(dá)到了 1350MFLOPS,是目前國(guó)際上性能最高的DSPs 之一。同時(shí)該DSPs 接口豐 富,擴(kuò)展能力強(qiáng),非常適合于做主控芯片。 基于TMS320C6713 和USB2.0,本文設(shè)計(jì)了一套多路實(shí)時(shí)信號(hào)采集系 統(tǒng)。該設(shè)計(jì)充分利用了高速數(shù)字信號(hào)處理器TMS320C6713 和USB 芯片 CY7C68001 的各種優(yōu)點(diǎn),實(shí)現(xiàn)了傳輸速度快,采樣精度高,易于擴(kuò)展,接口簡(jiǎn)單的特點(diǎn)。在本文中詳細(xì)討論了各種協(xié)議和功能模塊的設(shè)計(jì)。本文 的設(shè)計(jì)主要分為硬件部分和軟件部分,其中硬件部分包括模擬信號(hào)輸入 模塊,AD 數(shù)據(jù)采集模塊,USB 模塊,所有的硬件模塊都在TMS320C6713 的協(xié)調(diào)控制下工作,軟件部分包括DSP 程序和PC 端程序設(shè)計(jì)。總的設(shè)計(jì) 思想是以TMS320C6713為核心,通過(guò)AD 轉(zhuǎn)換,將采集的數(shù)據(jù)傳送給 TMS320C6713 進(jìn)行數(shù)據(jù)處理,并將處理后的數(shù)據(jù)經(jīng)過(guò)USB 接口傳送到上位 機(jī)。

    標(biāo)簽: C6713 320C 6713 TMS

    上傳時(shí)間: 2013-04-24

    上傳用戶:fudong911

  • 應(yīng)用FPGA的高速數(shù)據(jù)采集的設(shè)計(jì)與實(shí)現(xiàn).rar

    隨著計(jì)算機(jī)技術(shù)的突飛猛進(jìn)以及移動(dòng)通訊技術(shù)在日常生活中的不斷深入,數(shù)據(jù)采集不斷地向多路、高速、智能化的方向發(fā)展。本文針對(duì)此需求,實(shí)現(xiàn)了一種應(yīng)用FPGA的多路、高速的數(shù)據(jù)采集系統(tǒng),從而為測(cè)量?jī)x器提供良好的采集數(shù)據(jù)。 本文設(shè)計(jì)了一種基于AD+FPGA+DSP的多路數(shù)據(jù)采集處理系統(tǒng),針對(duì)此系統(tǒng)設(shè)計(jì)了基于AD9446的模數(shù)轉(zhuǎn)換采集板,再將模數(shù)轉(zhuǎn)換采集板的數(shù)據(jù)傳送至基于FPGA的采集控制模塊進(jìn)行數(shù)據(jù)的壓縮以及緩沖存儲(chǔ),最后由DSP調(diào)入數(shù)據(jù)進(jìn)行數(shù)據(jù)的處理。本文的設(shè)計(jì)主要分為兩部分,一部分為模數(shù)轉(zhuǎn)換采集板的設(shè)計(jì)與調(diào)試,另一部分為采集控制模塊的設(shè)計(jì)與仿真。 經(jīng)設(shè)計(jì)與調(diào)試,模數(shù)轉(zhuǎn)換模塊可為系統(tǒng)提供穩(wěn)定可靠的數(shù)據(jù),能穩(wěn)定工作在百兆的頻率下;采集控制模塊能實(shí)時(shí)地完成數(shù)據(jù)壓縮與數(shù)據(jù)緩沖,并能通過(guò)時(shí)鐘管理模塊來(lái)控制前端AD的采樣,該模塊也能穩(wěn)定工作在百兆的頻率下。該系統(tǒng)為多路、高速的數(shù)據(jù)采集系統(tǒng),并能穩(wěn)定工作,從而能滿足電子測(cè)量?jī)x器的要求。關(guān)鍵詞:數(shù)據(jù)采集;FPGA;AD9446

    標(biāo)簽: FPGA 高速數(shù)據(jù) 采集

    上傳時(shí)間: 2013-06-04

    上傳用戶:zzy7826

  • 基于AT89C2051單片機(jī)的智能電壓數(shù)據(jù)采集系統(tǒng)

    分,5'1Zk硬件和軟件的角度介紹了智能電壓數(shù)據(jù)采集裝置各部分的原理、功能,給出了串行通訊的程序流程圖及部分程序。經(jīng)調(diào)試證明,該程序簡(jiǎn)單、可靠,具有較高的應(yīng)用價(jià)值。

    標(biāo)簽: C2051 2051 89C AT

    上傳時(shí)間: 2013-07-07

    上傳用戶:凌云御清風(fēng)

  • 基于WEB實(shí)現(xiàn)FPGA的遠(yuǎn)程多路數(shù)據(jù)采集系統(tǒng)

      本文首先研究了常規(guī)的數(shù)據(jù)采集的方法,針對(duì)由單片機(jī)構(gòu)成的數(shù)據(jù)采集系統(tǒng)數(shù)據(jù)處理能力弱的問(wèn)題提出了基于現(xiàn)場(chǎng)可編程門(mén)陣列(FieldProgrammableGateArray,FPGA)為邏輯控制芯片對(duì)三片A/D芯片進(jìn)行控制的遠(yuǎn)程多路數(shù)據(jù)采集的解決方案。 本文利用VisualBasic編寫(xiě)串口通信程序,通過(guò)串行端口向FPGA數(shù)據(jù)采集板發(fā)送數(shù)據(jù)采集的參數(shù)指令,FPGA數(shù)據(jù)采集板接受指令后進(jìn)行現(xiàn)場(chǎng)數(shù)據(jù)采集,并通過(guò)串行通信將數(shù)據(jù)發(fā)送到PC機(jī),在通信過(guò)程中完全遵守RS-232協(xié)議,具有較強(qiáng)的通用性和推廣價(jià)值。然后本文重點(diǎn)介紹了該采集系統(tǒng)的硬件設(shè)計(jì)原理和軟件設(shè)計(jì)框架,實(shí)現(xiàn)實(shí)時(shí)嵌入式微機(jī)數(shù)據(jù)采集系統(tǒng)的軟件和硬件設(shè)計(jì)方法,將部分軟件的功能改由硬件實(shí)現(xiàn),從邏輯上大大簡(jiǎn)化了嵌入式軟件的設(shè)計(jì)。

    標(biāo)簽: FPGA WEB 遠(yuǎn)程 多路數(shù)據(jù)采集

    上傳時(shí)間: 2013-04-24

    上傳用戶:yaohe123

  • 基于WEB實(shí)現(xiàn)FPGA的遠(yuǎn)程多路數(shù)據(jù)采集系統(tǒng)

      本文首先研究了常規(guī)的數(shù)據(jù)采集的方法,針對(duì)由單片機(jī)構(gòu)成的數(shù)據(jù)采集系統(tǒng)數(shù)據(jù)處理能力弱的問(wèn)題提出了基于現(xiàn)場(chǎng)可編程門(mén)陣列(FieldProgrammableGateArray,FPGA)為邏輯控制芯片對(duì)三片A/D芯片進(jìn)行控制的遠(yuǎn)程多路數(shù)據(jù)采集的解決方案。 本文利用VisualBasic編寫(xiě)串口通信程序,通過(guò)串行端口向FPGA數(shù)據(jù)采集板發(fā)送數(shù)據(jù)采集的參數(shù)指令,FPGA數(shù)據(jù)采集板接受指令后進(jìn)行現(xiàn)場(chǎng)數(shù)據(jù)采集,并通過(guò)串行通信將數(shù)據(jù)發(fā)送到PC機(jī),在通信過(guò)程中完全遵守RS-232協(xié)議,具有較強(qiáng)的通用性和推廣價(jià)值。然后本文重點(diǎn)介紹了該采集系統(tǒng)的硬件設(shè)計(jì)原理和軟件設(shè)計(jì)框架,實(shí)現(xiàn)實(shí)時(shí)嵌入式微機(jī)數(shù)據(jù)采集系統(tǒng)的軟件和硬件設(shè)計(jì)方法,將部分軟件的功能改由硬件實(shí)現(xiàn),從邏輯上大大簡(jiǎn)化了嵌入式軟件的設(shè)計(jì)。

    標(biāo)簽: FPGA WEB 遠(yuǎn)程 多路數(shù)據(jù)采集

    上傳時(shí)間: 2013-05-30

    上傳用戶:1193169035

  • 基于FPGA 技術(shù)的模擬地震信號(hào)采集系統(tǒng)設(shè)計(jì)

    數(shù)據(jù)采集系統(tǒng)是整個(gè)地震勘探物理模擬實(shí)驗(yàn)系統(tǒng)的關(guān)鍵環(huán)節(jié)。文章介紹運(yùn)用FPGA 芯片控制,實(shí)現(xiàn)對(duì)高速模擬地震信號(hào)的數(shù)據(jù)采集技術(shù),以及USB.2.0 接口總線軟硬件的實(shí)現(xiàn)技術(shù)。該系統(tǒng)具有采集精度高,傳輸速度

    標(biāo)簽: FPGA 模擬地震 信號(hào)采集 系統(tǒng)設(shè)計(jì)

    上傳時(shí)間: 2013-04-24

    上傳用戶:ccsp11

  • 基于ARM與FPGA的高速數(shù)據(jù)采集技術(shù)研究

    本文研究基于ARM與FPGA的高速數(shù)據(jù)采集系統(tǒng)技術(shù)。論文完成了ARM+FPGA結(jié)構(gòu)的共享存儲(chǔ)器結(jié)構(gòu)設(shè)計(jì),實(shí)現(xiàn)了ARMLinux系統(tǒng)的軟件設(shè)計(jì),包括觸摸屏控制、LCD顯示、正弦插值算法設(shè)計(jì)以及各種顯示算法設(shè)計(jì)等。同時(shí)進(jìn)行了信號(hào)的高速采集和處理的實(shí)際測(cè)試,對(duì)實(shí)驗(yàn)測(cè)試數(shù)據(jù)進(jìn)行了分析。 論文分別從軟件和硬件兩方面入手,闡述了基于ARM處理器和FPGA芯片的高速數(shù)據(jù)采集的硬件系統(tǒng)設(shè)計(jì)方法,以及基于ARMLinux操作系統(tǒng)的設(shè)備驅(qū)動(dòng)程序設(shè)計(jì)和應(yīng)用程序設(shè)計(jì)。 硬件方面,在FPGA平臺(tái)上,我們首先利用乒乓操作的方式將一路高速數(shù)據(jù)信號(hào)轉(zhuǎn)換成頻率為原來(lái)頻率1/4的4路低速數(shù)據(jù)信號(hào),再將這四路數(shù)據(jù)分別存儲(chǔ)到4個(gè)FIFO中,然后再對(duì)這4個(gè)FIFO中的數(shù)據(jù)拼接并存儲(chǔ)在FPGA片上的雙端口雙時(shí)鐘RAM中,最后將FPGA的雙端口雙時(shí)鐘RAM掛載到ARM系統(tǒng)的總線上,實(shí)現(xiàn)了ARM和FPGA共享存儲(chǔ)器的系統(tǒng)結(jié)構(gòu),使ARM處理器可以直接讀取這個(gè)雙端口雙時(shí)鐘的RAM中的數(shù)據(jù),從而大大提高了數(shù)據(jù)采集與處理的效率。在采樣頻率控制電路設(shè)計(jì)方面,我們通過(guò)使FIFO的數(shù)據(jù)存儲(chǔ)時(shí)鐘降低為標(biāo)準(zhǔn)狀態(tài)下的1/n實(shí)現(xiàn)數(shù)據(jù)采集頻率降為標(biāo)準(zhǔn)狀態(tài)的1/n,從而實(shí)現(xiàn)了由FPGA控制的可變頻率的數(shù)據(jù)采集系統(tǒng)。 軟件方面,為了更有效地管理和拓展系統(tǒng)功能,我們移植了ARMLinux操作系統(tǒng),并在S3C2410平臺(tái)上設(shè)計(jì)實(shí)現(xiàn)了基于Linux操作系統(tǒng)的觸摸屏驅(qū)動(dòng)程序設(shè)計(jì)、LCD驅(qū)動(dòng)程序移植、自定義的FPGA模塊驅(qū)動(dòng)程序設(shè)計(jì)、LCD顯示程序設(shè)計(jì)、多線程的應(yīng)用程序設(shè)計(jì)。應(yīng)用程序能夠控制FPGA數(shù)據(jù)采集系統(tǒng)工作。 在前端采樣頻率為125MHz情況下,系統(tǒng)可以正常工作。能夠?qū)崿F(xiàn)對(duì)頻率在5MHz以下的信號(hào)波形的直接顯示;對(duì)5MHz至40MHz的信號(hào),使用正弦插值算法進(jìn)行處理,顯示效果良好。同時(shí)這種硬件結(jié)構(gòu)可擴(kuò)展性強(qiáng),可以在此基礎(chǔ)上實(shí)現(xiàn)8路甚至16路緩沖的系統(tǒng)結(jié)構(gòu),可以使系統(tǒng)支持更高的采樣頻率。

    標(biāo)簽: FPGA ARM 高速數(shù)據(jù) 采集

    上傳時(shí)間: 2013-07-04

    上傳用戶:林魚(yú)2016

  • AD574在數(shù)據(jù)采集中的應(yīng)用

    論述了AD574逐次逼近型12位模數(shù)轉(zhuǎn)換器的原理、應(yīng)用以及與單片機(jī)所構(gòu)成的數(shù)據(jù)采集系統(tǒng),分析了系統(tǒng)的硬件、軟件結(jié)構(gòu)和具體操作,給出了AD574與AT89C51單片機(jī)的接口線路圖.

    標(biāo)簽: 574 AD 數(shù)據(jù)采集 中的應(yīng)用

    上傳時(shí)間: 2013-05-23

    上傳用戶:ca05991270

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