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數(shù)(shù)字下變頻技術(shù)

  • dsp2812下CCS3的DC-DC-PWM波形調制程序.rar

    dsp2812下CCS3的DC-DC-PWM波形調制程序

    標簽: DC-DC-PWM 2812 CCS3 dsp

    上傳時間: 2013-07-10

    上傳用戶:LSPSL

  • 基于ARM的嵌入式linux系統(tǒng)下的MP3設計.rar

    隨著消費類電子產(chǎn)業(yè)的蓬勃發(fā)展,越來越多的嵌入式電子產(chǎn)品走進了千家萬戶。電腦的形態(tài)也不再局限于以前的PC機,各式各樣的嵌入式系統(tǒng)出現(xiàn)在了眾多的行業(yè)和應用中,其中ARM和Linux結合的產(chǎn)品在市場上最受青睞。ARM由于其低功耗、高性能、小體積、低成本受到了越來越廣泛的重視,成為眾多公司產(chǎn)品開發(fā)的主流硬件。而Linux則因其開放的源代碼,可裁剪的內核,便利的開發(fā)環(huán)境,各硬件平臺的通用性,逐漸成為嵌入式開發(fā)的主流操作系統(tǒng)。本課題的嵌入式MP3設計就是基于ARM和linux平臺的。 @@ 本課題實現(xiàn)了一個完整的嵌入式系統(tǒng),選用zq2410開發(fā)板為目標平臺,linux作為目標操作系統(tǒng),在這樣的軟硬件環(huán)境下研究實現(xiàn)MP3播放器。 @@ 文章首先綜述了嵌入式系統(tǒng)開發(fā)方法,介紹了ARM處理器及其特點,Linux操作系統(tǒng),嵌入式系統(tǒng)的開發(fā)模式以及如何搭建交叉開發(fā)環(huán)境,然后介紹了所選硬件平臺zq2410目標板的各種資源,在系統(tǒng)軟件開發(fā)中,介紹Uboot、Linux的裁剪和移植,根文件系統(tǒng)的制作以及核心驅動程序的開發(fā),應用程序開發(fā)中,介紹了MP3的原理,移植Madplay MP3播放器,最后成功對Madplay播放器實現(xiàn)了綜合控制。 @@關鍵詞:嵌入式;ARM; Linux;驅動程序;MP3;

    標簽: linux ARM MP3

    上傳時間: 2013-05-26

    上傳用戶:lo25643

  • USB2.0原理與工程開發(fā)(下).rar

    USB2.0原理與工程開發(fā)(下).pdf,8.06M,255頁.

    標簽: USB 2.0 工程

    上傳時間: 2013-04-24

    上傳用戶:lanjisu111

  • 單片機論文資料,精華中的精華,保證你下的不后悔,做畢設必備的資料.rar

    單片機論文資料,精華中的精華,保證你下的不后悔,做畢設必備的資料..,歡迎下載

    標簽: 單片機 論文資料

    上傳時間: 2013-04-24

    上傳用戶:edisonfather

  • 基于FPGA的PCI總線接口橋接邏輯設計.rar

    隨著信息技術的發(fā)展,數(shù)字信號的采集與處理在科學研究、工業(yè)生產(chǎn)、航空航天、醫(yī)療衛(wèi)生等部門得到越來越廣泛的應用,這些應用中對數(shù)字信號的傳輸速度提出了比較高的要求。傳統(tǒng)的基于ISA總線的信號傳輸效率低,嚴重制約著系統(tǒng)性能的提高。 PCI總線以其高性能、低成本、開放性、軟件兼容性等眾多優(yōu)點成為當今最流行的計算機局部總線。但是,由于PCI總線硬件接口復雜、不易于接入、協(xié)議規(guī)范比較繁瑣等缺點,常常需要專用的接口芯片作為橋接,為了解決這一系列問題,本文提出了一種基于FPGA的PCI總線接口橋接邏輯的實現(xiàn)方案,支持PCI突發(fā)訪問方式,突發(fā)長度為8至128個雙字長度,核心FPGA芯片采用ALTERA公司的CYCLONE FPGA系列的EP1C6Q240C8,容量為6000個邏輯宏單元,速度為-8,編譯后系統(tǒng)速度可以達到80MHz,取得了良好的效果。 基于FPGA的PCI總線接口橋接邏輯的核心是PCI接口模塊。在硬件方面,特別討論了PCI接口模塊、地址轉換模塊、數(shù)據(jù)緩沖模塊、外部接口模塊和SRAM DMA控制模塊等五個功能模塊的設計方案和硬件電路實現(xiàn)方法,著重分析了PCI接口模塊的數(shù)據(jù)傳輸方式,采用模塊化的方法設計了內部控制邏輯,并進行了相關的時序仿真和邏輯驗證,硬件需要軟件的配合才能實現(xiàn)其功能,因此設備驅動程序的設計是一個重要部分,論文研究了Windows XP體系結構下的WDM驅動模式的組成、開發(fā)設備驅動程序的工具以及開發(fā)系統(tǒng)實際硬件的設備驅動程序時的一些關鍵技術。 本文最后利用基于FPGA的PCI總線接口橋接邏輯中的關鍵技術,對PCI數(shù)據(jù)采集卡進行了整體方案的設計。該系統(tǒng)采用Altera公司的cyclone Ⅱ系列FPGA實現(xiàn)。

    標簽: FPGA PCI 總線接口

    上傳時間: 2013-07-24

    上傳用戶:ca05991270

  • 軟件無線電中數(shù)字下變頻技術研究及FPGA實現(xiàn).rar

    軟件無線電(SDR,Software Defined Radio)由于具備傳統(tǒng)無線電技術無可比擬的優(yōu)越性,已成為業(yè)界公認的現(xiàn)代無線電通信技術的發(fā)展方向。理想的軟件無線電系統(tǒng)強調體系結構的開放性和可編程性,減少靈活性著的硬件電路,把數(shù)字化處理(ADC和DAC)盡可能靠近天線,通過軟件的更新改變硬件的配置、結構和功能。目前,直接對射頻(RF)進行采樣的技術尚未實現(xiàn)普及的產(chǎn)品化,而用數(shù)字變頻器在中頻進行數(shù)字化是普遍采用的方法,其主要思想是,數(shù)字混頻器用離散化的單頻本振信號與輸入采樣信號在乘法器中相乘,再經(jīng)插值或抽取濾波,其結果是,輸入信號頻譜搬移到所需頻帶,數(shù)據(jù)速率也相應改變,以供后續(xù)模塊做進一步處理。數(shù)字變頻器在發(fā)射設備和接收設備中分別稱為數(shù)字上變頻器(DUC,Digital Upper Converter)和數(shù)字下變頻器(DDC,Digital Down Converter),它們是軟件無線電通信設備的關鍵部什。大規(guī)模可編程邏輯器件的應用為現(xiàn)代通信系統(tǒng)的設計帶來極大的靈活性。基于FPGA的數(shù)字變頻器設計是深受廣大設計人員歡迎的設計手段。本文的重點研究是數(shù)字下變頻器(DDC),然而將它與數(shù)字上變頻器(DUC)完全割裂后進行研究顯然是不妥的,因此,本文對數(shù)字上變頻器也作適當介紹。 第一章簡要闡述了軟件無線電及數(shù)字下變頻的基本概念,介紹了研究背景及所完成的主要研究工作。 第二章介紹了數(shù)控振蕩器(NCO),介紹了兩種實現(xiàn)方法,即基于查找表和基于CORDIC算法的實現(xiàn)。對CORDIc算法作了重點介紹,給出了傳統(tǒng)算法和改進算法,并對基于傳統(tǒng)CORDIC算法的NCO的FPGA實現(xiàn)進行了EDA仿真。 第三章介紹了變速率采樣技術,重點介紹了軟件無線電中廣泛采用的級聯(lián)積分梳狀濾波器 (cascaded integratot comb, CIC)和ISOP(Interpolated Second Order Polynomial)補償法,對前者進行了基于Matlab的理論仿真和FPGA實現(xiàn)的EDA仿真,后者只進行了基于Matlab的理論仿真。 第四章介紹了分布式算法和軟件無線電中廣泛采用的半帶(half-band,HB)濾波器,對基于分布式算法的半帶濾波器的FPGA實現(xiàn)進行了EDA仿真,最后簡要介紹了FIR的多相結構。 第五章對數(shù)字下變頻器系統(tǒng)進行了噪聲綜合分析,給出了一個噪聲模型。 第六章介紹了數(shù)字下變頻器在短波電臺中頻數(shù)字化應用中的一個實例,給出了測試結果,重點介紹了下變頻器的:FPGA實現(xiàn),其對應的VHDL程序收錄在本文最后的附錄中,希望對從事該領域設計的技術人員具有一定參考價值。

    標簽: FPGA 軟件無線電 數(shù)字下變頻

    上傳時間: 2013-06-30

    上傳用戶:huannan88

  • 在仿真環(huán)境下實現(xiàn)TMS320C6000系列DSP的程序自引導.rar

    在仿真環(huán)境下實現(xiàn)TMS320C6000系列DSP的程序自引導

    標簽: C6000 320C 6000 TMS

    上傳時間: 2013-08-03

    上傳用戶:tdyoung

  • 松下繼電器選型手冊

    松下繼電器選型手冊

    標簽: 松下 繼電器 選型手冊

    上傳時間: 2013-07-26

    上傳用戶:branblackson

  • 高噪聲率下極值型中值濾波算法的改進

    極值型中值濾波算法在高噪聲率下的濾波效果不是很好,主要原因有以下兩個:首先,濾波窗口中過多的噪聲點會使窗口中的點在排序時產(chǎn)生中值偏移;其次是高噪聲率環(huán)境下,可能序列中值本身就是是噪聲點。對此,本文提出

    標簽: 高噪聲率 中值濾波 法的改進

    上傳時間: 2013-06-26

    上傳用戶:小小小熊

  • 基于FPGA的數(shù)字化調頻DDS系統(tǒng)設計

    頻率合成技術廣泛應用于通信、航空航天、儀器儀表等領域。目前,常用的頻率合成技術有直接式頻率合成,鎖相頻率合成和直接數(shù)字頻率合成(DDS)。本次設計是利用FPGA完成一個DDS系統(tǒng)并利用該系統(tǒng)實現(xiàn)模擬信號的數(shù)字化調頻。 DDS是把一系列數(shù)字量形式的信號通過D/A轉換形成模擬量形式的信號的合成技術。主要是利用高速存儲器作查尋表,然后通過高速D/A轉換器產(chǎn)生已經(jīng)用數(shù)字形式存入的正弦波(或其他任意波形)。一個典型的DDS系統(tǒng)應包括:相位累加器,可在時鐘的控制下完成相位的累加;相位碼—幅度碼轉換電路,一般由ROM實現(xiàn);DA轉換電路,將數(shù)字形式的幅度碼轉換成模擬信號。DDS系統(tǒng)可以很方便地獲得頻率分辨率很精細且相位連續(xù)的信號,也可以通過改變相位字改變信號的相位,因此也廣泛用于數(shù)字調頻和調相。本次數(shù)字化調頻的基本思想是利用AD轉換電路將模擬信號轉換成數(shù)字信號,同時用該數(shù)字信號與一個固定的頻率字累加,形成一個受模擬信號幅度控制的頻率字,從而獲得一個頻率受模擬信號的幅度控制的正弦波,即實現(xiàn)了調頻。該DDS數(shù)字化調頻方案的硬件系統(tǒng)是以FPGA為核心實現(xiàn)的。使用Altera公司的ACEX1K系列FPGA,整個系統(tǒng)由VHDL語言編程,開發(fā)軟件為MAX+PLUSⅡ。經(jīng)過實際測試,該系統(tǒng)在頻率較低時與理論值完全符合,但在高頻時,受器件速度的限制,波形有較大的失真。

    標簽: FPGA DDS 數(shù)字化 調頻

    上傳時間: 2013-06-14

    上傳用戶:ljt101007

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