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數(shù)字溫度計(jì)

  • 數字圖像處理的灰度處理源代碼.rar

    一個基于C++的數字圖像處理的灰度處理源代碼,方便大家分享

    標簽: 數字圖像處理 灰度 源代碼

    上傳時間: 2013-07-22

    上傳用戶:sc965382896

  • 地面數字電視廣播系統中SRRC濾波器及FFT處理器的設計與FPGA實現.rar

    隨著人們對數字電視和數字視頻信息的需求越來越大,數字電視廣播在中國迅速的發展起來。近幾年,數字電視傳輸系統技術逐漸成熟,數字電視地面廣播(DTTB)傳輸標準也于2006年8月30號正式出臺。此標準技術是由我國多家單位聯合研究的,具有自主知識產權的數字地面電視傳輸標準。DTTB系統標準的研究與仿真,具有巨大的實用價值和廣闊的市場前景。 @@ 本文首先研究了地面數字電視廣播標準中平方根升余弦(SRRC)濾波器(滾降系數為0.05)的結構設計,介紹了一種適合在FPGA中實現的高階高速FIR濾波器的并行流水線結構。在本設計中,以CSD數優化濾波器系數,并運用簡化加法器圖(Reduced Adder Graph,RAG)算法進行改進,最后采用并行處理的轉置型流水線結構實現。 @@ 接著研究數字電視地面傳輸標準采用的傳輸技術-OFDM的基本概念和技術特點,并研究了清華大學提出的DMB-T方案中TDS-OFDM信號幀的組成結構以及相關原理。 @@ 最后,本文針對OFDM調制所需要的3780點FFT處理器進行研究。為了保證OFDM信號的采樣率和時域導頻的采樣率相同,以達到較好的同步性能,采用了3780個正交子載波的設計方案。在實現過程中,分析比較了多種算法的計算復雜性,設計出在硬件實現復雜度上進行優化的3780點FFT處理器的數據流流水線算法。之后,通過定點仿真比較各模塊輸出的動態范圍和概率分布,設計出定點字長的優化方案,并分析計算了這一處理器的輸出信噪比與內部各模塊字長的關系,進一步降低了硬件實現復雜性。 @@關鍵字:數字電視地面廣播傳輸(DTTB);平方根升余弦濾波器(SRRC);正交頻分復用調制(OFDM);快速傅立葉變換(FFT); 3780

    標簽: SRRC FPGA FFT

    上傳時間: 2013-04-24

    上傳用戶:mdrd3080

  • 2007年全國電子設計大賽論文(A~J題)

    07電子設計大賽論文 2007年全國電子設計大賽論文(A~J題)

    標簽: 2007 全國電子 設計大賽 論文

    上傳時間: 2013-05-26

    上傳用戶:qoovoop

  • 基于AVR單片機電風扇360度內搖頭角度自由調節裝置的實現

    本文介紹了一種基于AVR 單片機Atmel 169,與旋轉編碼器AS5040 及3966 控制直流電機構成的電風扇360 度內搖頭角度調節裝置的實現,設計了AS5040 旋轉編碼器接口電路、P

    標簽: AVR 360 單片機 電風扇

    上傳時間: 2013-05-19

    上傳用戶:cath

  • 基于ARM系統的表面粗糙度測量儀的設計.pdf

    表面粗糙度是機械加工中描述工件表面微觀形狀重要的參數。在機械零件切削的過程中,刀具或砂輪遺留的刀痕,切屑分離時的塑性變形和機床振動等因素,會使零件的表面形成微小的蜂谷。這些微小峰谷的高低程度和間距狀況就叫做表面粗糙度,也稱為微觀不平度。表面粗糙度的測量是幾何測量中的一個重要部分,它對于現代制造業的發展起了重要的推動作用。世界各國競相進行粗糙度測量儀的研制,隨著科學技術的發展,各種各樣的粗糙度測量系統也競相問世。對于粗糙度的測量,隨著技術的更新,國家標準也一直在變更。最新執行的國家標準(GB/T6062-2002),規定了粗糙度測量的參數,以及制定了觸針式測量粗糙度的儀器標準[1]。 隨著新國家標準的執行,許多陳舊的粗糙度測量儀已經無法符合新標準的要求。而且生產工藝的提高使得原有方案的采集精度和采集速度,滿足不了現代測量技術的需要。目前,各高校公差實驗室及大多數企業的計量部門所使用的計量儀器(如光切顯微鏡、表面粗糙度檢查儀等)只能測量單項參數,而能進行多參數測量的光電儀器價格較貴,一般實驗室和計量室難以購置。因此如何利用現有的技術,結含現代測控技術的發展,職制出性能可靠的粗糙度測量儀,能有效地降低實驗室測量儀器的成本,具有很好的實用價值和研究意義。 基于上述現狀,本文在參考舊的觸針式表面粗糙度測量儀技術方案的基礎上,提出了一種基于ARM嵌入式系統的粗糙度測量儀的設計。這種測量儀采用了先進的傳感器技術,保證了測量的范圍和精度;采用了集成的信號調理電路,降低了信號在調制、檢波、和放大的過程中的失真;采用了ARM處理器,快速的采集和控制測量儀系統;采用了強大的PC機人機交互功能,快速的計算粗糙度的相關參數和直觀的顯示粗糙度的特性曲線。 論文主要做了如下工作:首先,論文分析了觸針式粗糙度測量儀的發展以及現狀;然后,詳細敘述了系統的硬件構成和設計,包括傳感器的原理和結構分析、信號調理電路的設計、A/D轉換電路的設計、微處理器系統電路以及與上位機接口電路的設計。同時,還對系統的數據采集進行了研究,開發了相應的固件程序及接口程序,完成數據采集軟件的編寫,并且對表面粗糙度參數的算法進行程序的實現。編寫了控制應用程序,完成控制界面的設計。最終設計出一套多功能、多參數、高性能、高可靠、操作方便的表面粗糙度測量系統。

    標簽: ARM 測量

    上傳時間: 2013-04-24

    上傳用戶:KIM66

  • 一種面向無線視頻傳感器網絡的低復雜度視頻編碼算法及其在ARM平臺上的實現

    隨著21世紀的到來,計算機技術,信息處理技術,半導體技術和網絡技術不斷發展,人類社會進入了信息化時代。與此同時,無線視頻傳感器網絡也得到了突飛猛進的發展,成為當今國際上備受關注的熱點研究領域。無線視頻傳感器網絡有著很多的優點和十分廣泛的應用前景。在軍事,工業,城市管理和監控系統等重要領域都有潛在的使用價值。 無線視頻傳感器網絡有著顯著的特征,例如:網絡節點能源有限;網絡帶寬有限;對處理速度要求較高等。由此可見,傳統的視頻編碼標準無法應用于無線視頻傳感器網絡。MPEG-4,H.263,H.264等視頻編碼標準,全是基于運動估計補償實現的,計算量十分巨大,在能量,存儲空間和處理能力均有限的節點難以實現這類高復雜度的編碼算法。 本文針對無線視頻傳感器網絡對視頻編碼算法的具體需求,提出一種基于運動檢測的低復雜度視頻編碼算法。該算法只對當前編碼幀中的運動對象進行編碼,并且以面向對象的結構輸出碼流。實驗結果表明,與H.264全I幀編碼相比,本文提出的算法編碼速度提高了約3倍,編碼性能提高了約2dB。與H.264基本檔次相比,雖然編碼性能略有下降,但是編碼速度平均提高了8倍左右。因此,本文提出的算法可以在編碼效率和編碼速度之間獲得很好的折衷,在一定程度上可以滿足無線視頻傳感器網絡的需求。 本文選用ALDVK_270作為硬件實驗平臺。在分析算法結構的同時,結合嵌入式系統的特點,從算法,內存,高級語言和匯編語言等幾個方面提出優化方案,最終在ARM嵌入式平臺下實現了面向無線視頻傳感器網絡的低復雜度視頻編碼算法。測試結果表明,與優化前相比,優化后的編碼速度有了很大的提高,對于CIF格式的監控視頻序列能夠滿足實時處理的要求。

    標簽: ARM 無線視頻 傳感器網絡 復雜度

    上傳時間: 2013-07-26

    上傳用戶:小小小熊

  • (臺達)開關電源基本原理與設計介紹

    (臺達)開關電源基本原理與設計介紹,比較實用

    標簽: 開關電源

    上傳時間: 2013-06-15

    上傳用戶:ybysp008

  • Turbo乘積碼的譯碼算法及FPGA實現

    在信道編碼的發展進程中,編碼研究人員一直致力于追尋性能盡可能的接近Shannon極限,且譯碼復雜度較低的信道編碼方案。1993年Berrou等提出了Turbo碼,這種碼在接近香農極限的低信噪比下仍能夠獲得較低的誤碼率,它的出現在編碼界引起了廣泛的關注,并成為編碼研究領域最新的發展方向之一。但Turbo碼也有其缺點,由于交織器的存在,致使譯碼復雜度高,譯碼時延長且因為低碼重碼字,存在錯誤平臺現象。在Turbo碼的基礎上,1994年,Pyndiah等提出了Turbo乘積碼,Turbo乘積碼繼承了Turbo碼的優點,又因為Turbo乘積碼的構造采用了線性分組碼,所以譯碼方法比Turbo碼簡單。Turbo乘積碼近年來開始被廣泛到應用到各種通信場合,大有取代傳統的卷積碼之勢。 本文首先圍繞Turbo乘積碼的編譯碼原理,闡述了涉及到的基礎知識;又據Turbo乘積碼目前的應用狀況,回顧了Turbo碼的發展歷史;其次,根據Turbo乘積碼的構造原理,探討了構造的方法,交織類型,子碼的選擇及子碼的性能;再次,研究了Turbo乘積碼的概率譯碼,基于外信息的迭代算法,研究了Chase的譯碼算法;最后通過軟件仿真實現了該迭代譯碼算法,得到的結果達到了通信接收的要求。 本文還初步的闡述了Turbo乘積碼硬件實現系統的設計方案。據實際工作中碰到的非標準信號,給出了整體模塊設計圖,及相應模塊的功能和模塊問連接的各種參數。并實現了模態下的同步搜索和去除相位模糊功能。最后根據研究中碰到的各種問題,提出了下一步工作建議和研究方向。

    標簽: Turbo FPGA 乘積碼 譯碼算法

    上傳時間: 2013-07-02

    上傳用戶:ndyyliu

  • 高吞吐量LDPC碼編碼構造及其FPGA實現

    低密度校驗碼(LDPC,Low Density Parity Check Code)是一種性能接近香農極限的信道編碼,已被廣泛地采用到各種無線通信領域標準中,包括我國的數字電視地面傳輸標準、歐洲第二代衛星數字視頻廣播標準(DVB-S2,Digital Video Broadcasting-Satellite 2)、IEEE 802.11n、IEEE 802.16e等。它是3G乃至將來4G通信系統中的核心技術之一。 當今LDPC碼構造的主流方向有兩個,分別是結合準循環(QC,Quasi Cyclic)移位結構的單次擴展構造和類似重復累積(RA,Repeat Accumulate)碼構造。相應地,主要的LDPC碼編碼算法有基于生成矩陣的算法和基于迭代譯碼的算法。基于生成矩陣的編碼算法吞吐量高,但是需要較多的寄存器和ROM資源;基于迭代譯碼的編碼算法實現簡單,但是吞吐量不高,且不容易構造高性能的好碼。 本文在研究了上述幾種碼構造和編碼算法之后,結合編譯碼器綜合實現的復雜度考慮,提出了一種切實可行的基于二次擴展(Dex,Duplex Expansion)的QC-LDPC碼構造方法,以實現高吞吐量的LDPC碼收發端;并且充分利用該類碼校驗矩陣準循環移位結構的特點,結合RU算法,提出了一種新編碼器的設計方案。 基于二次擴展的QC-LDPC碼構造方法,是通過對母矩陣先后進行亂序擴展(Pex,Permutation Expansion)和循環移位擴展(CSEx,Cyclic Shift Expansion)實現的。在此基礎上,為了實現可變碼長、可變碼率,一般編譯碼器需同時支持多個亂序擴展和循環移位擴展的擴展因子。本文所述二次擴展構造方法的特點在于,固定循環移位擴展的擴展因子大小不變,支持多個亂序擴展的擴展因子,使得譯碼器結構得以精簡;構造得到的碼字具有近似規則碼的結構,便于硬件實現;(偽)隨機生成的循環移位系數能夠提高碼字的誤碼性能,是對硬件實現和誤碼性能的一種折中。 新編碼器在很大程度上考慮了資源的復用,使得實現復雜度近似與碼長成正比。考慮到吞吐量的要求,新編碼器結構完全拋棄了RU算法中串行的前向替換(FS,Forward Substitution)模塊,同時簡化了流水線結構,由原先RU算法的6級降低為4級;為了縮短編碼延時,設計時安排每一級流水線計算所需的時鐘數大致相同。 這種碼字構造和編碼聯合設計方案具有以下優勢:相比RU算法,新方案對可變碼長、可變碼率的支持更靈活,吞吐量也更大;相比基于生成矩陣的編碼算法,新方案節省了50%以上的寄存器和ROM資源,單位資源下的吞吐量更大;相比類似重復累積碼結構的基于迭代譯碼的編碼算法,新方案使高性能LDPC碼的構造更為方便。以上結果都在Xilinx Virtex II pro 70 FPGA上得到驗證。 通過在實驗板上實測表明,上述基于二次擴展的QC-LDPC碼構造和相應的編碼方案能夠實現高吞吐量LDPC碼收發端,在實際應用中具有很高的價值。 目前,LDPC碼正向著非規則、自適應、信源信道及調制聯合編碼方向發展。跨層聯合編碼的構造方法,及其對應的編碼算法,也必將成為信道編碼理論未來的研究重點。

    標簽: LDPC FPGA 吞吐量 編碼

    上傳時間: 2013-07-26

    上傳用戶:qoovoop

  • 基于FPGA的JPEG壓縮系統設計與實現

    對弓網故障的檢測在列車提速的今天顯得尤其重要,原始故障圖像數據量的巨大使實時存儲和傳輸故障圖像極其困難。JPEG作為一種低復雜度、高壓縮比的圖像壓縮標準在多媒體、網絡傳輸等領域得到廣泛的應用。和相同圖像質量的其它常用文件格式(如GIF,TIFF,PCX)相比,JPEG是目前靜態圖像中壓縮比最高的。 FPGA以其設計靈活、高速的卓越特性,逐漸成為許多應用中首先器件,尤其是與Verilog和VHDL等語言的結合,大大變革了電子系統的設計方法,加速了系統的設計進程。 本文旨在研究并實現一種實時采集并對特定幀進行壓縮傳輸的方法。通過采用可編程邏輯器件FPGA來實現整個采集、顯示、壓縮和傳輸,使系統具有可定制、高速度等優點。 本文首先介紹了開發硬件可編程邏輯門陣列FPGA及其開發語言Veridlog,并介紹了FPGA的設計方法及開發流程;接著介紹了PAL制視頻采集的相關知識及設計,其中主要包括基于I2C總線的模擬視頻解碼控制、視頻的數字化ITU-R BT.601標準介紹及視頻同步信號的獲取、基于SDRAM的視頻幀存儲、VGA顯示控制設計;隨后介紹了JPEG標準,并根據故障檢測的特點,設計了針對灰度圖像壓縮的JPEG編碼器,設計中先分別對組成JPEG編碼器的二維DCT變換模塊、量化模塊、Z字掃描模塊、變換直流系數的差分脈沖編碼模塊、交流系數的游程編碼模塊、哈夫曼編碼模塊及打包模塊進行了仿真測試,然后再對整個JPEG編碼器進行了測試;最后設計了單幀視頻的SRAM緩存,并將緩存的源圖像采用本文設計的JPEG編碼器進行壓縮,再設計一個僅包含發送功能的UART 將壓縮后的碼流傳輸到PC機,在PC機上通過將接收的碼流以ASCⅡ碼的形式還原為采集圖片。 本文實現了整個采集壓縮系統,同時也進一步驗證了本文設計的灰度圖像JPEG編碼器的正確性。相信本文無論是對弓網故障的圖像檢測,還是對于JPEG編碼器的芯片設計都有一定的參考價值。

    標簽: FPGA JPEG 壓縮系統

    上傳時間: 2013-04-24

    上傳用戶:cuiqiang

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