FPGA RSIC CPU設(shè)計(jì)文檔和源碼是EDA中對(duì)CPU設(shè)計(jì)非常好用的程序
標(biāo)簽： CPU FPGA RSIC EDA
上傳時(shí)間： 2013-08-21
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基于CPLD的雙屏結(jié)構(gòu)液晶控制器的研究與設(shè)計(jì)作者：黃麗薇.doc
標(biāo)簽： CPLD 液晶控制器
上傳時(shí)間： 2013-08-22
上傳用戶：leyesome
基于FPGA的高分辨率VGA顯示控制器的設(shè)計(jì)
標(biāo)簽： FPGA VGA 高分辨率 顯示控制器
上傳時(shí)間： 2013-08-23
上傳用戶：lizhen9880
通過(guò)fpga產(chǎn)生時(shí)鐘的VHDL源碼，QII7.1下調(diào)試通過(guò)
標(biāo)簽： fpga VHDL 時(shí)鐘 源碼
上傳時(shí)間： 2013-08-24
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fpga功能實(shí)現(xiàn)有限字長(zhǎng)響應(yīng)FIR，用verilog編寫
標(biāo)簽： fpga FIR 有限字長(zhǎng)
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ACTEL A3P StartKit FPGA開發(fā)全套文擋（含測(cè)試源碼）
標(biāo)簽： StartKit ACTEL FPGA A3P
上傳時(shí)間： 2013-08-28
上傳用戶：litianchu
FPGA數(shù)字電子系統(tǒng)設(shè)計(jì)與開發(fā)實(shí)例導(dǎo)航光盤內(nèi)附源碼
標(biāo)簽： FPGA 數(shù)字電子 開發(fā)實(shí)例 導(dǎo)航
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基于FPGA液晶控制器設(shè)計(jì)與實(shí)現(xiàn)，采用VHDL硬件描述語(yǔ)言。
標(biāo)簽： FPGA VHDL 液晶 制器設(shè)計(jì)
上傳時(shí)間： 2013-08-29
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基于FPGA＋DDS的MSK數(shù)字調(diào)制源設(shè)計(jì) 通信中的DDS技術(shù)應(yīng)用
標(biāo)簽： FPGA DDS MSK 數(shù)字調(diào)制
用CPLD驅(qū)動(dòng)SJA1000 CAN控制器
標(biāo)簽： CPLD 1000 CAN SJA
上傳時(shí)間： 2013-08-31
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